Fitter report for DE1_USB_API
Thu Aug 30 15:45:29 2007
Quartus II Version 7.1 Build 178 06/25/2007 Service Pack 1 SJ Full Version


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; Table of Contents ;
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  1. Legal Notice
  2. Fitter Summary
  3. Fitter Settings
  4. Fitter Netlist Optimizations
  5. Pin-Out File
  6. Fitter Resource Usage Summary
  7. Input Pins
  8. Output Pins
  9. Bidir Pins
 10. I/O Bank Usage
 11. All Package Pins
 12. PLL Summary
 13. PLL Usage
 14. Output Pin Default Load For Reported TCO
 15. Fitter Resource Utilization by Entity
 16. Delay Chain Summary
 17. Pad To Core Delay Chain Fanout
 18. Control Signals
 19. Global & Other Fast Signals
 20. Non-Global High Fan-Out Signals
 21. Fitter RAM Summary
 22. Interconnect Usage Summary
 23. LAB Logic Elements
 24. LAB-wide Signals
 25. LAB Signals Sourced
 26. LAB Signals Sourced Out
 27. LAB Distinct Inputs
 28. Fitter Device Options
 29. Advanced Data - General
 30. Advanced Data - Placement Preparation
 31. Advanced Data - Placement
 32. Advanced Data - Routing
 33. Fitter INI Usage
 34. Fitter Messages
 35. Fitter Suppressed Messages



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; Legal Notice ;
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Copyright (C) 1991-2007 Altera Corporation
Your use of Altera Corporation's design tools, logic functions 
and other software and tools, and its AMPP partner logic 
functions, and any output files from any of the foregoing 
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; Fitter Summary                                                                     ;
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; Fitter Status                      ; Successful - Thu Aug 30 15:45:28 2007         ;
; Quartus II Version                 ; 7.1 Build 178 06/25/2007 SP 1 SJ Full Version ;
; Revision Name                      ; DE1_USB_API                                   ;
; Top-level Entity Name              ; DE1_USB_API                                   ;
; Family                             ; Cyclone II                                    ;
; Device                             ; EP2C20F484C7                                  ;
; Timing Models                      ; Final                                         ;
; Total logic elements               ; 2,117 / 18,752 ( 11 % )                       ;
;     Total combinational functions  ; 1,867 / 18,752 ( 10 % )                       ;
;     Dedicated logic registers      ; 1,004 / 18,752 ( 5 % )                        ;
; Total registers                    ; 1005                                          ;
; Total pins                         ; 283 / 315 ( 90 % )                            ;
; Total virtual pins                 ; 0                                             ;
; Total memory bits                  ; 208,000 / 239,616 ( 87 % )                    ;
; Embedded Multiplier 9-bit elements ; 0 / 52 ( 0 % )                                ;
; Total PLLs                         ; 2 / 4 ( 50 % )                                ;
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; Fitter Settings                                                                                                                         ;
+-----------------------------------------------------------------------+--------------------------------+--------------------------------+
; Option                                                                ; Setting                        ; Default Value                  ;
+-----------------------------------------------------------------------+--------------------------------+--------------------------------+
; Device                                                                ; EP2C20F484C7                   ;                                ;
; Fit Attempts to Skip                                                  ; 0                              ; 0.0                            ;
; Use TimeQuest Timing Analyzer                                         ; Off                            ;                                ;
; Always Enable Input Buffers                                           ; Off                            ; Off                            ;
; Router Timing Optimization Level                                      ; Normal                         ; Normal                         ;
; Placement Effort Multiplier                                           ; 1.0                            ; 1.0                            ;
; Router Effort Multiplier                                              ; 1.0                            ; 1.0                            ;
; Optimize Hold Timing                                                  ; IO Paths and Minimum TPD Paths ; IO Paths and Minimum TPD Paths ;
; Optimize Fast-Corner Timing                                           ; Off                            ; Off                            ;
; PowerPlay Power Optimization                                          ; Normal compilation             ; Normal compilation             ;
; Optimize Timing                                                       ; Normal compilation             ; Normal compilation             ;
; Optimize IOC Register Placement for Timing                            ; On                             ; On                             ;
; Limit to One Fitting Attempt                                          ; Off                            ; Off                            ;
; Final Placement Optimizations                                         ; Automatically                  ; Automatically                  ;
; Fitter Aggressive Routability Optimizations                           ; Automatically                  ; Automatically                  ;
; Fitter Initial Placement Seed                                         ; 1                              ; 1                              ;
; PCI I/O                                                               ; Off                            ; Off                            ;
; Weak Pull-Up Resistor                                                 ; Off                            ; Off                            ;
; Enable Bus-Hold Circuitry                                             ; Off                            ; Off                            ;
; Auto Global Memory Control Signals                                    ; Off                            ; Off                            ;
; Auto Packed Registers -- Stratix II/II GX/III Cyclone II/III Arria GX ; Auto                           ; Auto                           ;
; Auto Delay Chains                                                     ; On                             ; On                             ;
; Auto Merge PLLs                                                       ; On                             ; On                             ;
; Ignore PLL Mode When Merging PLLs                                     ; Off                            ; Off                            ;
; Perform Physical Synthesis for Combinational Logic for Fitting        ; Off                            ; Off                            ;
; Perform Physical Synthesis for Combinational Logic for Performance    ; Off                            ; Off                            ;
; Perform Register Duplication for Performance                          ; Off                            ; Off                            ;
; Perform Logic to Memory Mapping for Fitting                           ; Off                            ; Off                            ;
; Perform Register Retiming for Performance                             ; Off                            ; Off                            ;
; Perform Asynchronous Signal Pipelining                                ; Off                            ; Off                            ;
; Fitter Effort                                                         ; Auto Fit                       ; Auto Fit                       ;
; Physical Synthesis Effort Level                                       ; Normal                         ; Normal                         ;
; Auto Global Clock                                                     ; On                             ; On                             ;
; Auto Global Register Control Signals                                  ; On                             ; On                             ;
; Stop After Congestion Map Generation                                  ; Off                            ; Off                            ;
; Save Intermediate Fitting Results                                     ; Off                            ; Off                            ;
; Use smart compilation                                                 ; Off                            ; Off                            ;
+-----------------------------------------------------------------------+--------------------------------+--------------------------------+


+--------------------------------------------------------------------------------------------------------------------------------------------------------+
; Fitter Netlist Optimizations                                                                                                                           ;
+-------------------------------+-----------------+------------------+---------------------------------+-----------+------------------+------------------+
; Node                          ; Action          ; Operation        ; Reason                          ; Node Port ; Destination Node ; Destination Port ;
+-------------------------------+-----------------+------------------+---------------------------------+-----------+------------------+------------------+
; USB_JTAG:u1|JTAG_TRANS:u1|TDO ; Packed Register ; Register Packing ; Fast Output Register assignment ; REGOUT    ; TDO              ; DATAIN           ;
+-------------------------------+-----------------+------------------+---------------------------------+-----------+------------------+------------------+


+--------------+
; Pin-Out File ;
+--------------+
The pin-out file can be found in //file2/R1/DE1/cd/source/DE1_CD_v0.7/DE1_demonstrations/DE1_USB_API/HW/DE1_USB_API.pin.


+--------------------------------------------------------------------------+
; Fitter Resource Usage Summary                                            ;
+---------------------------------------------+----------------------------+
; Resource                                    ; Usage                      ;
+---------------------------------------------+----------------------------+
; Total logic elements                        ; 2,117 / 18,752 ( 11 % )    ;
;     -- Combinational with no register       ; 1113                       ;
;     -- Register only                        ; 250                        ;
;     -- Combinational with a register        ; 754                        ;
;                                             ;                            ;
; Logic element usage by number of LUT inputs ;                            ;
;     -- 4 input functions                    ; 1031                       ;
;     -- 3 input functions                    ; 348                        ;
;     -- <=2 input functions                  ; 488                        ;
;     -- Register only                        ; 250                        ;
;                                             ;                            ;
; Logic elements by mode                      ;                            ;
;     -- normal mode                          ; 1514                       ;
;     -- arithmetic mode                      ; 353                        ;
;                                             ;                            ;
; Total registers*                            ; 1,005 / 19,649 ( 5 % )     ;
;     -- Dedicated logic registers            ; 1,004 / 18,752 ( 5 % )     ;
;     -- I/O registers                        ; 1 / 897 ( < 1 % )          ;
;                                             ;                            ;
; Total LABs:  partially or completely used   ; 178 / 1,172 ( 15 % )       ;
; User inserted logic elements                ; 0                          ;
; Virtual pins                                ; 0                          ;
; I/O pins                                    ; 283 / 315 ( 90 % )         ;
;     -- Clock pins                           ; 8 / 8 ( 100 % )            ;
; Global signals                              ; 14                         ;
; M4Ks                                        ; 51 / 52 ( 98 % )           ;
; Total memory bits                           ; 208,000 / 239,616 ( 87 % ) ;
; Total RAM block bits                        ; 235,008 / 239,616 ( 98 % ) ;
; Embedded Multiplier 9-bit elements          ; 0 / 52 ( 0 % )             ;
; PLLs                                        ; 2 / 4 ( 50 % )             ;
; Global clocks                               ; 14 / 16 ( 88 % )           ;
; Average interconnect usage                  ; 4%                         ;
; Peak interconnect usage                     ; 12%                        ;
; Maximum fan-out node                        ; CLOCK_50~clkctrl           ;
; Maximum fan-out                             ; 557                        ;
; Highest non-global fan-out signal           ; KEY[0]                     ;
; Highest non-global fan-out                  ; 529                        ;
; Total fan-out                               ; 10586                      ;
; Average fan-out                             ; 3.09                       ;
+---------------------------------------------+----------------------------+
*  Register count does not include registers inside RAM blocks or DSP blocks.



+-------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Input Pins                                                                                                                                                                                                                                                        ;
+-------------+-------+----------+--------------+--------------+-------------+-----------------------+--------------------+--------+----------------+---------------+-----------------+----------+--------------+--------------+-------------+----------------------+
; Name        ; Pin # ; I/O Bank ; X coordinate ; Y coordinate ; Cell number ; Combinational Fan-Out ; Registered Fan-Out ; Global ; Input Register ; Power Up High ; PCI I/O Enabled ; Bus Hold ; Weak Pull Up ; I/O Standard ; Termination ; Location assigned by ;
+-------------+-------+----------+--------------+--------------+-------------+-----------------------+--------------------+--------+----------------+---------------+-----------------+----------+--------------+--------------+-------------+----------------------+
; AUD_ADCDAT  ; B6    ; 3        ; 3            ; 27           ; 0           ; 0                     ; 0                  ; no     ; no             ; no            ; no              ; no       ; Off          ; 3.3-V LVTTL  ; Off         ; User                 ;
; CLOCK_24[0] ; B12   ; 4        ; 24           ; 27           ; 0           ; 0                     ; 0                  ; no     ; no             ; no            ; no              ; no       ; Off          ; 3.3-V LVTTL  ; Off         ; User                 ;
; CLOCK_24[1] ; A12   ; 4        ; 24           ; 27           ; 1           ; 0                     ; 0                  ; no     ; no             ; no            ; no              ; no       ; Off          ; 3.3-V LVTTL  ; Off         ; User                 ;
; CLOCK_27[0] ; D12   ; 3        ; 24           ; 27           ; 2           ; 1                     ; 0                  ; no     ; no             ; no            ; no              ; no       ; Off          ; 3.3-V LVTTL  ; Off         ; User                 ;
; CLOCK_27[1] ; E12   ; 3        ; 24           ; 27           ; 3           ; 0                     ; 0                  ; no     ; no             ; no            ; no              ; no       ; Off          ; 3.3-V LVTTL  ; Off         ; User                 ;
; CLOCK_50    ; L1    ; 2        ; 0            ; 13           ; 0           ; 4                     ; 0                  ; yes    ; no             ; no            ; no              ; no       ; Off          ; 3.3-V LVTTL  ; Off         ; User                 ;
; EXT_CLOCK   ; M21   ; 6        ; 50           ; 14           ; 3           ; 0                     ; 0                  ; no     ; no             ; no            ; no              ; no       ; Off          ; 3.3-V LVTTL  ; Off         ; User                 ;
; KEY[0]      ; R22   ; 6        ; 50           ; 10           ; 1           ; 529                   ; 0                  ; no     ; no             ; no            ; no              ; no       ; Off          ; 3.3-V LVTTL  ; Off         ; User                 ;
; KEY[1]      ; R21   ; 6        ; 50           ; 10           ; 2           ; 0                     ; 0                  ; no     ; no             ; no            ; no              ; no       ; Off          ; 3.3-V LVTTL  ; Off         ; User                 ;
; KEY[2]      ; T22   ; 6        ; 50           ; 9            ; 0           ; 0                     ; 0                  ; no     ; no             ; no            ; no              ; no       ; Off          ; 3.3-V LVTTL  ; Off         ; User                 ;
; KEY[3]      ; T21   ; 6        ; 50           ; 9            ; 1           ; 0                     ; 0                  ; no     ; no             ; no            ; no              ; no       ; Off          ; 3.3-V LVTTL  ; Off         ; User                 ;
; PS2_CLK     ; H15   ; 4        ; 44           ; 27           ; 1           ; 1                     ; 0                  ; no     ; no             ; no            ; no              ; no       ; Off          ; 3.3-V LVTTL  ; Off         ; User                 ;
; PS2_DAT     ; J14   ; 4        ; 42           ; 27           ; 3           ; 1                     ; 0                  ; no     ; no             ; no            ; no              ; no       ; Off          ; 3.3-V LVTTL  ; Off         ; User                 ;
; SW[0]       ; L22   ; 5        ; 50           ; 14           ; 0           ; 1                     ; 0                  ; no     ; no             ; no            ; no              ; no       ; Off          ; 3.3-V LVTTL  ; Off         ; User                 ;
; SW[1]       ; L21   ; 5        ; 50           ; 14           ; 1           ; 1                     ; 0                  ; no     ; no             ; no            ; no              ; no       ; Off          ; 3.3-V LVTTL  ; Off         ; User                 ;
; SW[2]       ; M22   ; 6        ; 50           ; 14           ; 2           ; 0                     ; 0                  ; no     ; no             ; no            ; no              ; no       ; Off          ; 3.3-V LVTTL  ; Off         ; User                 ;
; SW[3]       ; V12   ; 7        ; 26           ; 0            ; 0           ; 0                     ; 0                  ; no     ; no             ; no            ; no              ; no       ; Off          ; 3.3-V LVTTL  ; Off         ; User                 ;
; SW[4]       ; W12   ; 7        ; 26           ; 0            ; 1           ; 0                     ; 0                  ; no     ; no             ; no            ; no              ; no       ; Off          ; 3.3-V LVTTL  ; Off         ; User                 ;
; SW[5]       ; U12   ; 8        ; 26           ; 0            ; 2           ; 0                     ; 0                  ; no     ; no             ; no            ; no              ; no       ; Off          ; 3.3-V LVTTL  ; Off         ; User                 ;
; SW[6]       ; U11   ; 8        ; 26           ; 0            ; 3           ; 0                     ; 0                  ; no     ; no             ; no            ; no              ; no       ; Off          ; 3.3-V LVTTL  ; Off         ; User                 ;
; SW[7]       ; M2    ; 1        ; 0            ; 13           ; 3           ; 0                     ; 0                  ; no     ; no             ; no            ; no              ; no       ; Off          ; 3.3-V LVTTL  ; Off         ; User                 ;
; SW[8]       ; M1    ; 1        ; 0            ; 13           ; 2           ; 0                     ; 0                  ; no     ; no             ; no            ; no              ; no       ; Off          ; 3.3-V LVTTL  ; Off         ; User                 ;
; SW[9]       ; L2    ; 2        ; 0            ; 13           ; 1           ; 0                     ; 0                  ; no     ; no             ; no            ; no              ; no       ; Off          ; 3.3-V LVTTL  ; Off         ; User                 ;
; TCK         ; C7    ; 3        ; 7            ; 27           ; 2           ; 1                     ; 0                  ; yes    ; no             ; no            ; no              ; no       ; Off          ; 3.3-V LVTTL  ; Off         ; User                 ;
; TCS         ; D8    ; 3        ; 9            ; 27           ; 0           ; 1                     ; 0                  ; yes    ; no             ; no            ; no              ; no       ; Off          ; 3.3-V LVTTL  ; Off         ; User                 ;
; TDI         ; E8    ; 3        ; 11           ; 27           ; 3           ; 1                     ; 0                  ; yes    ; no             ; no            ; no              ; no       ; Off          ; 3.3-V LVTTL  ; Off         ; User                 ;
; UART_RXD    ; F14   ; 4        ; 35           ; 27           ; 2           ; 0                     ; 0                  ; no     ; no             ; no            ; no              ; no       ; Off          ; 3.3-V LVTTL  ; Off         ; User                 ;
+-------------+-------+----------+--------------+--------------+-------------+-----------------------+--------------------+--------+----------------+---------------+-----------------+----------+--------------+--------------+-------------+----------------------+


+------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Output Pins                                                                                                                                                                                                                                                                                    ;
+---------------+-------+----------+--------------+--------------+-------------+-----------------+------------------------+---------------+-----------------+------------+---------------+----------+--------------+--------------+------------------+-------------+----------------------+------+
; Name          ; Pin # ; I/O Bank ; X coordinate ; Y coordinate ; Cell number ; Output Register ; Output Enable Register ; Power Up High ; PCI I/O Enabled ; Open Drain ; TRI Primitive ; Bus Hold ; Weak Pull Up ; I/O Standard ; Current Strength ; Termination ; Location assigned by ; Load ;
+---------------+-------+----------+--------------+--------------+-------------+-----------------+------------------------+---------------+-----------------+------------+---------------+----------+--------------+--------------+------------------+-------------+----------------------+------+
; AUD_ADCLRCK   ; A6    ; 3        ; 3            ; 27           ; 1           ; no              ; no                     ; no            ; no              ; no         ; no            ; no       ; Off          ; 3.3-V LVTTL  ; 24mA             ; Off         ; User                 ; 0 pF ;
; AUD_DACDAT    ; B5    ; 3        ; 3            ; 27           ; 2           ; no              ; no                     ; no            ; no              ; no         ; no            ; no       ; Off          ; 3.3-V LVTTL  ; 24mA             ; Off         ; User                 ; 0 pF ;
; AUD_DACLRCK   ; A5    ; 3        ; 3            ; 27           ; 3           ; no              ; no                     ; no            ; no              ; no         ; no            ; no       ; Off          ; 3.3-V LVTTL  ; 24mA             ; Off         ; User                 ; 0 pF ;
; AUD_XCK       ; B4    ; 3        ; 1            ; 27           ; 0           ; no              ; no                     ; no            ; no              ; no         ; no            ; no       ; Off          ; 3.3-V LVTTL  ; 24mA             ; Off         ; User                 ; 0 pF ;
; DRAM_ADDR[0]  ; W4    ; 1        ; 0            ; 3            ; 1           ; no              ; no                     ; no            ; no              ; no         ; no            ; no       ; Off          ; 3.3-V LVTTL  ; 24mA             ; Off         ; User                 ; 0 pF ;
; DRAM_ADDR[10] ; W3    ; 1        ; 0            ; 3            ; 0           ; no              ; no                     ; no            ; no              ; no         ; no            ; no       ; Off          ; 3.3-V LVTTL  ; 24mA             ; Off         ; User                 ; 0 pF ;
; DRAM_ADDR[11] ; N6    ; 1        ; 0            ; 11           ; 2           ; no              ; no                     ; no            ; no              ; no         ; no            ; no       ; Off          ; 3.3-V LVTTL  ; 24mA             ; Off         ; User                 ; 0 pF ;
; DRAM_ADDR[1]  ; W5    ; 1        ; 0            ; 2            ; 0           ; no              ; no                     ; no            ; no              ; no         ; no            ; no       ; Off          ; 3.3-V LVTTL  ; 24mA             ; Off         ; User                 ; 0 pF ;
; DRAM_ADDR[2]  ; Y3    ; 1        ; 0            ; 3            ; 2           ; no              ; no                     ; no            ; no              ; no         ; no            ; no       ; Off          ; 3.3-V LVTTL  ; 24mA             ; Off         ; User                 ; 0 pF ;
; DRAM_ADDR[3]  ; Y4    ; 1        ; 0            ; 3            ; 3           ; no              ; no                     ; no            ; no              ; no         ; no            ; no       ; Off          ; 3.3-V LVTTL  ; 24mA             ; Off         ; User                 ; 0 pF ;
; DRAM_ADDR[4]  ; R6    ; 1        ; 0            ; 7            ; 3           ; no              ; no                     ; no            ; no              ; no         ; no            ; no       ; Off          ; 3.3-V LVTTL  ; 24mA             ; Off         ; User                 ; 0 pF ;
; DRAM_ADDR[5]  ; R5    ; 1        ; 0            ; 7            ; 2           ; no              ; no                     ; no            ; no              ; no         ; no            ; no       ; Off          ; 3.3-V LVTTL  ; 24mA             ; Off         ; User                 ; 0 pF ;
; DRAM_ADDR[6]  ; P6    ; 1        ; 0            ; 9            ; 3           ; no              ; no                     ; no            ; no              ; no         ; no            ; no       ; Off          ; 3.3-V LVTTL  ; 24mA             ; Off         ; User                 ; 0 pF ;
; DRAM_ADDR[7]  ; P5    ; 1        ; 0            ; 9            ; 2           ; no              ; no                     ; no            ; no              ; no         ; no            ; no       ; Off          ; 3.3-V LVTTL  ; 24mA             ; Off         ; User                 ; 0 pF ;
; DRAM_ADDR[8]  ; P3    ; 1        ; 0            ; 10           ; 0           ; no              ; no                     ; no            ; no              ; no         ; no            ; no       ; Off          ; 3.3-V LVTTL  ; 24mA             ; Off         ; User                 ; 0 pF ;
; DRAM_ADDR[9]  ; N4    ; 1        ; 0            ; 10           ; 2           ; no              ; no                     ; no            ; no              ; no         ; no            ; no       ; Off          ; 3.3-V LVTTL  ; 24mA             ; Off         ; User                 ; 0 pF ;
; DRAM_BA_0     ; U3    ; 1        ; 0            ; 5            ; 2           ; no              ; no                     ; no            ; no              ; no         ; no            ; no       ; Off          ; 3.3-V LVTTL  ; 24mA             ; Off         ; User                 ; 0 pF ;
; DRAM_BA_1     ; V4    ; 1        ; 0            ; 2            ; 2           ; no              ; no                     ; no            ; no              ; no         ; no            ; no       ; Off          ; 3.3-V LVTTL  ; 24mA             ; Off         ; User                 ; 0 pF ;
; DRAM_CAS_N    ; T3    ; 1        ; 0            ; 5            ; 1           ; no              ; no                     ; no            ; no              ; no         ; no            ; no       ; Off          ; 3.3-V LVTTL  ; 24mA             ; Off         ; User                 ; 0 pF ;
; DRAM_CKE      ; N3    ; 1        ; 0            ; 10           ; 1           ; no              ; no                     ; no            ; no              ; no         ; no            ; no       ; Off          ; 3.3-V LVTTL  ; 24mA             ; Off         ; User                 ; 0 pF ;
; DRAM_CLK      ; U4    ; 1        ; 0            ; 2            ; 1           ; no              ; no                     ; no            ; no              ; no         ; no            ; no       ; Off          ; 3.3-V LVTTL  ; 24mA             ; Off         ; User                 ; 0 pF ;
; DRAM_CS_N     ; T6    ; 1        ; 0            ; 5            ; 0           ; no              ; no                     ; no            ; no              ; no         ; no            ; no       ; Off          ; 3.3-V LVTTL  ; 24mA             ; Off         ; User                 ; 0 pF ;
; DRAM_LDQM     ; R7    ; 1        ; 0            ; 9            ; 1           ; no              ; no                     ; no            ; no              ; no         ; no            ; no       ; Off          ; 3.3-V LVTTL  ; 24mA             ; Off         ; User                 ; 0 pF ;
; DRAM_RAS_N    ; T5    ; 1        ; 0            ; 6            ; 2           ; no              ; no                     ; no            ; no              ; no         ; no            ; no       ; Off          ; 3.3-V LVTTL  ; 24mA             ; Off         ; User                 ; 0 pF ;
; DRAM_UDQM     ; M5    ; 1        ; 0            ; 12           ; 0           ; no              ; no                     ; no            ; no              ; no         ; no            ; no       ; Off          ; 3.3-V LVTTL  ; 24mA             ; Off         ; User                 ; 0 pF ;
; DRAM_WE_N     ; R8    ; 1        ; 0            ; 9            ; 0           ; no              ; no                     ; no            ; no              ; no         ; no            ; no       ; Off          ; 3.3-V LVTTL  ; 24mA             ; Off         ; User                 ; 0 pF ;
; FL_ADDR[0]    ; AB20  ; 7        ; 48           ; 0            ; 1           ; no              ; no                     ; no            ; no              ; no         ; no            ; no       ; Off          ; 3.3-V LVTTL  ; 24mA             ; Off         ; User                 ; 0 pF ;
; FL_ADDR[10]   ; R12   ; 7        ; 33           ; 0            ; 3           ; no              ; no                     ; no            ; no              ; no         ; no            ; no       ; Off          ; 3.3-V LVTTL  ; 24mA             ; Off         ; User                 ; 0 pF ;
; FL_ADDR[11]   ; T12   ; 7        ; 31           ; 0            ; 2           ; no              ; no                     ; no            ; no              ; no         ; no            ; no       ; Off          ; 3.3-V LVTTL  ; 24mA             ; Off         ; User                 ; 0 pF ;
; FL_ADDR[12]   ; AB14  ; 7        ; 33           ; 0            ; 2           ; no              ; no                     ; no            ; no              ; no         ; no            ; no       ; Off          ; 3.3-V LVTTL  ; 24mA             ; Off         ; User                 ; 0 pF ;
; FL_ADDR[13]   ; AA13  ; 7        ; 29           ; 0            ; 0           ; no              ; no                     ; no            ; no              ; no         ; no            ; no       ; Off          ; 3.3-V LVTTL  ; 24mA             ; Off         ; User                 ; 0 pF ;
; FL_ADDR[14]   ; AB13  ; 7        ; 29           ; 0            ; 1           ; no              ; no                     ; no            ; no              ; no         ; no            ; no       ; Off          ; 3.3-V LVTTL  ; 24mA             ; Off         ; User                 ; 0 pF ;
; FL_ADDR[15]   ; AA12  ; 7        ; 29           ; 0            ; 2           ; no              ; no                     ; no            ; no              ; no         ; no            ; no       ; Off          ; 3.3-V LVTTL  ; 24mA             ; Off         ; User                 ; 0 pF ;
; FL_ADDR[16]   ; AB12  ; 7        ; 29           ; 0            ; 3           ; no              ; no                     ; no            ; no              ; no         ; no            ; no       ; Off          ; 3.3-V LVTTL  ; 24mA             ; Off         ; User                 ; 0 pF ;
; FL_ADDR[17]   ; AA20  ; 7        ; 48           ; 0            ; 0           ; no              ; no                     ; no            ; no              ; no         ; no            ; no       ; Off          ; 3.3-V LVTTL  ; 24mA             ; Off         ; User                 ; 0 pF ;
; FL_ADDR[18]   ; U14   ; 7        ; 39           ; 0            ; 3           ; no              ; no                     ; no            ; no              ; no         ; no            ; no       ; Off          ; 3.3-V LVTTL  ; 24mA             ; Off         ; User                 ; 0 pF ;
; FL_ADDR[19]   ; V14   ; 7        ; 37           ; 0            ; 3           ; no              ; no                     ; no            ; no              ; no         ; no            ; no       ; Off          ; 3.3-V LVTTL  ; 24mA             ; Off         ; User                 ; 0 pF ;
; FL_ADDR[1]    ; AA14  ; 7        ; 33           ; 0            ; 1           ; no              ; no                     ; no            ; no              ; no         ; no            ; no       ; Off          ; 3.3-V LVTTL  ; 24mA             ; Off         ; User                 ; 0 pF ;
; FL_ADDR[20]   ; U13   ; 7        ; 31           ; 0            ; 1           ; no              ; no                     ; no            ; no              ; no         ; no            ; no       ; Off          ; 3.3-V LVTTL  ; 24mA             ; Off         ; User                 ; 0 pF ;
; FL_ADDR[21]   ; R13   ; 7        ; 37           ; 0            ; 0           ; no              ; no                     ; no            ; no              ; no         ; no            ; no       ; Off          ; 3.3-V LVTTL  ; 24mA             ; Off         ; User                 ; 0 pF ;
; FL_ADDR[2]    ; Y16   ; 7        ; 44           ; 0            ; 2           ; no              ; no                     ; no            ; no              ; no         ; no            ; no       ; Off          ; 3.3-V LVTTL  ; 24mA             ; Off         ; User                 ; 0 pF ;
; FL_ADDR[3]    ; R15   ; 7        ; 42           ; 0            ; 1           ; no              ; no                     ; no            ; no              ; no         ; no            ; no       ; Off          ; 3.3-V LVTTL  ; 24mA             ; Off         ; User                 ; 0 pF ;
; FL_ADDR[4]    ; T15   ; 7        ; 39           ; 0            ; 2           ; no              ; no                     ; no            ; no              ; no         ; no            ; no       ; Off          ; 3.3-V LVTTL  ; 24mA             ; Off         ; User                 ; 0 pF ;
; FL_ADDR[5]    ; U15   ; 7        ; 46           ; 0            ; 3           ; no              ; no                     ; no            ; no              ; no         ; no            ; no       ; Off          ; 3.3-V LVTTL  ; 24mA             ; Off         ; User                 ; 0 pF ;
; FL_ADDR[6]    ; V15   ; 7        ; 46           ; 0            ; 2           ; no              ; no                     ; no            ; no              ; no         ; no            ; no       ; Off          ; 3.3-V LVTTL  ; 24mA             ; Off         ; User                 ; 0 pF ;
; FL_ADDR[7]    ; W15   ; 7        ; 39           ; 0            ; 0           ; no              ; no                     ; no            ; no              ; no         ; no            ; no       ; Off          ; 3.3-V LVTTL  ; 24mA             ; Off         ; User                 ; 0 pF ;
; FL_ADDR[8]    ; R14   ; 7        ; 42           ; 0            ; 2           ; no              ; no                     ; no            ; no              ; no         ; no            ; no       ; Off          ; 3.3-V LVTTL  ; 24mA             ; Off         ; User                 ; 0 pF ;
; FL_ADDR[9]    ; Y13   ; 7        ; 31           ; 0            ; 0           ; no              ; no                     ; no            ; no              ; no         ; no            ; no       ; Off          ; 3.3-V LVTTL  ; 24mA             ; Off         ; User                 ; 0 pF ;
; FL_CE_N       ; AB15  ; 7        ; 33           ; 0            ; 0           ; no              ; no                     ; no            ; no              ; no         ; no            ; no       ; Off          ; 3.3-V LVTTL  ; 24mA             ; Off         ; User                 ; 0 pF ;
; FL_OE_N       ; AA15  ; 7        ; 35           ; 0            ; 3           ; no              ; no                     ; no            ; no              ; no         ; no            ; no       ; Off          ; 3.3-V LVTTL  ; 24mA             ; Off         ; User                 ; 0 pF ;
; FL_RST_N      ; W14   ; 7        ; 35           ; 0            ; 0           ; no              ; no                     ; no            ; no              ; no         ; no            ; no       ; Off          ; 3.3-V LVTTL  ; 24mA             ; Off         ; User                 ; 0 pF ;
; FL_WE_N       ; Y14   ; 7        ; 39           ; 0            ; 1           ; no              ; no                     ; no            ; no              ; no         ; no            ; no       ; Off          ; 3.3-V LVTTL  ; 24mA             ; Off         ; User                 ; 0 pF ;
; HEX0[0]       ; J2    ; 2        ; 0            ; 18           ; 2           ; no              ; no                     ; no            ; no              ; no         ; no            ; no       ; Off          ; 3.3-V LVTTL  ; 24mA             ; Off         ; User                 ; 0 pF ;
; HEX0[1]       ; J1    ; 2        ; 0            ; 18           ; 1           ; no              ; no                     ; no            ; no              ; no         ; no            ; no       ; Off          ; 3.3-V LVTTL  ; 24mA             ; Off         ; User                 ; 0 pF ;
; HEX0[2]       ; H2    ; 2        ; 0            ; 19           ; 1           ; no              ; no                     ; no            ; no              ; no         ; no            ; no       ; Off          ; 3.3-V LVTTL  ; 24mA             ; Off         ; User                 ; 0 pF ;
; HEX0[3]       ; H1    ; 2        ; 0            ; 19           ; 0           ; no              ; no                     ; no            ; no              ; no         ; no            ; no       ; Off          ; 3.3-V LVTTL  ; 24mA             ; Off         ; User                 ; 0 pF ;
; HEX0[4]       ; F2    ; 2        ; 0            ; 20           ; 3           ; no              ; no                     ; no            ; no              ; no         ; no            ; no       ; Off          ; 3.3-V LVTTL  ; 24mA             ; Off         ; User                 ; 0 pF ;
; HEX0[5]       ; F1    ; 2        ; 0            ; 20           ; 2           ; no              ; no                     ; no            ; no              ; no         ; no            ; no       ; Off          ; 3.3-V LVTTL  ; 24mA             ; Off         ; User                 ; 0 pF ;
; HEX0[6]       ; E2    ; 2        ; 0            ; 20           ; 1           ; no              ; no                     ; no            ; no              ; no         ; no            ; no       ; Off          ; 3.3-V LVTTL  ; 24mA             ; Off         ; User                 ; 0 pF ;
; HEX1[0]       ; E1    ; 2        ; 0            ; 20           ; 0           ; no              ; no                     ; no            ; no              ; no         ; no            ; no       ; Off          ; 3.3-V LVTTL  ; 24mA             ; Off         ; User                 ; 0 pF ;
; HEX1[1]       ; H6    ; 2        ; 0            ; 21           ; 3           ; no              ; no                     ; no            ; no              ; no         ; no            ; no       ; Off          ; 3.3-V LVTTL  ; 24mA             ; Off         ; User                 ; 0 pF ;
; HEX1[2]       ; H5    ; 2        ; 0            ; 21           ; 2           ; no              ; no                     ; no            ; no              ; no         ; no            ; no       ; Off          ; 3.3-V LVTTL  ; 24mA             ; Off         ; User                 ; 0 pF ;
; HEX1[3]       ; H4    ; 2        ; 0            ; 21           ; 1           ; no              ; no                     ; no            ; no              ; no         ; no            ; no       ; Off          ; 3.3-V LVTTL  ; 24mA             ; Off         ; User                 ; 0 pF ;
; HEX1[4]       ; G3    ; 2        ; 0            ; 21           ; 0           ; no              ; no                     ; no            ; no              ; no         ; no            ; no       ; Off          ; 3.3-V LVTTL  ; 24mA             ; Off         ; User                 ; 0 pF ;
; HEX1[5]       ; D2    ; 2        ; 0            ; 22           ; 3           ; no              ; no                     ; no            ; no              ; no         ; no            ; no       ; Off          ; 3.3-V LVTTL  ; 24mA             ; Off         ; User                 ; 0 pF ;
; HEX1[6]       ; D1    ; 2        ; 0            ; 22           ; 2           ; no              ; no                     ; no            ; no              ; no         ; no            ; no       ; Off          ; 3.3-V LVTTL  ; 24mA             ; Off         ; User                 ; 0 pF ;
; HEX2[0]       ; G5    ; 2        ; 0            ; 22           ; 0           ; no              ; no                     ; no            ; no              ; no         ; no            ; no       ; Off          ; 3.3-V LVTTL  ; 24mA             ; Off         ; User                 ; 0 pF ;
; HEX2[1]       ; G6    ; 2        ; 0            ; 23           ; 3           ; no              ; no                     ; no            ; no              ; no         ; no            ; no       ; Off          ; 3.3-V LVTTL  ; 24mA             ; Off         ; User                 ; 0 pF ;
; HEX2[2]       ; C2    ; 2        ; 0            ; 23           ; 1           ; no              ; no                     ; no            ; no              ; no         ; no            ; no       ; Off          ; 3.3-V LVTTL  ; 24mA             ; Off         ; User                 ; 0 pF ;
; HEX2[3]       ; C1    ; 2        ; 0            ; 23           ; 0           ; no              ; no                     ; no            ; no              ; no         ; no            ; no       ; Off          ; 3.3-V LVTTL  ; 24mA             ; Off         ; User                 ; 0 pF ;
; HEX2[4]       ; E3    ; 2        ; 0            ; 24           ; 2           ; no              ; no                     ; no            ; no              ; no         ; no            ; no       ; Off          ; 3.3-V LVTTL  ; 24mA             ; Off         ; User                 ; 0 pF ;
; HEX2[5]       ; E4    ; 2        ; 0            ; 24           ; 3           ; no              ; no                     ; no            ; no              ; no         ; no            ; no       ; Off          ; 3.3-V LVTTL  ; 24mA             ; Off         ; User                 ; 0 pF ;
; HEX2[6]       ; D3    ; 2        ; 0            ; 25           ; 2           ; no              ; no                     ; no            ; no              ; no         ; no            ; no       ; Off          ; 3.3-V LVTTL  ; 24mA             ; Off         ; User                 ; 0 pF ;
; HEX3[0]       ; F4    ; 2        ; 0            ; 23           ; 2           ; no              ; no                     ; no            ; no              ; no         ; no            ; no       ; Off          ; 3.3-V LVTTL  ; 24mA             ; Off         ; User                 ; 0 pF ;
; HEX3[1]       ; D5    ; 2        ; 0            ; 24           ; 0           ; no              ; no                     ; no            ; no              ; no         ; no            ; no       ; Off          ; 3.3-V LVTTL  ; 24mA             ; Off         ; User                 ; 0 pF ;
; HEX3[2]       ; D6    ; 2        ; 0            ; 24           ; 1           ; no              ; no                     ; no            ; no              ; no         ; no            ; no       ; Off          ; 3.3-V LVTTL  ; 24mA             ; Off         ; User                 ; 0 pF ;
; HEX3[3]       ; J4    ; 2        ; 0            ; 18           ; 0           ; no              ; no                     ; no            ; no              ; no         ; no            ; no       ; Off          ; 3.3-V LVTTL  ; 24mA             ; Off         ; User                 ; 0 pF ;
; HEX3[4]       ; L8    ; 2        ; 0            ; 19           ; 2           ; no              ; no                     ; no            ; no              ; no         ; no            ; no       ; Off          ; 3.3-V LVTTL  ; 24mA             ; Off         ; User                 ; 0 pF ;
; HEX3[5]       ; F3    ; 2        ; 0            ; 22           ; 1           ; no              ; no                     ; no            ; no              ; no         ; no            ; no       ; Off          ; 3.3-V LVTTL  ; 24mA             ; Off         ; User                 ; 0 pF ;
; HEX3[6]       ; D4    ; 2        ; 0            ; 25           ; 3           ; no              ; no                     ; no            ; no              ; no         ; no            ; no       ; Off          ; 3.3-V LVTTL  ; 24mA             ; Off         ; User                 ; 0 pF ;
; I2C_SCLK      ; A3    ; 3        ; 1            ; 27           ; 2           ; no              ; no                     ; no            ; no              ; no         ; no            ; no       ; Off          ; 3.3-V LVTTL  ; 24mA             ; Off         ; User                 ; 0 pF ;
; LEDG[0]       ; U22   ; 6        ; 50           ; 7            ; 0           ; no              ; no                     ; no            ; no              ; no         ; no            ; no       ; Off          ; 3.3-V LVTTL  ; 24mA             ; Off         ; User                 ; 0 pF ;
; LEDG[1]       ; U21   ; 6        ; 50           ; 7            ; 1           ; no              ; no                     ; no            ; no              ; no         ; no            ; no       ; Off          ; 3.3-V LVTTL  ; 24mA             ; Off         ; User                 ; 0 pF ;
; LEDG[2]       ; V22   ; 6        ; 50           ; 7            ; 2           ; no              ; no                     ; no            ; no              ; no         ; no            ; no       ; Off          ; 3.3-V LVTTL  ; 24mA             ; Off         ; User                 ; 0 pF ;
; LEDG[3]       ; V21   ; 6        ; 50           ; 6            ; 0           ; no              ; no                     ; no            ; no              ; no         ; no            ; no       ; Off          ; 3.3-V LVTTL  ; 24mA             ; Off         ; User                 ; 0 pF ;
; LEDG[4]       ; W22   ; 6        ; 50           ; 5            ; 2           ; no              ; no                     ; no            ; no              ; no         ; no            ; no       ; Off          ; 3.3-V LVTTL  ; 24mA             ; Off         ; User                 ; 0 pF ;
; LEDG[5]       ; W21   ; 6        ; 50           ; 4            ; 0           ; no              ; no                     ; no            ; no              ; no         ; no            ; no       ; Off          ; 3.3-V LVTTL  ; 24mA             ; Off         ; User                 ; 0 pF ;
; LEDG[6]       ; Y22   ; 6        ; 50           ; 6            ; 1           ; no              ; no                     ; no            ; no              ; no         ; no            ; no       ; Off          ; 3.3-V LVTTL  ; 24mA             ; Off         ; User                 ; 0 pF ;
; LEDG[7]       ; Y21   ; 6        ; 50           ; 6            ; 2           ; no              ; no                     ; no            ; no              ; no         ; no            ; no       ; Off          ; 3.3-V LVTTL  ; 24mA             ; Off         ; User                 ; 0 pF ;
; LEDR[0]       ; R20   ; 6        ; 50           ; 10           ; 0           ; no              ; no                     ; no            ; no              ; no         ; no            ; no       ; Off          ; 3.3-V LVTTL  ; 24mA             ; Off         ; User                 ; 0 pF ;
; LEDR[1]       ; R19   ; 6        ; 50           ; 8            ; 1           ; no              ; no                     ; no            ; no              ; no         ; no            ; no       ; Off          ; 3.3-V LVTTL  ; 24mA             ; Off         ; User                 ; 0 pF ;
; LEDR[2]       ; U19   ; 6        ; 50           ; 4            ; 2           ; no              ; no                     ; no            ; no              ; no         ; no            ; no       ; Off          ; 3.3-V LVTTL  ; 24mA             ; Off         ; User                 ; 0 pF ;
; LEDR[3]       ; Y19   ; 6        ; 50           ; 2            ; 0           ; no              ; no                     ; no            ; no              ; no         ; no            ; no       ; Off          ; 3.3-V LVTTL  ; 24mA             ; Off         ; User                 ; 0 pF ;
; LEDR[4]       ; T18   ; 6        ; 50           ; 3            ; 0           ; no              ; no                     ; no            ; no              ; no         ; no            ; no       ; Off          ; 3.3-V LVTTL  ; 24mA             ; Off         ; User                 ; 0 pF ;
; LEDR[5]       ; V19   ; 6        ; 50           ; 2            ; 2           ; no              ; no                     ; no            ; no              ; no         ; no            ; no       ; Off          ; 3.3-V LVTTL  ; 24mA             ; Off         ; User                 ; 0 pF ;
; LEDR[6]       ; Y18   ; 6        ; 50           ; 2            ; 3           ; no              ; no                     ; no            ; no              ; no         ; no            ; no       ; Off          ; 3.3-V LVTTL  ; 24mA             ; Off         ; User                 ; 0 pF ;
; LEDR[7]       ; U18   ; 6        ; 50           ; 3            ; 1           ; no              ; no                     ; no            ; no              ; no         ; no            ; no       ; Off          ; 3.3-V LVTTL  ; 24mA             ; Off         ; User                 ; 0 pF ;
; LEDR[8]       ; R18   ; 6        ; 50           ; 8            ; 2           ; no              ; no                     ; no            ; no              ; no         ; no            ; no       ; Off          ; 3.3-V LVTTL  ; 24mA             ; Off         ; User                 ; 0 pF ;
; LEDR[9]       ; R17   ; 6        ; 50           ; 5            ; 0           ; no              ; no                     ; no            ; no              ; no         ; no            ; no       ; Off          ; 3.3-V LVTTL  ; 24mA             ; Off         ; User                 ; 0 pF ;
; SD_CLK        ; H8    ; 3        ; 7            ; 27           ; 1           ; no              ; no                     ; no            ; no              ; no         ; no            ; no       ; Off          ; 3.3-V LVTTL  ; 24mA             ; Off         ; Fitter               ; 0 pF ;
; SRAM_ADDR[0]  ; AA3   ; 8        ; 1            ; 0            ; 3           ; no              ; no                     ; no            ; no              ; no         ; no            ; no       ; Off          ; 3.3-V LVTTL  ; 24mA             ; Off         ; User                 ; 0 pF ;
; SRAM_ADDR[10] ; R11   ; 8        ; 20           ; 0            ; 2           ; no              ; no                     ; no            ; no              ; no         ; no            ; no       ; Off          ; 3.3-V LVTTL  ; 24mA             ; Off         ; User                 ; 0 pF ;
; SRAM_ADDR[11] ; T11   ; 8        ; 18           ; 0            ; 0           ; no              ; no                     ; no            ; no              ; no         ; no            ; no       ; Off          ; 3.3-V LVTTL  ; 24mA             ; Off         ; User                 ; 0 pF ;
; SRAM_ADDR[12] ; Y10   ; 8        ; 15           ; 0            ; 0           ; no              ; no                     ; no            ; no              ; no         ; no            ; no       ; Off          ; 3.3-V LVTTL  ; 24mA             ; Off         ; User                 ; 0 pF ;
; SRAM_ADDR[13] ; U10   ; 8        ; 13           ; 0            ; 2           ; no              ; no                     ; no            ; no              ; no         ; no            ; no       ; Off          ; 3.3-V LVTTL  ; 24mA             ; Off         ; User                 ; 0 pF ;
; SRAM_ADDR[14] ; R10   ; 8        ; 13           ; 0            ; 1           ; no              ; no                     ; no            ; no              ; no         ; no            ; no       ; Off          ; 3.3-V LVTTL  ; 24mA             ; Off         ; User                 ; 0 pF ;
; SRAM_ADDR[15] ; T7    ; 8        ; 5            ; 0            ; 2           ; no              ; no                     ; no            ; no              ; no         ; no            ; no       ; Off          ; 3.3-V LVTTL  ; 24mA             ; Off         ; User                 ; 0 pF ;
; SRAM_ADDR[16] ; Y6    ; 8        ; 3            ; 0            ; 2           ; no              ; no                     ; no            ; no              ; no         ; no            ; no       ; Off          ; 3.3-V LVTTL  ; 24mA             ; Off         ; User                 ; 0 pF ;
; SRAM_ADDR[17] ; Y5    ; 8        ; 3            ; 0            ; 3           ; no              ; no                     ; no            ; no              ; no         ; no            ; no       ; Off          ; 3.3-V LVTTL  ; 24mA             ; Off         ; User                 ; 0 pF ;
; SRAM_ADDR[1]  ; AB3   ; 8        ; 1            ; 0            ; 2           ; no              ; no                     ; no            ; no              ; no         ; no            ; no       ; Off          ; 3.3-V LVTTL  ; 24mA             ; Off         ; User                 ; 0 pF ;
; SRAM_ADDR[2]  ; AA4   ; 8        ; 1            ; 0            ; 0           ; no              ; no                     ; no            ; no              ; no         ; no            ; no       ; Off          ; 3.3-V LVTTL  ; 24mA             ; Off         ; User                 ; 0 pF ;
; SRAM_ADDR[3]  ; AB4   ; 8        ; 1            ; 0            ; 1           ; no              ; no                     ; no            ; no              ; no         ; no            ; no       ; Off          ; 3.3-V LVTTL  ; 24mA             ; Off         ; User                 ; 0 pF ;
; SRAM_ADDR[4]  ; AA5   ; 8        ; 3            ; 0            ; 0           ; no              ; no                     ; no            ; no              ; no         ; no            ; no       ; Off          ; 3.3-V LVTTL  ; 24mA             ; Off         ; User                 ; 0 pF ;
; SRAM_ADDR[5]  ; AB10  ; 8        ; 22           ; 0            ; 1           ; no              ; no                     ; no            ; no              ; no         ; no            ; no       ; Off          ; 3.3-V LVTTL  ; 24mA             ; Off         ; User                 ; 0 pF ;
; SRAM_ADDR[6]  ; AA11  ; 8        ; 24           ; 0            ; 0           ; no              ; no                     ; no            ; no              ; no         ; no            ; no       ; Off          ; 3.3-V LVTTL  ; 24mA             ; Off         ; User                 ; 0 pF ;
; SRAM_ADDR[7]  ; AB11  ; 8        ; 24           ; 0            ; 1           ; no              ; no                     ; no            ; no              ; no         ; no            ; no       ; Off          ; 3.3-V LVTTL  ; 24mA             ; Off         ; User                 ; 0 pF ;
; SRAM_ADDR[8]  ; V11   ; 8        ; 20           ; 0            ; 0           ; no              ; no                     ; no            ; no              ; no         ; no            ; no       ; Off          ; 3.3-V LVTTL  ; 24mA             ; Off         ; User                 ; 0 pF ;
; SRAM_ADDR[9]  ; W11   ; 8        ; 20           ; 0            ; 1           ; no              ; no                     ; no            ; no              ; no         ; no            ; no       ; Off          ; 3.3-V LVTTL  ; 24mA             ; Off         ; User                 ; 0 pF ;
; SRAM_CE_N     ; AB5   ; 8        ; 3            ; 0            ; 1           ; no              ; no                     ; no            ; no              ; no         ; no            ; no       ; Off          ; 3.3-V LVTTL  ; 24mA             ; Off         ; User                 ; 0 pF ;
; SRAM_LB_N     ; Y7    ; 8        ; 5            ; 0            ; 0           ; no              ; no                     ; no            ; no              ; no         ; no            ; no       ; Off          ; 3.3-V LVTTL  ; 24mA             ; Off         ; User                 ; 0 pF ;
; SRAM_OE_N     ; T8    ; 8        ; 5            ; 0            ; 3           ; no              ; no                     ; no            ; no              ; no         ; no            ; no       ; Off          ; 3.3-V LVTTL  ; 24mA             ; Off         ; User                 ; 0 pF ;
; SRAM_UB_N     ; W7    ; 8        ; 9            ; 0            ; 2           ; no              ; no                     ; no            ; no              ; no         ; no            ; no       ; Off          ; 3.3-V LVTTL  ; 24mA             ; Off         ; User                 ; 0 pF ;
; SRAM_WE_N     ; AA10  ; 8        ; 22           ; 0            ; 0           ; no              ; no                     ; no            ; no              ; no         ; no            ; no       ; Off          ; 3.3-V LVTTL  ; 24mA             ; Off         ; User                 ; 0 pF ;
; TDO           ; D7    ; 3        ; 9            ; 27           ; 2           ; yes             ; no                     ; no            ; no              ; no         ; no            ; no       ; Off          ; 3.3-V LVTTL  ; 24mA             ; Off         ; User                 ; 0 pF ;
; UART_TXD      ; G12   ; 4        ; 31           ; 27           ; 3           ; no              ; no                     ; no            ; no              ; no         ; no            ; no       ; Off          ; 3.3-V LVTTL  ; 24mA             ; Off         ; User                 ; 0 pF ;
; VGA_B[0]      ; A9    ; 3        ; 15           ; 27           ; 1           ; no              ; no                     ; no            ; no              ; no         ; no            ; no       ; Off          ; 3.3-V LVTTL  ; 24mA             ; Off         ; User                 ; 0 pF ;
; VGA_B[1]      ; D11   ; 3        ; 22           ; 27           ; 3           ; no              ; no                     ; no            ; no              ; no         ; no            ; no       ; Off          ; 3.3-V LVTTL  ; 24mA             ; Off         ; User                 ; 0 pF ;
; VGA_B[2]      ; A10   ; 3        ; 20           ; 27           ; 3           ; no              ; no                     ; no            ; no              ; no         ; no            ; no       ; Off          ; 3.3-V LVTTL  ; 24mA             ; Off         ; User                 ; 0 pF ;
; VGA_B[3]      ; B10   ; 3        ; 20           ; 27           ; 2           ; no              ; no                     ; no            ; no              ; no         ; no            ; no       ; Off          ; 3.3-V LVTTL  ; 24mA             ; Off         ; User                 ; 0 pF ;
; VGA_G[0]      ; B8    ; 3        ; 13           ; 27           ; 2           ; no              ; no                     ; no            ; no              ; no         ; no            ; no       ; Off          ; 3.3-V LVTTL  ; 24mA             ; Off         ; User                 ; 0 pF ;
; VGA_G[1]      ; C10   ; 3        ; 18           ; 27           ; 2           ; no              ; no                     ; no            ; no              ; no         ; no            ; no       ; Off          ; 3.3-V LVTTL  ; 24mA             ; Off         ; User                 ; 0 pF ;
; VGA_G[2]      ; B9    ; 3        ; 15           ; 27           ; 0           ; no              ; no                     ; no            ; no              ; no         ; no            ; no       ; Off          ; 3.3-V LVTTL  ; 24mA             ; Off         ; User                 ; 0 pF ;
; VGA_G[3]      ; A8    ; 3        ; 13           ; 27           ; 3           ; no              ; no                     ; no            ; no              ; no         ; no            ; no       ; Off          ; 3.3-V LVTTL  ; 24mA             ; Off         ; User                 ; 0 pF ;
; VGA_HS        ; A11   ; 3        ; 22           ; 27           ; 1           ; no              ; no                     ; no            ; no              ; no         ; no            ; no       ; Off          ; 3.3-V LVTTL  ; 24mA             ; Off         ; User                 ; 0 pF ;
; VGA_R[0]      ; D9    ; 3        ; 13           ; 27           ; 1           ; no              ; no                     ; no            ; no              ; no         ; no            ; no       ; Off          ; 3.3-V LVTTL  ; 24mA             ; Off         ; User                 ; 0 pF ;
; VGA_R[1]      ; C9    ; 3        ; 9            ; 27           ; 1           ; no              ; no                     ; no            ; no              ; no         ; no            ; no       ; Off          ; 3.3-V LVTTL  ; 24mA             ; Off         ; User                 ; 0 pF ;
; VGA_R[2]      ; A7    ; 3        ; 11           ; 27           ; 1           ; no              ; no                     ; no            ; no              ; no         ; no            ; no       ; Off          ; 3.3-V LVTTL  ; 24mA             ; Off         ; User                 ; 0 pF ;
; VGA_R[3]      ; B7    ; 3        ; 11           ; 27           ; 0           ; no              ; no                     ; no            ; no              ; no         ; no            ; no       ; Off          ; 3.3-V LVTTL  ; 24mA             ; Off         ; User                 ; 0 pF ;
; VGA_VS        ; B11   ; 3        ; 22           ; 27           ; 0           ; no              ; no                     ; no            ; no              ; no         ; no            ; no       ; Off          ; 3.3-V LVTTL  ; 24mA             ; Off         ; User                 ; 0 pF ;
+---------------+-------+----------+--------------+--------------+-------------+-----------------+------------------------+---------------+-----------------+------------+---------------+----------+--------------+--------------+------------------+-------------+----------------------+------+


+-----------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Bidir Pins                                                                                                                                                                                                                                                                                                                                          ;
+-------------+-------+----------+--------------+--------------+-------------+-----------------------+--------------------+--------+----------------+-----------------+------------------------+---------------+-----------------+------------+----------+--------------+--------------+------------------+-------------+----------------------+------+
; Name        ; Pin # ; I/O Bank ; X coordinate ; Y coordinate ; Cell number ; Combinational Fan-Out ; Registered Fan-Out ; Global ; Input Register ; Output Register ; Output Enable Register ; Power Up High ; PCI I/O Enabled ; Open Drain ; Bus Hold ; Weak Pull Up ; I/O Standard ; Current Strength ; Termination ; Location assigned by ; Load ;
+-------------+-------+----------+--------------+--------------+-------------+-----------------------+--------------------+--------+----------------+-----------------+------------------------+---------------+-----------------+------------+----------+--------------+--------------+------------------+-------------+----------------------+------+
; AUD_BCLK    ; A4    ; 3        ; 1            ; 27           ; 1           ; 0                     ; 0                  ; no     ; no             ; no              ; no                     ; no            ; no              ; no         ; no       ; Off          ; 3.3-V LVTTL  ; 24mA             ; Off         ; User                 ; 0 pF ;
; DRAM_DQ[0]  ; U1    ; 1        ; 0            ; 7            ; 0           ; 1                     ; 0                  ; no     ; no             ; no              ; no                     ; no            ; no              ; no         ; no       ; Off          ; 3.3-V LVTTL  ; 24mA             ; Off         ; User                 ; 0 pF ;
; DRAM_DQ[10] ; P1    ; 1        ; 0            ; 11           ; 0           ; 1                     ; 0                  ; no     ; no             ; no              ; no                     ; no            ; no              ; no         ; no       ; Off          ; 3.3-V LVTTL  ; 24mA             ; Off         ; User                 ; 0 pF ;
; DRAM_DQ[11] ; P2    ; 1        ; 0            ; 11           ; 1           ; 1                     ; 0                  ; no     ; no             ; no              ; no                     ; no            ; no              ; no         ; no       ; Off          ; 3.3-V LVTTL  ; 24mA             ; Off         ; User                 ; 0 pF ;
; DRAM_DQ[12] ; R1    ; 1        ; 0            ; 8            ; 0           ; 1                     ; 0                  ; no     ; no             ; no              ; no                     ; no            ; no              ; no         ; no       ; Off          ; 3.3-V LVTTL  ; 24mA             ; Off         ; User                 ; 0 pF ;
; DRAM_DQ[13] ; R2    ; 1        ; 0            ; 8            ; 1           ; 1                     ; 0                  ; no     ; no             ; no              ; no                     ; no            ; no              ; no         ; no       ; Off          ; 3.3-V LVTTL  ; 24mA             ; Off         ; User                 ; 0 pF ;
; DRAM_DQ[14] ; T1    ; 1        ; 0            ; 8            ; 2           ; 1                     ; 0                  ; no     ; no             ; no              ; no                     ; no            ; no              ; no         ; no       ; Off          ; 3.3-V LVTTL  ; 24mA             ; Off         ; User                 ; 0 pF ;
; DRAM_DQ[15] ; T2    ; 1        ; 0            ; 8            ; 3           ; 1                     ; 0                  ; no     ; no             ; no              ; no                     ; no            ; no              ; no         ; no       ; Off          ; 3.3-V LVTTL  ; 24mA             ; Off         ; User                 ; 0 pF ;
; DRAM_DQ[1]  ; U2    ; 1        ; 0            ; 7            ; 1           ; 1                     ; 0                  ; no     ; no             ; no              ; no                     ; no            ; no              ; no         ; no       ; Off          ; 3.3-V LVTTL  ; 24mA             ; Off         ; User                 ; 0 pF ;
; DRAM_DQ[2]  ; V1    ; 1        ; 0            ; 6            ; 0           ; 1                     ; 0                  ; no     ; no             ; no              ; no                     ; no            ; no              ; no         ; no       ; Off          ; 3.3-V LVTTL  ; 24mA             ; Off         ; User                 ; 0 pF ;
; DRAM_DQ[3]  ; V2    ; 1        ; 0            ; 6            ; 1           ; 1                     ; 0                  ; no     ; no             ; no              ; no                     ; no            ; no              ; no         ; no       ; Off          ; 3.3-V LVTTL  ; 24mA             ; Off         ; User                 ; 0 pF ;
; DRAM_DQ[4]  ; W1    ; 1        ; 0            ; 4            ; 0           ; 1                     ; 0                  ; no     ; no             ; no              ; no                     ; no            ; no              ; no         ; no       ; Off          ; 3.3-V LVTTL  ; 24mA             ; Off         ; User                 ; 0 pF ;
; DRAM_DQ[5]  ; W2    ; 1        ; 0            ; 4            ; 1           ; 1                     ; 0                  ; no     ; no             ; no              ; no                     ; no            ; no              ; no         ; no       ; Off          ; 3.3-V LVTTL  ; 24mA             ; Off         ; User                 ; 0 pF ;
; DRAM_DQ[6]  ; Y1    ; 1        ; 0            ; 4            ; 2           ; 1                     ; 0                  ; no     ; no             ; no              ; no                     ; no            ; no              ; no         ; no       ; Off          ; 3.3-V LVTTL  ; 24mA             ; Off         ; User                 ; 0 pF ;
; DRAM_DQ[7]  ; Y2    ; 1        ; 0            ; 4            ; 3           ; 1                     ; 0                  ; no     ; no             ; no              ; no                     ; no            ; no              ; no         ; no       ; Off          ; 3.3-V LVTTL  ; 24mA             ; Off         ; User                 ; 0 pF ;
; DRAM_DQ[8]  ; N1    ; 1        ; 0            ; 12           ; 2           ; 1                     ; 0                  ; no     ; no             ; no              ; no                     ; no            ; no              ; no         ; no       ; Off          ; 3.3-V LVTTL  ; 24mA             ; Off         ; User                 ; 0 pF ;
; DRAM_DQ[9]  ; N2    ; 1        ; 0            ; 12           ; 3           ; 1                     ; 0                  ; no     ; no             ; no              ; no                     ; no            ; no              ; no         ; no       ; Off          ; 3.3-V LVTTL  ; 24mA             ; Off         ; User                 ; 0 pF ;
; FL_DQ[0]    ; AB16  ; 7        ; 35           ; 0            ; 2           ; 1                     ; 0                  ; no     ; no             ; no              ; no                     ; no            ; no              ; no         ; no       ; Off          ; 3.3-V LVTTL  ; 24mA             ; Off         ; User                 ; 0 pF ;
; FL_DQ[1]    ; AA16  ; 7        ; 35           ; 0            ; 1           ; 1                     ; 0                  ; no     ; no             ; no              ; no                     ; no            ; no              ; no         ; no       ; Off          ; 3.3-V LVTTL  ; 24mA             ; Off         ; User                 ; 0 pF ;
; FL_DQ[2]    ; AB17  ; 7        ; 37           ; 0            ; 2           ; 1                     ; 0                  ; no     ; no             ; no              ; no                     ; no            ; no              ; no         ; no       ; Off          ; 3.3-V LVTTL  ; 24mA             ; Off         ; User                 ; 0 pF ;
; FL_DQ[3]    ; AA17  ; 7        ; 37           ; 0            ; 1           ; 1                     ; 0                  ; no     ; no             ; no              ; no                     ; no            ; no              ; no         ; no       ; Off          ; 3.3-V LVTTL  ; 24mA             ; Off         ; User                 ; 0 pF ;
; FL_DQ[4]    ; AB18  ; 7        ; 42           ; 0            ; 0           ; 1                     ; 0                  ; no     ; no             ; no              ; no                     ; no            ; no              ; no         ; no       ; Off          ; 3.3-V LVTTL  ; 24mA             ; Off         ; User                 ; 0 pF ;
; FL_DQ[5]    ; AA18  ; 7        ; 44           ; 0            ; 3           ; 1                     ; 0                  ; no     ; no             ; no              ; no                     ; no            ; no              ; no         ; no       ; Off          ; 3.3-V LVTTL  ; 24mA             ; Off         ; User                 ; 0 pF ;
; FL_DQ[6]    ; AB19  ; 7        ; 48           ; 0            ; 3           ; 1                     ; 0                  ; no     ; no             ; no              ; no                     ; no            ; no              ; no         ; no       ; Off          ; 3.3-V LVTTL  ; 24mA             ; Off         ; User                 ; 0 pF ;
; FL_DQ[7]    ; AA19  ; 7        ; 48           ; 0            ; 2           ; 1                     ; 0                  ; no     ; no             ; no              ; no                     ; no            ; no              ; no         ; no       ; Off          ; 3.3-V LVTTL  ; 24mA             ; Off         ; User                 ; 0 pF ;
; GPIO_0[0]   ; A13   ; 4        ; 26           ; 27           ; 1           ; 0                     ; 0                  ; no     ; no             ; no              ; no                     ; no            ; no              ; yes        ; no       ; Off          ; 3.3-V LVTTL  ; 24mA             ; Off         ; User                 ; 0 pF ;
; GPIO_0[10]  ; A18   ; 4        ; 46           ; 27           ; 3           ; 0                     ; 0                  ; no     ; no             ; no              ; no                     ; no            ; no              ; yes        ; no       ; Off          ; 3.3-V LVTTL  ; 24mA             ; Off         ; User                 ; 0 pF ;
; GPIO_0[11]  ; B18   ; 4        ; 46           ; 27           ; 2           ; 0                     ; 0                  ; no     ; no             ; no              ; no                     ; no            ; no              ; yes        ; no       ; Off          ; 3.3-V LVTTL  ; 24mA             ; Off         ; User                 ; 0 pF ;
; GPIO_0[12]  ; A19   ; 4        ; 46           ; 27           ; 1           ; 0                     ; 0                  ; no     ; no             ; no              ; no                     ; no            ; no              ; yes        ; no       ; Off          ; 3.3-V LVTTL  ; 24mA             ; Off         ; User                 ; 0 pF ;
; GPIO_0[13]  ; B19   ; 4        ; 46           ; 27           ; 0           ; 0                     ; 0                  ; no     ; no             ; no              ; no                     ; no            ; no              ; yes        ; no       ; Off          ; 3.3-V LVTTL  ; 24mA             ; Off         ; User                 ; 0 pF ;
; GPIO_0[14]  ; A20   ; 4        ; 48           ; 27           ; 3           ; 0                     ; 0                  ; no     ; no             ; no              ; no                     ; no            ; no              ; yes        ; no       ; Off          ; 3.3-V LVTTL  ; 24mA             ; Off         ; User                 ; 0 pF ;
; GPIO_0[15]  ; B20   ; 4        ; 48           ; 27           ; 2           ; 0                     ; 0                  ; no     ; no             ; no              ; no                     ; no            ; no              ; yes        ; no       ; Off          ; 3.3-V LVTTL  ; 24mA             ; Off         ; User                 ; 0 pF ;
; GPIO_0[16]  ; C21   ; 5        ; 50           ; 24           ; 2           ; 0                     ; 0                  ; no     ; no             ; no              ; no                     ; no            ; no              ; yes        ; no       ; Off          ; 3.3-V LVTTL  ; 24mA             ; Off         ; User                 ; 0 pF ;
; GPIO_0[17]  ; C22   ; 5        ; 50           ; 24           ; 1           ; 0                     ; 0                  ; no     ; no             ; no              ; no                     ; no            ; no              ; yes        ; no       ; Off          ; 3.3-V LVTTL  ; 24mA             ; Off         ; User                 ; 0 pF ;
; GPIO_0[18]  ; D21   ; 5        ; 50           ; 21           ; 0           ; 0                     ; 0                  ; no     ; no             ; no              ; no                     ; no            ; no              ; yes        ; no       ; Off          ; 3.3-V LVTTL  ; 24mA             ; Off         ; User                 ; 0 pF ;
; GPIO_0[19]  ; D22   ; 5        ; 50           ; 22           ; 2           ; 0                     ; 0                  ; no     ; no             ; no              ; no                     ; no            ; no              ; yes        ; no       ; Off          ; 3.3-V LVTTL  ; 24mA             ; Off         ; User                 ; 0 pF ;
; GPIO_0[1]   ; B13   ; 4        ; 26           ; 27           ; 0           ; 0                     ; 0                  ; no     ; no             ; no              ; no                     ; no            ; no              ; yes        ; no       ; Off          ; 3.3-V LVTTL  ; 24mA             ; Off         ; User                 ; 0 pF ;
; GPIO_0[20]  ; E21   ; 5        ; 50           ; 21           ; 2           ; 0                     ; 0                  ; no     ; no             ; no              ; no                     ; no            ; no              ; yes        ; no       ; Off          ; 3.3-V LVTTL  ; 24mA             ; Off         ; User                 ; 0 pF ;
; GPIO_0[21]  ; E22   ; 5        ; 50           ; 21           ; 1           ; 0                     ; 0                  ; no     ; no             ; no              ; no                     ; no            ; no              ; yes        ; no       ; Off          ; 3.3-V LVTTL  ; 24mA             ; Off         ; User                 ; 0 pF ;
; GPIO_0[22]  ; F21   ; 5        ; 50           ; 20           ; 3           ; 0                     ; 0                  ; no     ; no             ; no              ; no                     ; no            ; no              ; yes        ; no       ; Off          ; 3.3-V LVTTL  ; 24mA             ; Off         ; User                 ; 0 pF ;
; GPIO_0[23]  ; F22   ; 5        ; 50           ; 20           ; 2           ; 0                     ; 0                  ; no     ; no             ; no              ; no                     ; no            ; no              ; yes        ; no       ; Off          ; 3.3-V LVTTL  ; 24mA             ; Off         ; User                 ; 0 pF ;
; GPIO_0[24]  ; G21   ; 5        ; 50           ; 19           ; 1           ; 0                     ; 0                  ; no     ; no             ; no              ; no                     ; no            ; no              ; yes        ; no       ; Off          ; 3.3-V LVTTL  ; 24mA             ; Off         ; User                 ; 0 pF ;
; GPIO_0[25]  ; G22   ; 5        ; 50           ; 19           ; 0           ; 0                     ; 0                  ; no     ; no             ; no              ; no                     ; no            ; no              ; yes        ; no       ; Off          ; 3.3-V LVTTL  ; 24mA             ; Off         ; User                 ; 0 pF ;
; GPIO_0[26]  ; J21   ; 5        ; 50           ; 16           ; 3           ; 0                     ; 0                  ; no     ; no             ; no              ; no                     ; no            ; no              ; yes        ; no       ; Off          ; 3.3-V LVTTL  ; 24mA             ; Off         ; User                 ; 0 pF ;
; GPIO_0[27]  ; J22   ; 5        ; 50           ; 16           ; 2           ; 0                     ; 0                  ; no     ; no             ; no              ; no                     ; no            ; no              ; yes        ; no       ; Off          ; 3.3-V LVTTL  ; 24mA             ; Off         ; User                 ; 0 pF ;
; GPIO_0[28]  ; K21   ; 5        ; 50           ; 15           ; 1           ; 0                     ; 0                  ; no     ; no             ; no              ; no                     ; no            ; no              ; yes        ; no       ; Off          ; 3.3-V LVTTL  ; 24mA             ; Off         ; User                 ; 0 pF ;
; GPIO_0[29]  ; K22   ; 5        ; 50           ; 15           ; 0           ; 0                     ; 0                  ; no     ; no             ; no              ; no                     ; no            ; no              ; yes        ; no       ; Off          ; 3.3-V LVTTL  ; 24mA             ; Off         ; User                 ; 0 pF ;
; GPIO_0[2]   ; A14   ; 4        ; 29           ; 27           ; 1           ; 0                     ; 0                  ; no     ; no             ; no              ; no                     ; no            ; no              ; yes        ; no       ; Off          ; 3.3-V LVTTL  ; 24mA             ; Off         ; User                 ; 0 pF ;
; GPIO_0[30]  ; J19   ; 5        ; 50           ; 17           ; 1           ; 0                     ; 0                  ; no     ; no             ; no              ; no                     ; no            ; no              ; yes        ; no       ; Off          ; 3.3-V LVTTL  ; 24mA             ; Off         ; User                 ; 0 pF ;
; GPIO_0[31]  ; J20   ; 5        ; 50           ; 16           ; 1           ; 0                     ; 0                  ; no     ; no             ; no              ; no                     ; no            ; no              ; yes        ; no       ; Off          ; 3.3-V LVTTL  ; 24mA             ; Off         ; User                 ; 0 pF ;
; GPIO_0[32]  ; J18   ; 5        ; 50           ; 17           ; 0           ; 0                     ; 0                  ; no     ; no             ; no              ; no                     ; no            ; no              ; yes        ; no       ; Off          ; 3.3-V LVTTL  ; 24mA             ; Off         ; User                 ; 0 pF ;
; GPIO_0[33]  ; K20   ; 5        ; 50           ; 17           ; 2           ; 0                     ; 0                  ; no     ; no             ; no              ; no                     ; no            ; no              ; yes        ; no       ; Off          ; 3.3-V LVTTL  ; 24mA             ; Off         ; User                 ; 0 pF ;
; GPIO_0[34]  ; L19   ; 5        ; 50           ; 15           ; 3           ; 0                     ; 0                  ; no     ; no             ; no              ; no                     ; no            ; no              ; yes        ; no       ; Off          ; 3.3-V LVTTL  ; 24mA             ; Off         ; User                 ; 0 pF ;
; GPIO_0[35]  ; L18   ; 5        ; 50           ; 15           ; 2           ; 0                     ; 0                  ; no     ; no             ; no              ; no                     ; no            ; no              ; yes        ; no       ; Off          ; 3.3-V LVTTL  ; 24mA             ; Off         ; User                 ; 0 pF ;
; GPIO_0[3]   ; B14   ; 4        ; 29           ; 27           ; 0           ; 0                     ; 0                  ; no     ; no             ; no              ; no                     ; no            ; no              ; yes        ; no       ; Off          ; 3.3-V LVTTL  ; 24mA             ; Off         ; User                 ; 0 pF ;
; GPIO_0[4]   ; A15   ; 4        ; 33           ; 27           ; 3           ; 0                     ; 0                  ; no     ; no             ; no              ; no                     ; no            ; no              ; yes        ; no       ; Off          ; 3.3-V LVTTL  ; 24mA             ; Off         ; User                 ; 0 pF ;
; GPIO_0[5]   ; B15   ; 4        ; 33           ; 27           ; 2           ; 0                     ; 0                  ; no     ; no             ; no              ; no                     ; no            ; no              ; yes        ; no       ; Off          ; 3.3-V LVTTL  ; 24mA             ; Off         ; User                 ; 0 pF ;
; GPIO_0[6]   ; A16   ; 4        ; 33           ; 27           ; 1           ; 0                     ; 0                  ; no     ; no             ; no              ; no                     ; no            ; no              ; yes        ; no       ; Off          ; 3.3-V LVTTL  ; 24mA             ; Off         ; User                 ; 0 pF ;
; GPIO_0[7]   ; B16   ; 4        ; 33           ; 27           ; 0           ; 0                     ; 0                  ; no     ; no             ; no              ; no                     ; no            ; no              ; yes        ; no       ; Off          ; 3.3-V LVTTL  ; 24mA             ; Off         ; User                 ; 0 pF ;
; GPIO_0[8]   ; A17   ; 4        ; 37           ; 27           ; 2           ; 0                     ; 0                  ; no     ; no             ; no              ; no                     ; no            ; no              ; yes        ; no       ; Off          ; 3.3-V LVTTL  ; 24mA             ; Off         ; User                 ; 0 pF ;
; GPIO_0[9]   ; B17   ; 4        ; 37           ; 27           ; 1           ; 0                     ; 0                  ; no     ; no             ; no              ; no                     ; no            ; no              ; yes        ; no       ; Off          ; 3.3-V LVTTL  ; 24mA             ; Off         ; User                 ; 0 pF ;
; GPIO_1[0]   ; H12   ; 4        ; 31           ; 27           ; 0           ; 0                     ; 0                  ; no     ; no             ; no              ; no                     ; no            ; no              ; yes        ; no       ; Off          ; 3.3-V LVTTL  ; 24mA             ; Off         ; User                 ; 0 pF ;
; GPIO_1[10]  ; C14   ; 4        ; 39           ; 27           ; 1           ; 0                     ; 0                  ; no     ; no             ; no              ; no                     ; no            ; no              ; yes        ; no       ; Off          ; 3.3-V LVTTL  ; 24mA             ; Off         ; User                 ; 0 pF ;
; GPIO_1[11]  ; D14   ; 4        ; 35           ; 27           ; 1           ; 0                     ; 0                  ; no     ; no             ; no              ; no                     ; no            ; no              ; yes        ; no       ; Off          ; 3.3-V LVTTL  ; 24mA             ; Off         ; User                 ; 0 pF ;
; GPIO_1[12]  ; D15   ; 4        ; 39           ; 27           ; 0           ; 0                     ; 0                  ; no     ; no             ; no              ; no                     ; no            ; no              ; yes        ; no       ; Off          ; 3.3-V LVTTL  ; 24mA             ; Off         ; User                 ; 0 pF ;
; GPIO_1[13]  ; D16   ; 4        ; 42           ; 27           ; 0           ; 0                     ; 0                  ; no     ; no             ; no              ; no                     ; no            ; no              ; yes        ; no       ; Off          ; 3.3-V LVTTL  ; 24mA             ; Off         ; User                 ; 0 pF ;
; GPIO_1[14]  ; C17   ; 4        ; 48           ; 27           ; 1           ; 0                     ; 0                  ; no     ; no             ; no              ; no                     ; no            ; no              ; yes        ; no       ; Off          ; 3.3-V LVTTL  ; 24mA             ; Off         ; User                 ; 0 pF ;
; GPIO_1[15]  ; C18   ; 4        ; 48           ; 27           ; 0           ; 0                     ; 0                  ; no     ; no             ; no              ; no                     ; no            ; no              ; yes        ; no       ; Off          ; 3.3-V LVTTL  ; 24mA             ; Off         ; User                 ; 0 pF ;
; GPIO_1[16]  ; C19   ; 5        ; 50           ; 24           ; 0           ; 0                     ; 0                  ; no     ; no             ; no              ; no                     ; no            ; no              ; yes        ; no       ; Off          ; 3.3-V LVTTL  ; 24mA             ; Off         ; User                 ; 0 pF ;
; GPIO_1[17]  ; C20   ; 5        ; 50           ; 25           ; 4           ; 0                     ; 0                  ; no     ; no             ; no              ; no                     ; no            ; no              ; yes        ; no       ; Off          ; 3.3-V LVTTL  ; 24mA             ; Off         ; User                 ; 0 pF ;
; GPIO_1[18]  ; D19   ; 5        ; 50           ; 25           ; 3           ; 0                     ; 0                  ; no     ; no             ; no              ; no                     ; no            ; no              ; yes        ; no       ; Off          ; 3.3-V LVTTL  ; 24mA             ; Off         ; User                 ; 0 pF ;
; GPIO_1[19]  ; D20   ; 5        ; 50           ; 25           ; 2           ; 0                     ; 0                  ; no     ; no             ; no              ; no                     ; no            ; no              ; yes        ; no       ; Off          ; 3.3-V LVTTL  ; 24mA             ; Off         ; User                 ; 0 pF ;
; GPIO_1[1]   ; H13   ; 4        ; 37           ; 27           ; 0           ; 0                     ; 0                  ; no     ; no             ; no              ; no                     ; no            ; no              ; yes        ; no       ; Off          ; 3.3-V LVTTL  ; 24mA             ; Off         ; User                 ; 0 pF ;
; GPIO_1[20]  ; E20   ; 5        ; 50           ; 23           ; 1           ; 0                     ; 0                  ; no     ; no             ; no              ; no                     ; no            ; no              ; yes        ; no       ; Off          ; 3.3-V LVTTL  ; 24mA             ; Off         ; User                 ; 0 pF ;
; GPIO_1[21]  ; F20   ; 5        ; 50           ; 23           ; 0           ; 0                     ; 0                  ; no     ; no             ; no              ; no                     ; no            ; no              ; yes        ; no       ; Off          ; 3.3-V LVTTL  ; 24mA             ; Off         ; User                 ; 0 pF ;
; GPIO_1[22]  ; E19   ; 5        ; 50           ; 25           ; 1           ; 0                     ; 0                  ; no     ; no             ; no              ; no                     ; no            ; no              ; yes        ; no       ; Off          ; 3.3-V LVTTL  ; 24mA             ; Off         ; User                 ; 0 pF ;
; GPIO_1[23]  ; E18   ; 5        ; 50           ; 25           ; 0           ; 0                     ; 0                  ; no     ; no             ; no              ; no                     ; no            ; no              ; yes        ; no       ; Off          ; 3.3-V LVTTL  ; 24mA             ; Off         ; User                 ; 0 pF ;
; GPIO_1[24]  ; G20   ; 5        ; 50           ; 23           ; 2           ; 0                     ; 0                  ; no     ; no             ; no              ; no                     ; no            ; no              ; yes        ; no       ; Off          ; 3.3-V LVTTL  ; 24mA             ; Off         ; User                 ; 0 pF ;
; GPIO_1[25]  ; G18   ; 5        ; 50           ; 22           ; 0           ; 0                     ; 0                  ; no     ; no             ; no              ; no                     ; no            ; no              ; yes        ; no       ; Off          ; 3.3-V LVTTL  ; 24mA             ; Off         ; User                 ; 0 pF ;
; GPIO_1[26]  ; G17   ; 5        ; 50           ; 22           ; 1           ; 0                     ; 0                  ; no     ; no             ; no              ; no                     ; no            ; no              ; yes        ; no       ; Off          ; 3.3-V LVTTL  ; 24mA             ; Off         ; User                 ; 0 pF ;
; GPIO_1[27]  ; H17   ; 5        ; 50           ; 20           ; 0           ; 0                     ; 0                  ; no     ; no             ; no              ; no                     ; no            ; no              ; yes        ; no       ; Off          ; 3.3-V LVTTL  ; 24mA             ; Off         ; User                 ; 0 pF ;
; GPIO_1[28]  ; J15   ; 5        ; 50           ; 18           ; 0           ; 0                     ; 0                  ; no     ; no             ; no              ; no                     ; no            ; no              ; yes        ; no       ; Off          ; 3.3-V LVTTL  ; 24mA             ; Off         ; User                 ; 0 pF ;
; GPIO_1[29]  ; H18   ; 5        ; 50           ; 20           ; 1           ; 0                     ; 0                  ; no     ; no             ; no              ; no                     ; no            ; no              ; yes        ; no       ; Off          ; 3.3-V LVTTL  ; 24mA             ; Off         ; User                 ; 0 pF ;
; GPIO_1[2]   ; H14   ; 4        ; 42           ; 27           ; 2           ; 0                     ; 0                  ; no     ; no             ; no              ; no                     ; no            ; no              ; yes        ; no       ; Off          ; 3.3-V LVTTL  ; 24mA             ; Off         ; User                 ; 0 pF ;
; GPIO_1[30]  ; N22   ; 6        ; 50           ; 12           ; 0           ; 0                     ; 0                  ; no     ; no             ; no              ; no                     ; no            ; no              ; yes        ; no       ; Off          ; 3.3-V LVTTL  ; 24mA             ; Off         ; User                 ; 0 pF ;
; GPIO_1[31]  ; N21   ; 6        ; 50           ; 12           ; 1           ; 0                     ; 0                  ; no     ; no             ; no              ; no                     ; no            ; no              ; yes        ; no       ; Off          ; 3.3-V LVTTL  ; 24mA             ; Off         ; User                 ; 0 pF ;
; GPIO_1[32]  ; P15   ; 6        ; 50           ; 11           ; 2           ; 0                     ; 0                  ; no     ; no             ; no              ; no                     ; no            ; no              ; yes        ; no       ; Off          ; 3.3-V LVTTL  ; 24mA             ; Off         ; User                 ; 0 pF ;
; GPIO_1[33]  ; N15   ; 6        ; 50           ; 11           ; 1           ; 0                     ; 0                  ; no     ; no             ; no              ; no                     ; no            ; no              ; yes        ; no       ; Off          ; 3.3-V LVTTL  ; 24mA             ; Off         ; User                 ; 0 pF ;
; GPIO_1[34]  ; P17   ; 6        ; 50           ; 8            ; 0           ; 0                     ; 0                  ; no     ; no             ; no              ; no                     ; no            ; no              ; yes        ; no       ; Off          ; 3.3-V LVTTL  ; 24mA             ; Off         ; User                 ; 0 pF ;
; GPIO_1[35]  ; P18   ; 6        ; 50           ; 9            ; 2           ; 0                     ; 0                  ; no     ; no             ; no              ; no                     ; no            ; no              ; yes        ; no       ; Off          ; 3.3-V LVTTL  ; 24mA             ; Off         ; User                 ; 0 pF ;
; GPIO_1[3]   ; G15   ; 4        ; 39           ; 27           ; 2           ; 0                     ; 0                  ; no     ; no             ; no              ; no                     ; no            ; no              ; yes        ; no       ; Off          ; 3.3-V LVTTL  ; 24mA             ; Off         ; User                 ; 0 pF ;
; GPIO_1[4]   ; E14   ; 4        ; 35           ; 27           ; 0           ; 0                     ; 0                  ; no     ; no             ; no              ; no                     ; no            ; no              ; yes        ; no       ; Off          ; 3.3-V LVTTL  ; 24mA             ; Off         ; User                 ; 0 pF ;
; GPIO_1[5]   ; E15   ; 4        ; 42           ; 27           ; 1           ; 0                     ; 0                  ; no     ; no             ; no              ; no                     ; no            ; no              ; yes        ; no       ; Off          ; 3.3-V LVTTL  ; 24mA             ; Off         ; User                 ; 0 pF ;
; GPIO_1[6]   ; F15   ; 4        ; 39           ; 27           ; 3           ; 0                     ; 0                  ; no     ; no             ; no              ; no                     ; no            ; no              ; yes        ; no       ; Off          ; 3.3-V LVTTL  ; 24mA             ; Off         ; User                 ; 0 pF ;
; GPIO_1[7]   ; G16   ; 4        ; 44           ; 27           ; 0           ; 0                     ; 0                  ; no     ; no             ; no              ; no                     ; no            ; no              ; yes        ; no       ; Off          ; 3.3-V LVTTL  ; 24mA             ; Off         ; User                 ; 0 pF ;
; GPIO_1[8]   ; F12   ; 4        ; 31           ; 27           ; 2           ; 0                     ; 0                  ; no     ; no             ; no              ; no                     ; no            ; no              ; yes        ; no       ; Off          ; 3.3-V LVTTL  ; 24mA             ; Off         ; User                 ; 0 pF ;
; GPIO_1[9]   ; F13   ; 4        ; 35           ; 27           ; 3           ; 0                     ; 0                  ; no     ; no             ; no              ; no                     ; no            ; no              ; yes        ; no       ; Off          ; 3.3-V LVTTL  ; 24mA             ; Off         ; User                 ; 0 pF ;
; I2C_SDAT    ; B3    ; 3        ; 1            ; 27           ; 3           ; 3                     ; 0                  ; no     ; no             ; no              ; no                     ; no            ; no              ; yes        ; no       ; Off          ; 3.3-V LVTTL  ; 24mA             ; Off         ; User                 ; 0 pF ;
; SD_CMD      ; G7    ; 3        ; 5            ; 27           ; 1           ; 0                     ; 0                  ; no     ; no             ; no              ; no                     ; no            ; no              ; yes        ; no       ; Off          ; 3.3-V LVTTL  ; 24mA             ; Off         ; Fitter               ; 0 pF ;
; SD_DAT      ; H19   ; 5        ; 50           ; 16           ; 0           ; 0                     ; 0                  ; no     ; no             ; no              ; no                     ; no            ; no              ; yes        ; no       ; Off          ; 3.3-V LVTTL  ; 24mA             ; Off         ; Fitter               ; 0 pF ;
; SD_DAT3     ; T16   ; 7        ; 44           ; 0            ; 0           ; 0                     ; 0                  ; no     ; no             ; no              ; no                     ; no            ; no              ; yes        ; no       ; Off          ; 3.3-V LVTTL  ; 24mA             ; Off         ; Fitter               ; 0 pF ;
; SRAM_DQ[0]  ; AA6   ; 8        ; 7            ; 0            ; 0           ; 1                     ; 0                  ; no     ; no             ; no              ; no                     ; no            ; no              ; no         ; no       ; Off          ; 3.3-V LVTTL  ; 24mA             ; Off         ; User                 ; 0 pF ;
; SRAM_DQ[10] ; V9    ; 8        ; 9            ; 0            ; 0           ; 1                     ; 0                  ; no     ; no             ; no              ; no                     ; no            ; no              ; no         ; no       ; Off          ; 3.3-V LVTTL  ; 24mA             ; Off         ; User                 ; 0 pF ;
; SRAM_DQ[11] ; U9    ; 8        ; 13           ; 0            ; 3           ; 1                     ; 0                  ; no     ; no             ; no              ; no                     ; no            ; no              ; no         ; no       ; Off          ; 3.3-V LVTTL  ; 24mA             ; Off         ; User                 ; 0 pF ;
; SRAM_DQ[12] ; R9    ; 8        ; 13           ; 0            ; 0           ; 2                     ; 0                  ; no     ; no             ; no              ; no                     ; no            ; no              ; no         ; no       ; Off          ; 3.3-V LVTTL  ; 24mA             ; Off         ; User                 ; 0 pF ;
; SRAM_DQ[13] ; W8    ; 8        ; 9            ; 0            ; 1           ; 2                     ; 0                  ; no     ; no             ; no              ; no                     ; no            ; no              ; no         ; no       ; Off          ; 3.3-V LVTTL  ; 24mA             ; Off         ; User                 ; 0 pF ;
; SRAM_DQ[14] ; V8    ; 8        ; 9            ; 0            ; 3           ; 2                     ; 0                  ; no     ; no             ; no              ; no                     ; no            ; no              ; no         ; no       ; Off          ; 3.3-V LVTTL  ; 24mA             ; Off         ; User                 ; 0 pF ;
; SRAM_DQ[15] ; U8    ; 8        ; 5            ; 0            ; 1           ; 2                     ; 0                  ; no     ; no             ; no              ; no                     ; no            ; no              ; no         ; no       ; Off          ; 3.3-V LVTTL  ; 24mA             ; Off         ; User                 ; 0 pF ;
; SRAM_DQ[1]  ; AB6   ; 8        ; 7            ; 0            ; 1           ; 1                     ; 0                  ; no     ; no             ; no              ; no                     ; no            ; no              ; no         ; no       ; Off          ; 3.3-V LVTTL  ; 24mA             ; Off         ; User                 ; 0 pF ;
; SRAM_DQ[2]  ; AA7   ; 8        ; 11           ; 0            ; 2           ; 1                     ; 0                  ; no     ; no             ; no              ; no                     ; no            ; no              ; no         ; no       ; Off          ; 3.3-V LVTTL  ; 24mA             ; Off         ; User                 ; 0 pF ;
; SRAM_DQ[3]  ; AB7   ; 8        ; 11           ; 0            ; 3           ; 1                     ; 0                  ; no     ; no             ; no              ; no                     ; no            ; no              ; no         ; no       ; Off          ; 3.3-V LVTTL  ; 24mA             ; Off         ; User                 ; 0 pF ;
; SRAM_DQ[4]  ; AA8   ; 8        ; 15           ; 0            ; 1           ; 2                     ; 0                  ; no     ; no             ; no              ; no                     ; no            ; no              ; no         ; no       ; Off          ; 3.3-V LVTTL  ; 24mA             ; Off         ; User                 ; 0 pF ;
; SRAM_DQ[5]  ; AB8   ; 8        ; 15           ; 0            ; 2           ; 2                     ; 0                  ; no     ; no             ; no              ; no                     ; no            ; no              ; no         ; no       ; Off          ; 3.3-V LVTTL  ; 24mA             ; Off         ; User                 ; 0 pF ;
; SRAM_DQ[6]  ; AA9   ; 8        ; 18           ; 0            ; 1           ; 2                     ; 0                  ; no     ; no             ; no              ; no                     ; no            ; no              ; no         ; no       ; Off          ; 3.3-V LVTTL  ; 24mA             ; Off         ; User                 ; 0 pF ;
; SRAM_DQ[7]  ; AB9   ; 8        ; 18           ; 0            ; 2           ; 2                     ; 0                  ; no     ; no             ; no              ; no                     ; no            ; no              ; no         ; no       ; Off          ; 3.3-V LVTTL  ; 24mA             ; Off         ; User                 ; 0 pF ;
; SRAM_DQ[8]  ; Y9    ; 8        ; 11           ; 0            ; 1           ; 1                     ; 0                  ; no     ; no             ; no              ; no                     ; no            ; no              ; no         ; no       ; Off          ; 3.3-V LVTTL  ; 24mA             ; Off         ; User                 ; 0 pF ;
; SRAM_DQ[9]  ; W9    ; 8        ; 11           ; 0            ; 0           ; 1                     ; 0                  ; no     ; no             ; no              ; no                     ; no            ; no              ; no         ; no       ; Off          ; 3.3-V LVTTL  ; 24mA             ; Off         ; User                 ; 0 pF ;
+-------------+-------+----------+--------------+--------------+-------------+-----------------------+--------------------+--------+----------------+-----------------+------------------------+---------------+-----------------+------------+----------+--------------+--------------+------------------+-------------+----------------------+------+


+------------------------------------------------------------+
; I/O Bank Usage                                             ;
+----------+------------------+---------------+--------------+
; I/O Bank ; Usage            ; VCCIO Voltage ; VREF Voltage ;
+----------+------------------+---------------+--------------+
; 1        ; 40 / 41 ( 98 % ) ; 3.3V          ; --           ;
; 2        ; 32 / 33 ( 97 % ) ; 3.3V          ; --           ;
; 3        ; 30 / 43 ( 70 % ) ; 3.3V          ; --           ;
; 4        ; 38 / 40 ( 95 % ) ; 3.3V          ; --           ;
; 5        ; 37 / 39 ( 95 % ) ; 3.3V          ; --           ;
; 6        ; 31 / 36 ( 86 % ) ; 3.3V          ; --           ;
; 7        ; 37 / 40 ( 93 % ) ; 3.3V          ; --           ;
; 8        ; 41 / 43 ( 95 % ) ; 3.3V          ; --           ;
+----------+------------------+---------------+--------------+


+------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; All Package Pins                                                                                                                                                       ;
+----------+------------+----------+------------------------------------------+--------+--------------+---------+------------+-----------------+----------+--------------+
; Location ; Pad Number ; I/O Bank ; Pin Name/Usage                           ; Dir.   ; I/O Standard ; Voltage ; I/O Type   ; User Assignment ; Bus Hold ; Weak Pull Up ;
+----------+------------+----------+------------------------------------------+--------+--------------+---------+------------+-----------------+----------+--------------+
; A1       ;            ;          ; GND                                      ; gnd    ;              ;         ; --         ;                 ; --       ; --           ;
; A2       ;            ; 3        ; VCCIO3                                   ; power  ;              ; 3.3V    ; --         ;                 ; --       ; --           ;
; A3       ; 325        ; 3        ; I2C_SCLK                                 ; output ; 3.3-V LVTTL  ;         ; Column I/O ; Y               ; no       ; Off          ;
; A4       ; 324        ; 3        ; AUD_BCLK                                 ; bidir  ; 3.3-V LVTTL  ;         ; Column I/O ; Y               ; no       ; Off          ;
; A5       ; 322        ; 3        ; AUD_DACLRCK                              ; output ; 3.3-V LVTTL  ;         ; Column I/O ; Y               ; no       ; Off          ;
; A6       ; 320        ; 3        ; AUD_ADCLRCK                              ; output ; 3.3-V LVTTL  ;         ; Column I/O ; Y               ; no       ; Off          ;
; A7       ; 306        ; 3        ; VGA_R[2]                                 ; output ; 3.3-V LVTTL  ;         ; Column I/O ; Y               ; no       ; Off          ;
; A8       ; 304        ; 3        ; VGA_G[3]                                 ; output ; 3.3-V LVTTL  ;         ; Column I/O ; Y               ; no       ; Off          ;
; A9       ; 298        ; 3        ; VGA_B[0]                                 ; output ; 3.3-V LVTTL  ;         ; Column I/O ; Y               ; no       ; Off          ;
; A10      ; 293        ; 3        ; VGA_B[2]                                 ; output ; 3.3-V LVTTL  ;         ; Column I/O ; Y               ; no       ; Off          ;
; A11      ; 287        ; 3        ; VGA_HS                                   ; output ; 3.3-V LVTTL  ;         ; Column I/O ; Y               ; no       ; Off          ;
; A12      ; 283        ; 4        ; CLOCK_24[1]                              ; input  ; 3.3-V LVTTL  ;         ; Column I/O ; Y               ; no       ; Off          ;
; A13      ; 281        ; 4        ; GPIO_0[0]                                ; bidir  ; 3.3-V LVTTL  ;         ; Column I/O ; Y               ; no       ; Off          ;
; A14      ; 279        ; 4        ; GPIO_0[2]                                ; bidir  ; 3.3-V LVTTL  ;         ; Column I/O ; Y               ; no       ; Off          ;
; A15      ; 273        ; 4        ; GPIO_0[4]                                ; bidir  ; 3.3-V LVTTL  ;         ; Column I/O ; Y               ; no       ; Off          ;
; A16      ; 271        ; 4        ; GPIO_0[6]                                ; bidir  ; 3.3-V LVTTL  ;         ; Column I/O ; Y               ; no       ; Off          ;
; A17      ; 265        ; 4        ; GPIO_0[8]                                ; bidir  ; 3.3-V LVTTL  ;         ; Column I/O ; Y               ; no       ; Off          ;
; A18      ; 251        ; 4        ; GPIO_0[10]                               ; bidir  ; 3.3-V LVTTL  ;         ; Column I/O ; Y               ; no       ; Off          ;
; A19      ; 249        ; 4        ; GPIO_0[12]                               ; bidir  ; 3.3-V LVTTL  ;         ; Column I/O ; Y               ; no       ; Off          ;
; A20      ; 247        ; 4        ; GPIO_0[14]                               ; bidir  ; 3.3-V LVTTL  ;         ; Column I/O ; Y               ; no       ; Off          ;
; A21      ;            ; 4        ; VCCIO4                                   ; power  ;              ; 3.3V    ; --         ;                 ; --       ; --           ;
; A22      ;            ;          ; GND                                      ; gnd    ;              ;         ; --         ;                 ; --       ; --           ;
; AA1      ;            ; 1        ; VCCIO1                                   ; power  ;              ; 3.3V    ; --         ;                 ; --       ; --           ;
; AA2      ;            ;          ; GND                                      ; gnd    ;              ;         ; --         ;                 ; --       ; --           ;
; AA3      ; 82         ; 8        ; SRAM_ADDR[0]                             ; output ; 3.3-V LVTTL  ;         ; Column I/O ; Y               ; no       ; Off          ;
; AA4      ; 85         ; 8        ; SRAM_ADDR[2]                             ; output ; 3.3-V LVTTL  ;         ; Column I/O ; Y               ; no       ; Off          ;
; AA5      ; 89         ; 8        ; SRAM_ADDR[4]                             ; output ; 3.3-V LVTTL  ;         ; Column I/O ; Y               ; no       ; Off          ;
; AA6      ; 97         ; 8        ; SRAM_DQ[0]                               ; bidir  ; 3.3-V LVTTL  ;         ; Column I/O ; Y               ; no       ; Off          ;
; AA7      ; 103        ; 8        ; SRAM_DQ[2]                               ; bidir  ; 3.3-V LVTTL  ;         ; Column I/O ; Y               ; no       ; Off          ;
; AA8      ; 111        ; 8        ; SRAM_DQ[4]                               ; bidir  ; 3.3-V LVTTL  ;         ; Column I/O ; Y               ; no       ; Off          ;
; AA9      ; 114        ; 8        ; SRAM_DQ[6]                               ; bidir  ; 3.3-V LVTTL  ;         ; Column I/O ; Y               ; no       ; Off          ;
; AA10     ; 120        ; 8        ; SRAM_WE_N                                ; output ; 3.3-V LVTTL  ;         ; Column I/O ; Y               ; no       ; Off          ;
; AA11     ; 122        ; 8        ; SRAM_ADDR[6]                             ; output ; 3.3-V LVTTL  ;         ; Column I/O ; Y               ; no       ; Off          ;
; AA12     ; 128        ; 7        ; FL_ADDR[15]                              ; output ; 3.3-V LVTTL  ;         ; Column I/O ; Y               ; no       ; Off          ;
; AA13     ; 130        ; 7        ; FL_ADDR[13]                              ; output ; 3.3-V LVTTL  ;         ; Column I/O ; Y               ; no       ; Off          ;
; AA14     ; 136        ; 7        ; FL_ADDR[1]                               ; output ; 3.3-V LVTTL  ;         ; Column I/O ; Y               ; no       ; Off          ;
; AA15     ; 138        ; 7        ; FL_OE_N                                  ; output ; 3.3-V LVTTL  ;         ; Column I/O ; Y               ; no       ; Off          ;
; AA16     ; 140        ; 7        ; FL_DQ[1]                                 ; bidir  ; 3.3-V LVTTL  ;         ; Column I/O ; Y               ; no       ; Off          ;
; AA17     ; 144        ; 7        ; FL_DQ[3]                                 ; bidir  ; 3.3-V LVTTL  ;         ; Column I/O ; Y               ; no       ; Off          ;
; AA18     ; 153        ; 7        ; FL_DQ[5]                                 ; bidir  ; 3.3-V LVTTL  ;         ; Column I/O ; Y               ; no       ; Off          ;
; AA19     ; 162        ; 7        ; FL_DQ[7]                                 ; bidir  ; 3.3-V LVTTL  ;         ; Column I/O ; Y               ; no       ; Off          ;
; AA20     ; 164        ; 7        ; FL_ADDR[17]                              ; output ; 3.3-V LVTTL  ;         ; Column I/O ; Y               ; no       ; Off          ;
; AA21     ;            ;          ; GND                                      ; gnd    ;              ;         ; --         ;                 ; --       ; --           ;
; AA22     ;            ; 6        ; VCCIO6                                   ; power  ;              ; 3.3V    ; --         ;                 ; --       ; --           ;
; AB1      ;            ;          ; GND                                      ; gnd    ;              ;         ; --         ;                 ; --       ; --           ;
; AB2      ;            ; 8        ; VCCIO8                                   ; power  ;              ; 3.3V    ; --         ;                 ; --       ; --           ;
; AB3      ; 83         ; 8        ; SRAM_ADDR[1]                             ; output ; 3.3-V LVTTL  ;         ; Column I/O ; Y               ; no       ; Off          ;
; AB4      ; 84         ; 8        ; SRAM_ADDR[3]                             ; output ; 3.3-V LVTTL  ;         ; Column I/O ; Y               ; no       ; Off          ;
; AB5      ; 88         ; 8        ; SRAM_CE_N                                ; output ; 3.3-V LVTTL  ;         ; Column I/O ; Y               ; no       ; Off          ;
; AB6      ; 96         ; 8        ; SRAM_DQ[1]                               ; bidir  ; 3.3-V LVTTL  ;         ; Column I/O ; Y               ; no       ; Off          ;
; AB7      ; 102        ; 8        ; SRAM_DQ[3]                               ; bidir  ; 3.3-V LVTTL  ;         ; Column I/O ; Y               ; no       ; Off          ;
; AB8      ; 110        ; 8        ; SRAM_DQ[5]                               ; bidir  ; 3.3-V LVTTL  ;         ; Column I/O ; Y               ; no       ; Off          ;
; AB9      ; 113        ; 8        ; SRAM_DQ[7]                               ; bidir  ; 3.3-V LVTTL  ;         ; Column I/O ; Y               ; no       ; Off          ;
; AB10     ; 119        ; 8        ; SRAM_ADDR[5]                             ; output ; 3.3-V LVTTL  ;         ; Column I/O ; Y               ; no       ; Off          ;
; AB11     ; 121        ; 8        ; SRAM_ADDR[7]                             ; output ; 3.3-V LVTTL  ;         ; Column I/O ; Y               ; no       ; Off          ;
; AB12     ; 127        ; 7        ; FL_ADDR[16]                              ; output ; 3.3-V LVTTL  ;         ; Column I/O ; Y               ; no       ; Off          ;
; AB13     ; 129        ; 7        ; FL_ADDR[14]                              ; output ; 3.3-V LVTTL  ;         ; Column I/O ; Y               ; no       ; Off          ;
; AB14     ; 135        ; 7        ; FL_ADDR[12]                              ; output ; 3.3-V LVTTL  ;         ; Column I/O ; Y               ; no       ; Off          ;
; AB15     ; 137        ; 7        ; FL_CE_N                                  ; output ; 3.3-V LVTTL  ;         ; Column I/O ; Y               ; no       ; Off          ;
; AB16     ; 139        ; 7        ; FL_DQ[0]                                 ; bidir  ; 3.3-V LVTTL  ;         ; Column I/O ; Y               ; no       ; Off          ;
; AB17     ; 143        ; 7        ; FL_DQ[2]                                 ; bidir  ; 3.3-V LVTTL  ;         ; Column I/O ; Y               ; no       ; Off          ;
; AB18     ; 152        ; 7        ; FL_DQ[4]                                 ; bidir  ; 3.3-V LVTTL  ;         ; Column I/O ; Y               ; no       ; Off          ;
; AB19     ; 161        ; 7        ; FL_DQ[6]                                 ; bidir  ; 3.3-V LVTTL  ;         ; Column I/O ; Y               ; no       ; Off          ;
; AB20     ; 163        ; 7        ; FL_ADDR[0]                               ; output ; 3.3-V LVTTL  ;         ; Column I/O ; Y               ; no       ; Off          ;
; AB21     ;            ; 7        ; VCCIO7                                   ; power  ;              ; 3.3V    ; --         ;                 ; --       ; --           ;
; AB22     ;            ;          ; GND                                      ; gnd    ;              ;         ; --         ;                 ; --       ; --           ;
; B1       ;            ; 2        ; VCCIO2                                   ; power  ;              ; 3.3V    ; --         ;                 ; --       ; --           ;
; B2       ;            ;          ; GND                                      ; gnd    ;              ;         ; --         ;                 ; --       ; --           ;
; B3       ; 326        ; 3        ; I2C_SDAT                                 ; bidir  ; 3.3-V LVTTL  ;         ; Column I/O ; Y               ; no       ; Off          ;
; B4       ; 323        ; 3        ; AUD_XCK                                  ; output ; 3.3-V LVTTL  ;         ; Column I/O ; Y               ; no       ; Off          ;
; B5       ; 321        ; 3        ; AUD_DACDAT                               ; output ; 3.3-V LVTTL  ;         ; Column I/O ; Y               ; no       ; Off          ;
; B6       ; 319        ; 3        ; AUD_ADCDAT                               ; input  ; 3.3-V LVTTL  ;         ; Column I/O ; Y               ; no       ; Off          ;
; B7       ; 305        ; 3        ; VGA_R[3]                                 ; output ; 3.3-V LVTTL  ;         ; Column I/O ; Y               ; no       ; Off          ;
; B8       ; 303        ; 3        ; VGA_G[0]                                 ; output ; 3.3-V LVTTL  ;         ; Column I/O ; Y               ; no       ; Off          ;
; B9       ; 297        ; 3        ; VGA_G[2]                                 ; output ; 3.3-V LVTTL  ;         ; Column I/O ; Y               ; no       ; Off          ;
; B10      ; 292        ; 3        ; VGA_B[3]                                 ; output ; 3.3-V LVTTL  ;         ; Column I/O ; Y               ; no       ; Off          ;
; B11      ; 286        ; 3        ; VGA_VS                                   ; output ; 3.3-V LVTTL  ;         ; Column I/O ; Y               ; no       ; Off          ;
; B12      ; 282        ; 4        ; CLOCK_24[0]                              ; input  ; 3.3-V LVTTL  ;         ; Column I/O ; Y               ; no       ; Off          ;
; B13      ; 280        ; 4        ; GPIO_0[1]                                ; bidir  ; 3.3-V LVTTL  ;         ; Column I/O ; Y               ; no       ; Off          ;
; B14      ; 278        ; 4        ; GPIO_0[3]                                ; bidir  ; 3.3-V LVTTL  ;         ; Column I/O ; Y               ; no       ; Off          ;
; B15      ; 272        ; 4        ; GPIO_0[5]                                ; bidir  ; 3.3-V LVTTL  ;         ; Column I/O ; Y               ; no       ; Off          ;
; B16      ; 270        ; 4        ; GPIO_0[7]                                ; bidir  ; 3.3-V LVTTL  ;         ; Column I/O ; Y               ; no       ; Off          ;
; B17      ; 264        ; 4        ; GPIO_0[9]                                ; bidir  ; 3.3-V LVTTL  ;         ; Column I/O ; Y               ; no       ; Off          ;
; B18      ; 250        ; 4        ; GPIO_0[11]                               ; bidir  ; 3.3-V LVTTL  ;         ; Column I/O ; Y               ; no       ; Off          ;
; B19      ; 248        ; 4        ; GPIO_0[13]                               ; bidir  ; 3.3-V LVTTL  ;         ; Column I/O ; Y               ; no       ; Off          ;
; B20      ; 246        ; 4        ; GPIO_0[15]                               ; bidir  ; 3.3-V LVTTL  ;         ; Column I/O ; Y               ; no       ; Off          ;
; B21      ;            ;          ; GND                                      ; gnd    ;              ;         ; --         ;                 ; --       ; --           ;
; B22      ;            ; 5        ; VCCIO5                                   ; power  ;              ; 3.3V    ; --         ;                 ; --       ; --           ;
; C1       ; 8          ; 2        ; HEX2[3]                                  ; output ; 3.3-V LVTTL  ;         ; Row I/O    ; Y               ; no       ; Off          ;
; C2       ; 9          ; 2        ; HEX2[2]                                  ; output ; 3.3-V LVTTL  ;         ; Row I/O    ; Y               ; no       ; Off          ;
; C3       ; 1          ; 2        ; ~nCSO~ / RESERVED_INPUT_WITH_WEAK_PULLUP ; input  ; 3.3-V LVTTL  ;         ; Row I/O    ; N               ; no       ; On           ;
; C4       ; 0          ; 2        ; ~ASDO~ / RESERVED_INPUT_WITH_WEAK_PULLUP ; input  ; 3.3-V LVTTL  ;         ; Row I/O    ; N               ; no       ; On           ;
; C5       ;            ;          ; GND                                      ; gnd    ;              ;         ; --         ;                 ; --       ; --           ;
; C6       ;            ; 3        ; VCCIO3                                   ; power  ;              ; 3.3V    ; --         ;                 ; --       ; --           ;
; C7       ; 315        ; 3        ; TCK                                      ; input  ; 3.3-V LVTTL  ;         ; Column I/O ; Y               ; no       ; Off          ;
; C8       ;            ;          ; GND                                      ; gnd    ;              ;         ; --         ;                 ; --       ; --           ;
; C9       ; 310        ; 3        ; VGA_R[1]                                 ; output ; 3.3-V LVTTL  ;         ; Column I/O ; Y               ; no       ; Off          ;
; C10      ; 296        ; 3        ; VGA_G[1]                                 ; output ; 3.3-V LVTTL  ;         ; Column I/O ; Y               ; no       ; Off          ;
; C11      ;            ; 3        ; VCCIO3                                   ; power  ;              ; 3.3V    ; --         ;                 ; --       ; --           ;
; C12      ;            ; 4        ; VCCIO4                                   ; power  ;              ; 3.3V    ; --         ;                 ; --       ; --           ;
; C13      ; 275        ; 4        ; GND*                                     ;        ;              ;         ; Column I/O ;                 ; no       ; Off          ;
; C14      ; 260        ; 4        ; GPIO_1[10]                               ; bidir  ; 3.3-V LVTTL  ;         ; Column I/O ; Y               ; no       ; Off          ;
; C15      ;            ;          ; GND                                      ; gnd    ;              ;         ; --         ;                 ; --       ; --           ;
; C16      ; 254        ; 4        ; GND*                                     ;        ;              ;         ; Column I/O ;                 ; no       ; Off          ;
; C17      ; 245        ; 4        ; GPIO_1[14]                               ; bidir  ; 3.3-V LVTTL  ;         ; Column I/O ; Y               ; no       ; Off          ;
; C18      ; 244        ; 4        ; GPIO_1[15]                               ; bidir  ; 3.3-V LVTTL  ;         ; Column I/O ; Y               ; no       ; Off          ;
; C19      ; 238        ; 5        ; GPIO_1[16]                               ; bidir  ; 3.3-V LVTTL  ;         ; Row I/O    ; Y               ; no       ; Off          ;
; C20      ; 239        ; 5        ; GPIO_1[17]                               ; bidir  ; 3.3-V LVTTL  ;         ; Row I/O    ; Y               ; no       ; Off          ;
; C21      ; 236        ; 5        ; GPIO_0[16]                               ; bidir  ; 3.3-V LVTTL  ;         ; Row I/O    ; Y               ; no       ; Off          ;
; C22      ; 237        ; 5        ; GPIO_0[17]                               ; bidir  ; 3.3-V LVTTL  ;         ; Row I/O    ; Y               ; no       ; Off          ;
; D1       ; 14         ; 2        ; HEX1[6]                                  ; output ; 3.3-V LVTTL  ;         ; Row I/O    ; Y               ; no       ; Off          ;
; D2       ; 15         ; 2        ; HEX1[5]                                  ; output ; 3.3-V LVTTL  ;         ; Row I/O    ; Y               ; no       ; Off          ;
; D3       ; 2          ; 2        ; HEX2[6]                                  ; output ; 3.3-V LVTTL  ;         ; Row I/O    ; Y               ; no       ; Off          ;
; D4       ; 3          ; 2        ; HEX3[6]                                  ; output ; 3.3-V LVTTL  ;         ; Row I/O    ; Y               ; no       ; Off          ;
; D5       ; 4          ; 2        ; HEX3[1]                                  ; output ; 3.3-V LVTTL  ;         ; Row I/O    ; Y               ; no       ; Off          ;
; D6       ; 5          ; 2        ; HEX3[2]                                  ; output ; 3.3-V LVTTL  ;         ; Row I/O    ; Y               ; no       ; Off          ;
; D7       ; 311        ; 3        ; TDO                                      ; output ; 3.3-V LVTTL  ;         ; Column I/O ; Y               ; no       ; Off          ;
; D8       ; 309        ; 3        ; TCS                                      ; input  ; 3.3-V LVTTL  ;         ; Column I/O ; Y               ; no       ; Off          ;
; D9       ; 302        ; 3        ; VGA_R[0]                                 ; output ; 3.3-V LVTTL  ;         ; Column I/O ; Y               ; no       ; Off          ;
; D10      ;            ;          ; GND                                      ; gnd    ;              ;         ; --         ;                 ; --       ; --           ;
; D11      ; 289        ; 3        ; VGA_B[1]                                 ; output ; 3.3-V LVTTL  ;         ; Column I/O ; Y               ; no       ; Off          ;
; D12      ; 284        ; 3        ; CLOCK_27[0]                              ; input  ; 3.3-V LVTTL  ;         ; Column I/O ; Y               ; no       ; Off          ;
; D13      ;            ;          ; GND                                      ; gnd    ;              ;         ; --         ;                 ; --       ; --           ;
; D14      ; 267        ; 4        ; GPIO_1[11]                               ; bidir  ; 3.3-V LVTTL  ;         ; Column I/O ; Y               ; no       ; Off          ;
; D15      ; 259        ; 4        ; GPIO_1[12]                               ; bidir  ; 3.3-V LVTTL  ;         ; Column I/O ; Y               ; no       ; Off          ;
; D16      ; 255        ; 4        ; GPIO_1[13]                               ; bidir  ; 3.3-V LVTTL  ;         ; Column I/O ; Y               ; no       ; Off          ;
; D17      ;            ; 4        ; VCCIO4                                   ; power  ;              ; 3.3V    ; --         ;                 ; --       ; --           ;
; D18      ;            ;          ; GND                                      ; gnd    ;              ;         ; --         ;                 ; --       ; --           ;
; D19      ; 240        ; 5        ; GPIO_1[18]                               ; bidir  ; 3.3-V LVTTL  ;         ; Row I/O    ; Y               ; no       ; Off          ;
; D20      ; 241        ; 5        ; GPIO_1[19]                               ; bidir  ; 3.3-V LVTTL  ;         ; Row I/O    ; Y               ; no       ; Off          ;
; D21      ; 229        ; 5        ; GPIO_0[18]                               ; bidir  ; 3.3-V LVTTL  ;         ; Row I/O    ; Y               ; no       ; Off          ;
; D22      ; 230        ; 5        ; GPIO_0[19]                               ; bidir  ; 3.3-V LVTTL  ;         ; Row I/O    ; Y               ; no       ; Off          ;
; E1       ; 20         ; 2        ; HEX1[0]                                  ; output ; 3.3-V LVTTL  ;         ; Row I/O    ; Y               ; no       ; Off          ;
; E2       ; 21         ; 2        ; HEX0[6]                                  ; output ; 3.3-V LVTTL  ;         ; Row I/O    ; Y               ; no       ; Off          ;
; E3       ; 6          ; 2        ; HEX2[4]                                  ; output ; 3.3-V LVTTL  ;         ; Row I/O    ; Y               ; no       ; Off          ;
; E4       ; 7          ; 2        ; HEX2[5]                                  ; output ; 3.3-V LVTTL  ;         ; Row I/O    ; Y               ; no       ; Off          ;
; E5       ;            ;          ; VCCD_PLL3                                ; power  ;              ; 1.2V    ; --         ;                 ; --       ; --           ;
; E6       ;            ;          ; VCCA_PLL3                                ; power  ;              ; 1.2V    ; --         ;                 ; --       ; --           ;
; E7       ; 316        ; 3        ; GND*                                     ;        ;              ;         ; Column I/O ;                 ; no       ; Off          ;
; E8       ; 308        ; 3        ; TDI                                      ; input  ; 3.3-V LVTTL  ;         ; Column I/O ; Y               ; no       ; Off          ;
; E9       ; 301        ; 3        ; GND*                                     ;        ;              ;         ; Column I/O ;                 ; no       ; Off          ;
; E10      ;            ; 3        ; VCCIO3                                   ; power  ;              ; 3.3V    ; --         ;                 ; --       ; --           ;
; E11      ; 288        ; 3        ; GND*                                     ;        ;              ;         ; Column I/O ;                 ; no       ; Off          ;
; E12      ; 285        ; 3        ; CLOCK_27[1]                              ; input  ; 3.3-V LVTTL  ;         ; Column I/O ; Y               ; no       ; Off          ;
; E13      ;            ; 4        ; VCCIO4                                   ; power  ;              ; 3.3V    ; --         ;                 ; --       ; --           ;
; E14      ; 266        ; 4        ; GPIO_1[4]                                ; bidir  ; 3.3-V LVTTL  ;         ; Column I/O ; Y               ; no       ; Off          ;
; E15      ; 256        ; 4        ; GPIO_1[5]                                ; bidir  ; 3.3-V LVTTL  ;         ; Column I/O ; Y               ; no       ; Off          ;
; E16      ;            ;          ; GNDA_PLL2                                ; gnd    ;              ;         ; --         ;                 ; --       ; --           ;
; E17      ;            ;          ; GND_PLL2                                 ; gnd    ;              ;         ; --         ;                 ; --       ; --           ;
; E18      ; 243        ; 5        ; GPIO_1[23]                               ; bidir  ; 3.3-V LVTTL  ;         ; Row I/O    ; Y               ; no       ; Off          ;
; E19      ; 242        ; 5        ; GPIO_1[22]                               ; bidir  ; 3.3-V LVTTL  ;         ; Row I/O    ; Y               ; no       ; Off          ;
; E20      ; 234        ; 5        ; GPIO_1[20]                               ; bidir  ; 3.3-V LVTTL  ;         ; Row I/O    ; Y               ; no       ; Off          ;
; E21      ; 227        ; 5        ; GPIO_0[20]                               ; bidir  ; 3.3-V LVTTL  ;         ; Row I/O    ; Y               ; no       ; Off          ;
; E22      ; 228        ; 5        ; GPIO_0[21]                               ; bidir  ; 3.3-V LVTTL  ;         ; Row I/O    ; Y               ; no       ; Off          ;
; F1       ; 22         ; 2        ; HEX0[5]                                  ; output ; 3.3-V LVTTL  ;         ; Row I/O    ; Y               ; no       ; Off          ;
; F2       ; 23         ; 2        ; HEX0[4]                                  ; output ; 3.3-V LVTTL  ;         ; Row I/O    ; Y               ; no       ; Off          ;
; F3       ; 13         ; 2        ; HEX3[5]                                  ; output ; 3.3-V LVTTL  ;         ; Row I/O    ; Y               ; no       ; Off          ;
; F4       ; 10         ; 2        ; HEX3[0]                                  ; output ; 3.3-V LVTTL  ;         ; Row I/O    ; Y               ; no       ; Off          ;
; F5       ;            ;          ; GND_PLL3                                 ; gnd    ;              ;         ; --         ;                 ; --       ; --           ;
; F6       ;            ;          ; GND_PLL3                                 ; gnd    ;              ;         ; --         ;                 ; --       ; --           ;
; F7       ;            ;          ; GNDA_PLL3                                ; gnd    ;              ;         ; --         ;                 ; --       ; --           ;
; F8       ; 312        ; 3        ; GND*                                     ;        ;              ;         ; Column I/O ;                 ; no       ; Off          ;
; F9       ; 307        ; 3        ; GND*                                     ;        ;              ;         ; Column I/O ;                 ; no       ; Off          ;
; F10      ; 295        ; 3        ; GND*                                     ;        ;              ;         ; Column I/O ;                 ; no       ; Off          ;
; F11      ; 294        ; 3        ; GND*                                     ;        ;              ;         ; Column I/O ;                 ; no       ; Off          ;
; F12      ; 276        ; 4        ; GPIO_1[8]                                ; bidir  ; 3.3-V LVTTL  ;         ; Column I/O ; Y               ; no       ; Off          ;
; F13      ; 269        ; 4        ; GPIO_1[9]                                ; bidir  ; 3.3-V LVTTL  ;         ; Column I/O ; Y               ; no       ; Off          ;
; F14      ; 268        ; 4        ; UART_RXD                                 ; input  ; 3.3-V LVTTL  ;         ; Column I/O ; Y               ; no       ; Off          ;
; F15      ; 262        ; 4        ; GPIO_1[6]                                ; bidir  ; 3.3-V LVTTL  ;         ; Column I/O ; Y               ; no       ; Off          ;
; F16      ;            ;          ; VCCA_PLL2                                ; power  ;              ; 1.2V    ; --         ;                 ; --       ; --           ;
; F17      ;            ;          ; VCCD_PLL2                                ; power  ;              ; 1.2V    ; --         ;                 ; --       ; --           ;
; F18      ;            ;          ; GND_PLL2                                 ; gnd    ;              ;         ; --         ;                 ; --       ; --           ;
; F19      ;            ;          ; GND                                      ; gnd    ;              ;         ; --         ;                 ; --       ; --           ;
; F20      ; 235        ; 5        ; GPIO_1[21]                               ; bidir  ; 3.3-V LVTTL  ;         ; Row I/O    ; Y               ; no       ; Off          ;
; F21      ; 223        ; 5        ; GPIO_0[22]                               ; bidir  ; 3.3-V LVTTL  ;         ; Row I/O    ; Y               ; no       ; Off          ;
; F22      ; 224        ; 5        ; GPIO_0[23]                               ; bidir  ; 3.3-V LVTTL  ;         ; Row I/O    ; Y               ; no       ; Off          ;
; G1       ;            ;          ; NC                                       ;        ;              ;         ; --         ;                 ; --       ; --           ;
; G2       ;            ;          ; NC                                       ;        ;              ;         ; --         ;                 ; --       ; --           ;
; G3       ; 16         ; 2        ; HEX1[4]                                  ; output ; 3.3-V LVTTL  ;         ; Row I/O    ; Y               ; no       ; Off          ;
; G4       ;            ;          ; GND                                      ; gnd    ;              ;         ; --         ;                 ; --       ; --           ;
; G5       ; 12         ; 2        ; HEX2[0]                                  ; output ; 3.3-V LVTTL  ;         ; Row I/O    ; Y               ; no       ; Off          ;
; G6       ; 11         ; 2        ; HEX2[1]                                  ; output ; 3.3-V LVTTL  ;         ; Row I/O    ; Y               ; no       ; Off          ;
; G7       ; 317        ; 3        ; SD_CMD                                   ; bidir  ; 3.3-V LVTTL  ;         ; Column I/O ; N               ; no       ; Off          ;
; G8       ; 313        ; 3        ; GND*                                     ;        ;              ;         ; Column I/O ;                 ; no       ; Off          ;
; G9       ;            ; 3        ; VCCIO3                                   ; power  ;              ; 3.3V    ; --         ;                 ; --       ; --           ;
; G10      ;            ;          ; GND                                      ; gnd    ;              ;         ; --         ;                 ; --       ; --           ;
; G11      ; 291        ; 3        ; GND*                                     ;        ;              ;         ; Column I/O ;                 ; no       ; Off          ;
; G12      ; 277        ; 4        ; UART_TXD                                 ; output ; 3.3-V LVTTL  ;         ; Column I/O ; Y               ; no       ; Off          ;
; G13      ;            ;          ; GND                                      ; gnd    ;              ;         ; --         ;                 ; --       ; --           ;
; G14      ;            ; 4        ; VCCIO4                                   ; power  ;              ; 3.3V    ; --         ;                 ; --       ; --           ;
; G15      ; 261        ; 4        ; GPIO_1[3]                                ; bidir  ; 3.3-V LVTTL  ;         ; Column I/O ; Y               ; no       ; Off          ;
; G16      ; 252        ; 4        ; GPIO_1[7]                                ; bidir  ; 3.3-V LVTTL  ;         ; Column I/O ; Y               ; no       ; Off          ;
; G17      ; 231        ; 5        ; GPIO_1[26]                               ; bidir  ; 3.3-V LVTTL  ;         ; Row I/O    ; Y               ; no       ; Off          ;
; G18      ; 232        ; 5        ; GPIO_1[25]                               ; bidir  ; 3.3-V LVTTL  ;         ; Row I/O    ; Y               ; no       ; Off          ;
; G19      ;            ; 5        ; VCCIO5                                   ; power  ;              ; 3.3V    ; --         ;                 ; --       ; --           ;
; G20      ; 233        ; 5        ; GPIO_1[24]                               ; bidir  ; 3.3-V LVTTL  ;         ; Row I/O    ; Y               ; no       ; Off          ;
; G21      ; 221        ; 5        ; GPIO_0[24]                               ; bidir  ; 3.3-V LVTTL  ;         ; Row I/O    ; Y               ; no       ; Off          ;
; G22      ; 222        ; 5        ; GPIO_0[25]                               ; bidir  ; 3.3-V LVTTL  ;         ; Row I/O    ; Y               ; no       ; Off          ;
; H1       ; 24         ; 2        ; HEX0[3]                                  ; output ; 3.3-V LVTTL  ;         ; Row I/O    ; Y               ; no       ; Off          ;
; H2       ; 25         ; 2        ; HEX0[2]                                  ; output ; 3.3-V LVTTL  ;         ; Row I/O    ; Y               ; no       ; Off          ;
; H3       ; 27         ; 2        ; GND*                                     ;        ;              ;         ; Row I/O    ;                 ; no       ; Off          ;
; H4       ; 17         ; 2        ; HEX1[3]                                  ; output ; 3.3-V LVTTL  ;         ; Row I/O    ; Y               ; no       ; Off          ;
; H5       ; 18         ; 2        ; HEX1[2]                                  ; output ; 3.3-V LVTTL  ;         ; Row I/O    ; Y               ; no       ; Off          ;
; H6       ; 19         ; 2        ; HEX1[1]                                  ; output ; 3.3-V LVTTL  ;         ; Row I/O    ; Y               ; no       ; Off          ;
; H7       ; 318        ; 3        ; GND*                                     ;        ;              ;         ; Column I/O ;                 ; no       ; Off          ;
; H8       ; 314        ; 3        ; SD_CLK                                   ; output ; 3.3-V LVTTL  ;         ; Column I/O ; N               ; no       ; Off          ;
; H9       ; 300        ; 3        ; GND*                                     ;        ;              ;         ; Column I/O ;                 ; no       ; Off          ;
; H10      ; 299        ; 3        ; GND*                                     ;        ;              ;         ; Column I/O ;                 ; no       ; Off          ;
; H11      ; 290        ; 3        ; GND*                                     ;        ;              ;         ; Column I/O ;                 ; no       ; Off          ;
; H12      ; 274        ; 4        ; GPIO_1[0]                                ; bidir  ; 3.3-V LVTTL  ;         ; Column I/O ; Y               ; no       ; Off          ;
; H13      ; 263        ; 4        ; GPIO_1[1]                                ; bidir  ; 3.3-V LVTTL  ;         ; Column I/O ; Y               ; no       ; Off          ;
; H14      ; 257        ; 4        ; GPIO_1[2]                                ; bidir  ; 3.3-V LVTTL  ;         ; Column I/O ; Y               ; no       ; Off          ;
; H15      ; 253        ; 4        ; PS2_CLK                                  ; input  ; 3.3-V LVTTL  ;         ; Column I/O ; Y               ; no       ; Off          ;
; H16      ; 219        ; 5        ; GND*                                     ;        ;              ;         ; Row I/O    ;                 ; no       ; Off          ;
; H17      ; 226        ; 5        ; GPIO_1[27]                               ; bidir  ; 3.3-V LVTTL  ;         ; Row I/O    ; Y               ; no       ; Off          ;
; H18      ; 225        ; 5        ; GPIO_1[29]                               ; bidir  ; 3.3-V LVTTL  ;         ; Row I/O    ; Y               ; no       ; Off          ;
; H19      ; 214        ; 5        ; SD_DAT                                   ; bidir  ; 3.3-V LVTTL  ;         ; Row I/O    ; N               ; no       ; Off          ;
; H20      ;            ;          ; GND                                      ; gnd    ;              ;         ; --         ;                 ; --       ; --           ;
; H21      ;            ;          ; NC                                       ;        ;              ;         ; --         ;                 ; --       ; --           ;
; H22      ;            ;          ; NC                                       ;        ;              ;         ; --         ;                 ; --       ; --           ;
; J1       ; 29         ; 2        ; HEX0[1]                                  ; output ; 3.3-V LVTTL  ;         ; Row I/O    ; Y               ; no       ; Off          ;
; J2       ; 30         ; 2        ; HEX0[0]                                  ; output ; 3.3-V LVTTL  ;         ; Row I/O    ; Y               ; no       ; Off          ;
; J3       ;            ;          ; NC                                       ;        ;              ;         ; --         ;                 ; --       ; --           ;
; J4       ; 28         ; 2        ; HEX3[3]                                  ; output ; 3.3-V LVTTL  ;         ; Row I/O    ; Y               ; no       ; Off          ;
; J5       ;            ;          ; NC                                       ;        ;              ;         ; --         ;                 ; --       ; --           ;
; J6       ;            ;          ; NC                                       ;        ;              ;         ; --         ;                 ; --       ; --           ;
; J7       ;            ; 2        ; VCCIO2                                   ; power  ;              ; 3.3V    ; --         ;                 ; --       ; --           ;
; J8       ;            ;          ; NC                                       ;        ;              ;         ; --         ;                 ; --       ; --           ;
; J9       ;            ;          ; NC                                       ;        ;              ;         ; --         ;                 ; --       ; --           ;
; J10      ;            ;          ; VCCINT                                   ; power  ;              ; 1.2V    ; --         ;                 ; --       ; --           ;
; J11      ;            ;          ; VCCINT                                   ; power  ;              ; 1.2V    ; --         ;                 ; --       ; --           ;
; J12      ;            ;          ; VCCINT                                   ; power  ;              ; 1.2V    ; --         ;                 ; --       ; --           ;
; J13      ;            ;          ; VCCINT                                   ; power  ;              ; 1.2V    ; --         ;                 ; --       ; --           ;
; J14      ; 258        ; 4        ; PS2_DAT                                  ; input  ; 3.3-V LVTTL  ;         ; Column I/O ; Y               ; no       ; Off          ;
; J15      ; 220        ; 5        ; GPIO_1[28]                               ; bidir  ; 3.3-V LVTTL  ;         ; Row I/O    ; Y               ; no       ; Off          ;
; J16      ;            ; 5        ; VCCIO5                                   ; power  ;              ; 3.3V    ; --         ;                 ; --       ; --           ;
; J17      ; 218        ; 5        ; GND*                                     ;        ;              ;         ; Row I/O    ;                 ; no       ; Off          ;
; J18      ; 217        ; 5        ; GPIO_0[32]                               ; bidir  ; 3.3-V LVTTL  ;         ; Row I/O    ; Y               ; no       ; Off          ;
; J19      ; 216        ; 5        ; GPIO_0[30]                               ; bidir  ; 3.3-V LVTTL  ;         ; Row I/O    ; Y               ; no       ; Off          ;
; J20      ; 213        ; 5        ; GPIO_0[31]                               ; bidir  ; 3.3-V LVTTL  ;         ; Row I/O    ; Y               ; no       ; Off          ;
; J21      ; 211        ; 5        ; GPIO_0[26]                               ; bidir  ; 3.3-V LVTTL  ;         ; Row I/O    ; Y               ; no       ; Off          ;
; J22      ; 212        ; 5        ; GPIO_0[27]                               ; bidir  ; 3.3-V LVTTL  ;         ; Row I/O    ; Y               ; no       ; Off          ;
; K1       ; 37         ; 2        ; ^nCE                                     ;        ;              ;         ; --         ;                 ; --       ; --           ;
; K2       ; 32         ; 2        ; #TCK                                     ; input  ;              ;         ; --         ;                 ; --       ; --           ;
; K3       ;            ;          ; GND                                      ; gnd    ;              ;         ; --         ;                 ; --       ; --           ;
; K4       ; 36         ; 2        ; ^DATA0                                   ; input  ;              ;         ; --         ;                 ; --       ; --           ;
; K5       ; 31         ; 2        ; #TDI                                     ; input  ;              ;         ; --         ;                 ; --       ; --           ;
; K6       ; 33         ; 2        ; #TMS                                     ; input  ;              ;         ; --         ;                 ; --       ; --           ;
; K7       ;            ;          ; GND                                      ; gnd    ;              ;         ; --         ;                 ; --       ; --           ;
; K8       ;            ;          ; NC                                       ;        ;              ;         ; --         ;                 ; --       ; --           ;
; K9       ;            ;          ; VCCINT                                   ; power  ;              ; 1.2V    ; --         ;                 ; --       ; --           ;
; K10      ;            ;          ; GND                                      ; gnd    ;              ;         ; --         ;                 ; --       ; --           ;
; K11      ;            ;          ; GND                                      ; gnd    ;              ;         ; --         ;                 ; --       ; --           ;
; K12      ;            ;          ; GND                                      ; gnd    ;              ;         ; --         ;                 ; --       ; --           ;
; K13      ;            ;          ; GND                                      ; gnd    ;              ;         ; --         ;                 ; --       ; --           ;
; K14      ;            ;          ; VCCINT                                   ; power  ;              ; 1.2V    ; --         ;                 ; --       ; --           ;
; K15      ;            ;          ; NC                                       ;        ;              ;         ; --         ;                 ; --       ; --           ;
; K16      ;            ;          ; GND                                      ; gnd    ;              ;         ; --         ;                 ; --       ; --           ;
; K17      ;            ;          ; NC                                       ;        ;              ;         ; --         ;                 ; --       ; --           ;
; K18      ;            ;          ; NC                                       ;        ;              ;         ; --         ;                 ; --       ; --           ;
; K19      ;            ;          ; GND                                      ; gnd    ;              ;         ; --         ;                 ; --       ; --           ;
; K20      ; 215        ; 5        ; GPIO_0[33]                               ; bidir  ; 3.3-V LVTTL  ;         ; Row I/O    ; Y               ; no       ; Off          ;
; K21      ; 209        ; 5        ; GPIO_0[28]                               ; bidir  ; 3.3-V LVTTL  ;         ; Row I/O    ; Y               ; no       ; Off          ;
; K22      ; 210        ; 5        ; GPIO_0[29]                               ; bidir  ; 3.3-V LVTTL  ;         ; Row I/O    ; Y               ; no       ; Off          ;
; L1       ; 38         ; 2        ; CLOCK_50                                 ; input  ; 3.3-V LVTTL  ;         ; Row I/O    ; Y               ; no       ; Off          ;
; L2       ; 39         ; 2        ; SW[9]                                    ; input  ; 3.3-V LVTTL  ;         ; Row I/O    ; Y               ; no       ; Off          ;
; L3       ;            ; 2        ; VCCIO2                                   ; power  ;              ; 3.3V    ; --         ;                 ; --       ; --           ;
; L4       ; 40         ; 2        ; ^nCONFIG                                 ;        ;              ;         ; --         ;                 ; --       ; --           ;
; L5       ; 34         ; 2        ; #TDO                                     ; output ;              ;         ; --         ;                 ; --       ; --           ;
; L6       ; 35         ; 2        ; ^DCLK                                    ;        ;              ;         ; --         ;                 ; --       ; --           ;
; L7       ;            ;          ; NC                                       ;        ;              ;         ; --         ;                 ; --       ; --           ;
; L8       ; 26         ; 2        ; HEX3[4]                                  ; output ; 3.3-V LVTTL  ;         ; Row I/O    ; Y               ; no       ; Off          ;
; L9       ;            ;          ; VCCINT                                   ; power  ;              ; 1.2V    ; --         ;                 ; --       ; --           ;
; L10      ;            ;          ; GND                                      ; gnd    ;              ;         ; --         ;                 ; --       ; --           ;
; L11      ;            ;          ; GND                                      ; gnd    ;              ;         ; --         ;                 ; --       ; --           ;
; L12      ;            ;          ; GND                                      ; gnd    ;              ;         ; --         ;                 ; --       ; --           ;
; L13      ;            ;          ; GND                                      ; gnd    ;              ;         ; --         ;                 ; --       ; --           ;
; L14      ;            ;          ; VCCINT                                   ; power  ;              ; 1.2V    ; --         ;                 ; --       ; --           ;
; L15      ;            ;          ; NC                                       ;        ;              ;         ; --         ;                 ; --       ; --           ;
; L16      ;            ;          ; NC                                       ;        ;              ;         ; --         ;                 ; --       ; --           ;
; L17      ;            ;          ; NC                                       ;        ;              ;         ; --         ;                 ; --       ; --           ;
; L18      ; 208        ; 5        ; GPIO_0[35]                               ; bidir  ; 3.3-V LVTTL  ;         ; Row I/O    ; Y               ; no       ; Off          ;
; L19      ; 207        ; 5        ; GPIO_0[34]                               ; bidir  ; 3.3-V LVTTL  ;         ; Row I/O    ; Y               ; no       ; Off          ;
; L20      ;            ; 5        ; VCCIO5                                   ; power  ;              ; 3.3V    ; --         ;                 ; --       ; --           ;
; L21      ; 205        ; 5        ; SW[1]                                    ; input  ; 3.3-V LVTTL  ;         ; Row I/O    ; Y               ; no       ; Off          ;
; L22      ; 206        ; 5        ; SW[0]                                    ; input  ; 3.3-V LVTTL  ;         ; Row I/O    ; Y               ; no       ; Off          ;
; M1       ; 41         ; 1        ; SW[8]                                    ; input  ; 3.3-V LVTTL  ;         ; Row I/O    ; Y               ; no       ; Off          ;
; M2       ; 42         ; 1        ; SW[7]                                    ; input  ; 3.3-V LVTTL  ;         ; Row I/O    ; Y               ; no       ; Off          ;
; M3       ;            ; 1        ; VCCIO1                                   ; power  ;              ; 3.3V    ; --         ;                 ; --       ; --           ;
; M4       ;            ;          ; GND                                      ; gnd    ;              ;         ; --         ;                 ; --       ; --           ;
; M5       ; 43         ; 1        ; DRAM_UDQM                                ; output ; 3.3-V LVTTL  ;         ; Row I/O    ; Y               ; no       ; Off          ;
; M6       ; 44         ; 1        ; GND*                                     ;        ;              ;         ; Row I/O    ;                 ; no       ; Off          ;
; M7       ;            ;          ; NC                                       ;        ;              ;         ; --         ;                 ; --       ; --           ;
; M8       ;            ;          ; NC                                       ;        ;              ;         ; --         ;                 ; --       ; --           ;
; M9       ;            ;          ; VCCINT                                   ; power  ;              ; 1.2V    ; --         ;                 ; --       ; --           ;
; M10      ;            ;          ; GND                                      ; gnd    ;              ;         ; --         ;                 ; --       ; --           ;
; M11      ;            ;          ; GND                                      ; gnd    ;              ;         ; --         ;                 ; --       ; --           ;
; M12      ;            ;          ; GND                                      ; gnd    ;              ;         ; --         ;                 ; --       ; --           ;
; M13      ;            ;          ; GND                                      ; gnd    ;              ;         ; --         ;                 ; --       ; --           ;
; M14      ;            ;          ; VCCINT                                   ; power  ;              ; 1.2V    ; --         ;                 ; --       ; --           ;
; M15      ;            ;          ; NC                                       ;        ;              ;         ; --         ;                 ; --       ; --           ;
; M16      ;            ;          ; NC                                       ;        ;              ;         ; --         ;                 ; --       ; --           ;
; M17      ; 198        ; 6        ; ^MSEL0                                   ;        ;              ;         ; --         ;                 ; --       ; --           ;
; M18      ; 202        ; 6        ; GND*                                     ;        ;              ;         ; Row I/O    ;                 ; no       ; Off          ;
; M19      ; 201        ; 6        ; GND*                                     ;        ;              ;         ; Row I/O    ;                 ; no       ; Off          ;
; M20      ;            ; 6        ; VCCIO6                                   ; power  ;              ; 3.3V    ; --         ;                 ; --       ; --           ;
; M21      ; 203        ; 6        ; EXT_CLOCK                                ; input  ; 3.3-V LVTTL  ;         ; Row I/O    ; Y               ; no       ; Off          ;
; M22      ; 204        ; 6        ; SW[2]                                    ; input  ; 3.3-V LVTTL  ;         ; Row I/O    ; Y               ; no       ; Off          ;
; N1       ; 45         ; 1        ; DRAM_DQ[8]                               ; bidir  ; 3.3-V LVTTL  ;         ; Row I/O    ; Y               ; no       ; Off          ;
; N2       ; 46         ; 1        ; DRAM_DQ[9]                               ; bidir  ; 3.3-V LVTTL  ;         ; Row I/O    ; Y               ; no       ; Off          ;
; N3       ; 51         ; 1        ; DRAM_CKE                                 ; output ; 3.3-V LVTTL  ;         ; Row I/O    ; Y               ; no       ; Off          ;
; N4       ; 52         ; 1        ; DRAM_ADDR[9]                             ; output ; 3.3-V LVTTL  ;         ; Row I/O    ; Y               ; no       ; Off          ;
; N5       ;            ;          ; NC                                       ;        ;              ;         ; --         ;                 ; --       ; --           ;
; N6       ; 49         ; 1        ; DRAM_ADDR[11]                            ; output ; 3.3-V LVTTL  ;         ; Row I/O    ; Y               ; no       ; Off          ;
; N7       ;            ;          ; GND                                      ; gnd    ;              ;         ; --         ;                 ; --       ; --           ;
; N8       ;            ;          ; NC                                       ;        ;              ;         ; --         ;                 ; --       ; --           ;
; N9       ;            ;          ; VCCINT                                   ; power  ;              ; 1.2V    ; --         ;                 ; --       ; --           ;
; N10      ;            ;          ; GND                                      ; gnd    ;              ;         ; --         ;                 ; --       ; --           ;
; N11      ;            ;          ; GND                                      ; gnd    ;              ;         ; --         ;                 ; --       ; --           ;
; N12      ;            ;          ; GND                                      ; gnd    ;              ;         ; --         ;                 ; --       ; --           ;
; N13      ;            ;          ; GND                                      ; gnd    ;              ;         ; --         ;                 ; --       ; --           ;
; N14      ;            ;          ; VCCINT                                   ; power  ;              ; 1.2V    ; --         ;                 ; --       ; --           ;
; N15      ; 194        ; 6        ; GPIO_1[33]                               ; bidir  ; 3.3-V LVTTL  ;         ; Row I/O    ; Y               ; no       ; Off          ;
; N16      ;            ;          ; GND                                      ; gnd    ;              ;         ; --         ;                 ; --       ; --           ;
; N17      ; 197        ; 6        ; ^MSEL1                                   ;        ;              ;         ; --         ;                 ; --       ; --           ;
; N18      ; 196        ; 6        ; ^CONF_DONE                               ;        ;              ;         ; --         ;                 ; --       ; --           ;
; N19      ;            ;          ; GND                                      ; gnd    ;              ;         ; --         ;                 ; --       ; --           ;
; N20      ; 195        ; 6        ; ^nSTATUS                                 ;        ;              ;         ; --         ;                 ; --       ; --           ;
; N21      ; 199        ; 6        ; GPIO_1[31]                               ; bidir  ; 3.3-V LVTTL  ;         ; Row I/O    ; Y               ; no       ; Off          ;
; N22      ; 200        ; 6        ; GPIO_1[30]                               ; bidir  ; 3.3-V LVTTL  ;         ; Row I/O    ; Y               ; no       ; Off          ;
; P1       ; 47         ; 1        ; DRAM_DQ[10]                              ; bidir  ; 3.3-V LVTTL  ;         ; Row I/O    ; Y               ; no       ; Off          ;
; P2       ; 48         ; 1        ; DRAM_DQ[11]                              ; bidir  ; 3.3-V LVTTL  ;         ; Row I/O    ; Y               ; no       ; Off          ;
; P3       ; 50         ; 1        ; DRAM_ADDR[8]                             ; output ; 3.3-V LVTTL  ;         ; Row I/O    ; Y               ; no       ; Off          ;
; P4       ;            ;          ; NC                                       ;        ;              ;         ; --         ;                 ; --       ; --           ;
; P5       ; 55         ; 1        ; DRAM_ADDR[7]                             ; output ; 3.3-V LVTTL  ;         ; Row I/O    ; Y               ; no       ; Off          ;
; P6       ; 56         ; 1        ; DRAM_ADDR[6]                             ; output ; 3.3-V LVTTL  ;         ; Row I/O    ; Y               ; no       ; Off          ;
; P7       ;            ; 1        ; VCCIO1                                   ; power  ;              ; 3.3V    ; --         ;                 ; --       ; --           ;
; P8       ; 95         ; 8        ; GND*                                     ;        ;              ;         ; Column I/O ;                 ; no       ; Off          ;
; P9       ; 94         ; 8        ; GND*                                     ;        ;              ;         ; Column I/O ;                 ; no       ; Off          ;
; P10      ;            ;          ; VCCINT                                   ; power  ;              ; 1.2V    ; --         ;                 ; --       ; --           ;
; P11      ;            ;          ; VCCINT                                   ; power  ;              ; 1.2V    ; --         ;                 ; --       ; --           ;
; P12      ;            ;          ; VCCINT                                   ; power  ;              ; 1.2V    ; --         ;                 ; --       ; --           ;
; P13      ;            ;          ; VCCINT                                   ; power  ;              ; 1.2V    ; --         ;                 ; --       ; --           ;
; P14      ;            ;          ; NC                                       ;        ;              ;         ; --         ;                 ; --       ; --           ;
; P15      ; 193        ; 6        ; GPIO_1[32]                               ; bidir  ; 3.3-V LVTTL  ;         ; Row I/O    ; Y               ; no       ; Off          ;
; P16      ;            ; 6        ; VCCIO6                                   ; power  ;              ; 3.3V    ; --         ;                 ; --       ; --           ;
; P17      ; 186        ; 6        ; GPIO_1[34]                               ; bidir  ; 3.3-V LVTTL  ;         ; Row I/O    ; Y               ; no       ; Off          ;
; P18      ; 187        ; 6        ; GPIO_1[35]                               ; bidir  ; 3.3-V LVTTL  ;         ; Row I/O    ; Y               ; no       ; Off          ;
; P19      ;            ;          ; NC                                       ;        ;              ;         ; --         ;                 ; --       ; --           ;
; P20      ;            ;          ; NC                                       ;        ;              ;         ; --         ;                 ; --       ; --           ;
; P21      ;            ;          ; NC                                       ;        ;              ;         ; --         ;                 ; --       ; --           ;
; P22      ;            ;          ; NC                                       ;        ;              ;         ; --         ;                 ; --       ; --           ;
; R1       ; 57         ; 1        ; DRAM_DQ[12]                              ; bidir  ; 3.3-V LVTTL  ;         ; Row I/O    ; Y               ; no       ; Off          ;
; R2       ; 58         ; 1        ; DRAM_DQ[13]                              ; bidir  ; 3.3-V LVTTL  ;         ; Row I/O    ; Y               ; no       ; Off          ;
; R3       ;            ;          ; GND                                      ; gnd    ;              ;         ; --         ;                 ; --       ; --           ;
; R4       ;            ;          ; NC                                       ;        ;              ;         ; --         ;                 ; --       ; --           ;
; R5       ; 63         ; 1        ; DRAM_ADDR[5]                             ; output ; 3.3-V LVTTL  ;         ; Row I/O    ; Y               ; no       ; Off          ;
; R6       ; 64         ; 1        ; DRAM_ADDR[4]                             ; output ; 3.3-V LVTTL  ;         ; Row I/O    ; Y               ; no       ; Off          ;
; R7       ; 54         ; 1        ; DRAM_LDQM                                ; output ; 3.3-V LVTTL  ;         ; Row I/O    ; Y               ; no       ; Off          ;
; R8       ; 53         ; 1        ; DRAM_WE_N                                ; output ; 3.3-V LVTTL  ;         ; Row I/O    ; Y               ; no       ; Off          ;
; R9       ; 109        ; 8        ; SRAM_DQ[12]                              ; bidir  ; 3.3-V LVTTL  ;         ; Column I/O ; Y               ; no       ; Off          ;
; R10      ; 108        ; 8        ; SRAM_ADDR[14]                            ; output ; 3.3-V LVTTL  ;         ; Column I/O ; Y               ; no       ; Off          ;
; R11      ; 116        ; 8        ; SRAM_ADDR[10]                            ; output ; 3.3-V LVTTL  ;         ; Column I/O ; Y               ; no       ; Off          ;
; R12      ; 134        ; 7        ; FL_ADDR[10]                              ; output ; 3.3-V LVTTL  ;         ; Column I/O ; Y               ; no       ; Off          ;
; R13      ; 145        ; 7        ; FL_ADDR[21]                              ; output ; 3.3-V LVTTL  ;         ; Column I/O ; Y               ; no       ; Off          ;
; R14      ; 150        ; 7        ; FL_ADDR[8]                               ; output ; 3.3-V LVTTL  ;         ; Column I/O ; Y               ; no       ; Off          ;
; R15      ; 151        ; 7        ; FL_ADDR[3]                               ; output ; 3.3-V LVTTL  ;         ; Column I/O ; Y               ; no       ; Off          ;
; R16      ; 155        ; 7        ; GND*                                     ;        ;              ;         ; Column I/O ;                 ; no       ; Off          ;
; R17      ; 177        ; 6        ; LEDR[9]                                  ; output ; 3.3-V LVTTL  ;         ; Row I/O    ; Y               ; no       ; Off          ;
; R18      ; 184        ; 6        ; LEDR[8]                                  ; output ; 3.3-V LVTTL  ;         ; Row I/O    ; Y               ; no       ; Off          ;
; R19      ; 185        ; 6        ; LEDR[1]                                  ; output ; 3.3-V LVTTL  ;         ; Row I/O    ; Y               ; no       ; Off          ;
; R20      ; 192        ; 6        ; LEDR[0]                                  ; output ; 3.3-V LVTTL  ;         ; Row I/O    ; Y               ; no       ; Off          ;
; R21      ; 190        ; 6        ; KEY[1]                                   ; input  ; 3.3-V LVTTL  ;         ; Row I/O    ; Y               ; no       ; Off          ;
; R22      ; 191        ; 6        ; KEY[0]                                   ; input  ; 3.3-V LVTTL  ;         ; Row I/O    ; Y               ; no       ; Off          ;
; T1       ; 59         ; 1        ; DRAM_DQ[14]                              ; bidir  ; 3.3-V LVTTL  ;         ; Row I/O    ; Y               ; no       ; Off          ;
; T2       ; 60         ; 1        ; DRAM_DQ[15]                              ; bidir  ; 3.3-V LVTTL  ;         ; Row I/O    ; Y               ; no       ; Off          ;
; T3       ; 69         ; 1        ; DRAM_CAS_N                               ; output ; 3.3-V LVTTL  ;         ; Row I/O    ; Y               ; no       ; Off          ;
; T4       ;            ; 1        ; VCCIO1                                   ; power  ;              ; 3.3V    ; --         ;                 ; --       ; --           ;
; T5       ; 67         ; 1        ; DRAM_RAS_N                               ; output ; 3.3-V LVTTL  ;         ; Row I/O    ; Y               ; no       ; Off          ;
; T6       ; 68         ; 1        ; DRAM_CS_N                                ; output ; 3.3-V LVTTL  ;         ; Row I/O    ; Y               ; no       ; Off          ;
; T7       ; 91         ; 8        ; SRAM_ADDR[15]                            ; output ; 3.3-V LVTTL  ;         ; Column I/O ; Y               ; no       ; Off          ;
; T8       ; 90         ; 8        ; SRAM_OE_N                                ; output ; 3.3-V LVTTL  ;         ; Column I/O ; Y               ; no       ; Off          ;
; T9       ;            ; 8        ; VCCIO8                                   ; power  ;              ; 3.3V    ; --         ;                 ; --       ; --           ;
; T10      ;            ;          ; GND                                      ; gnd    ;              ;         ; --         ;                 ; --       ; --           ;
; T11      ; 115        ; 8        ; SRAM_ADDR[11]                            ; output ; 3.3-V LVTTL  ;         ; Column I/O ; Y               ; no       ; Off          ;
; T12      ; 131        ; 7        ; FL_ADDR[11]                              ; output ; 3.3-V LVTTL  ;         ; Column I/O ; Y               ; no       ; Off          ;
; T13      ;            ;          ; GND                                      ; gnd    ;              ;         ; --         ;                 ; --       ; --           ;
; T14      ;            ; 7        ; VCCIO7                                   ; power  ;              ; 3.3V    ; --         ;                 ; --       ; --           ;
; T15      ; 147        ; 7        ; FL_ADDR[4]                               ; output ; 3.3-V LVTTL  ;         ; Column I/O ; Y               ; no       ; Off          ;
; T16      ; 156        ; 7        ; SD_DAT3                                  ; bidir  ; 3.3-V LVTTL  ;         ; Column I/O ; N               ; no       ; Off          ;
; T17      ;            ;          ; GND_PLL4                                 ; gnd    ;              ;         ; --         ;                 ; --       ; --           ;
; T18      ; 171        ; 6        ; LEDR[4]                                  ; output ; 3.3-V LVTTL  ;         ; Row I/O    ; Y               ; no       ; Off          ;
; T19      ;            ; 6        ; VCCIO6                                   ; power  ;              ; 3.3V    ; --         ;                 ; --       ; --           ;
; T20      ;            ;          ; GND                                      ; gnd    ;              ;         ; --         ;                 ; --       ; --           ;
; T21      ; 188        ; 6        ; KEY[3]                                   ; input  ; 3.3-V LVTTL  ;         ; Row I/O    ; Y               ; no       ; Off          ;
; T22      ; 189        ; 6        ; KEY[2]                                   ; input  ; 3.3-V LVTTL  ;         ; Row I/O    ; Y               ; no       ; Off          ;
; U1       ; 61         ; 1        ; DRAM_DQ[0]                               ; bidir  ; 3.3-V LVTTL  ;         ; Row I/O    ; Y               ; no       ; Off          ;
; U2       ; 62         ; 1        ; DRAM_DQ[1]                               ; bidir  ; 3.3-V LVTTL  ;         ; Row I/O    ; Y               ; no       ; Off          ;
; U3       ; 70         ; 1        ; DRAM_BA_0                                ; output ; 3.3-V LVTTL  ;         ; Row I/O    ; Y               ; no       ; Off          ;
; U4       ; 80         ; 1        ; DRAM_CLK                                 ; output ; 3.3-V LVTTL  ;         ; Row I/O    ; Y               ; no       ; Off          ;
; U5       ;            ;          ; GND_PLL1                                 ; gnd    ;              ;         ; --         ;                 ; --       ; --           ;
; U6       ;            ;          ; VCCD_PLL1                                ; power  ;              ; 1.2V    ; --         ;                 ; --       ; --           ;
; U7       ;            ;          ; VCCA_PLL1                                ; power  ;              ; 1.2V    ; --         ;                 ; --       ; --           ;
; U8       ; 92         ; 8        ; SRAM_DQ[15]                              ; bidir  ; 3.3-V LVTTL  ;         ; Column I/O ; Y               ; no       ; Off          ;
; U9       ; 106        ; 8        ; SRAM_DQ[11]                              ; bidir  ; 3.3-V LVTTL  ;         ; Column I/O ; Y               ; no       ; Off          ;
; U10      ; 107        ; 8        ; SRAM_ADDR[13]                            ; output ; 3.3-V LVTTL  ;         ; Column I/O ; Y               ; no       ; Off          ;
; U11      ; 123        ; 8        ; SW[6]                                    ; input  ; 3.3-V LVTTL  ;         ; Column I/O ; Y               ; no       ; Off          ;
; U12      ; 124        ; 8        ; SW[5]                                    ; input  ; 3.3-V LVTTL  ;         ; Column I/O ; Y               ; no       ; Off          ;
; U13      ; 132        ; 7        ; FL_ADDR[20]                              ; output ; 3.3-V LVTTL  ;         ; Column I/O ; Y               ; no       ; Off          ;
; U14      ; 146        ; 7        ; FL_ADDR[18]                              ; output ; 3.3-V LVTTL  ;         ; Column I/O ; Y               ; no       ; Off          ;
; U15      ; 157        ; 7        ; FL_ADDR[5]                               ; output ; 3.3-V LVTTL  ;         ; Column I/O ; Y               ; no       ; Off          ;
; U16      ;            ;          ; VCCA_PLL4                                ; power  ;              ; 1.2V    ; --         ;                 ; --       ; --           ;
; U17      ;            ;          ; VCCD_PLL4                                ; power  ;              ; 1.2V    ; --         ;                 ; --       ; --           ;
; U18      ; 170        ; 6        ; LEDR[7]                                  ; output ; 3.3-V LVTTL  ;         ; Row I/O    ; Y               ; no       ; Off          ;
; U19      ; 172        ; 6        ; LEDR[2]                                  ; output ; 3.3-V LVTTL  ;         ; Row I/O    ; Y               ; no       ; Off          ;
; U20      ; 176        ; 6        ; GND*                                     ;        ;              ;         ; Row I/O    ;                 ; no       ; Off          ;
; U21      ; 182        ; 6        ; LEDG[1]                                  ; output ; 3.3-V LVTTL  ;         ; Row I/O    ; Y               ; no       ; Off          ;
; U22      ; 183        ; 6        ; LEDG[0]                                  ; output ; 3.3-V LVTTL  ;         ; Row I/O    ; Y               ; no       ; Off          ;
; V1       ; 65         ; 1        ; DRAM_DQ[2]                               ; bidir  ; 3.3-V LVTTL  ;         ; Row I/O    ; Y               ; no       ; Off          ;
; V2       ; 66         ; 1        ; DRAM_DQ[3]                               ; bidir  ; 3.3-V LVTTL  ;         ; Row I/O    ; Y               ; no       ; Off          ;
; V3       ;            ;          ; GND                                      ; gnd    ;              ;         ; --         ;                 ; --       ; --           ;
; V4       ; 81         ; 1        ; DRAM_BA_1                                ; output ; 3.3-V LVTTL  ;         ; Row I/O    ; Y               ; no       ; Off          ;
; V5       ;            ;          ; GND_PLL1                                 ; gnd    ;              ;         ; --         ;                 ; --       ; --           ;
; V6       ;            ;          ; GND                                      ; gnd    ;              ;         ; --         ;                 ; --       ; --           ;
; V7       ;            ;          ; GNDA_PLL1                                ; gnd    ;              ;         ; --         ;                 ; --       ; --           ;
; V8       ; 98         ; 8        ; SRAM_DQ[14]                              ; bidir  ; 3.3-V LVTTL  ;         ; Column I/O ; Y               ; no       ; Off          ;
; V9       ; 101        ; 8        ; SRAM_DQ[10]                              ; bidir  ; 3.3-V LVTTL  ;         ; Column I/O ; Y               ; no       ; Off          ;
; V10      ;            ; 8        ; VCCIO8                                   ; power  ;              ; 3.3V    ; --         ;                 ; --       ; --           ;
; V11      ; 118        ; 8        ; SRAM_ADDR[8]                             ; output ; 3.3-V LVTTL  ;         ; Column I/O ; Y               ; no       ; Off          ;
; V12      ; 126        ; 7        ; SW[3]                                    ; input  ; 3.3-V LVTTL  ;         ; Column I/O ; Y               ; no       ; Off          ;
; V13      ;            ; 7        ; VCCIO7                                   ; power  ;              ; 3.3V    ; --         ;                 ; --       ; --           ;
; V14      ; 142        ; 7        ; FL_ADDR[19]                              ; output ; 3.3-V LVTTL  ;         ; Column I/O ; Y               ; no       ; Off          ;
; V15      ; 158        ; 7        ; FL_ADDR[6]                               ; output ; 3.3-V LVTTL  ;         ; Column I/O ; Y               ; no       ; Off          ;
; V16      ;            ;          ; GNDA_PLL4                                ; gnd    ;              ;         ; --         ;                 ; --       ; --           ;
; V17      ;            ;          ; GND                                      ; gnd    ;              ;         ; --         ;                 ; --       ; --           ;
; V18      ;            ;          ; GND_PLL4                                 ; gnd    ;              ;         ; --         ;                 ; --       ; --           ;
; V19      ; 166        ; 6        ; LEDR[5]                                  ; output ; 3.3-V LVTTL  ;         ; Row I/O    ; Y               ; no       ; Off          ;
; V20      ; 173        ; 6        ; GND*                                     ;        ;              ;         ; Row I/O    ;                 ; no       ; Off          ;
; V21      ; 180        ; 6        ; LEDG[3]                                  ; output ; 3.3-V LVTTL  ;         ; Row I/O    ; Y               ; no       ; Off          ;
; V22      ; 181        ; 6        ; LEDG[2]                                  ; output ; 3.3-V LVTTL  ;         ; Row I/O    ; Y               ; no       ; Off          ;
; W1       ; 71         ; 1        ; DRAM_DQ[4]                               ; bidir  ; 3.3-V LVTTL  ;         ; Row I/O    ; Y               ; no       ; Off          ;
; W2       ; 72         ; 1        ; DRAM_DQ[5]                               ; bidir  ; 3.3-V LVTTL  ;         ; Row I/O    ; Y               ; no       ; Off          ;
; W3       ; 75         ; 1        ; DRAM_ADDR[10]                            ; output ; 3.3-V LVTTL  ;         ; Row I/O    ; Y               ; no       ; Off          ;
; W4       ; 76         ; 1        ; DRAM_ADDR[0]                             ; output ; 3.3-V LVTTL  ;         ; Row I/O    ; Y               ; no       ; Off          ;
; W5       ; 79         ; 1        ; DRAM_ADDR[1]                             ; output ; 3.3-V LVTTL  ;         ; Row I/O    ; Y               ; no       ; Off          ;
; W6       ;            ; 8        ; VCCIO8                                   ; power  ;              ; 3.3V    ; --         ;                 ; --       ; --           ;
; W7       ; 99         ; 8        ; SRAM_UB_N                                ; output ; 3.3-V LVTTL  ;         ; Column I/O ; Y               ; no       ; Off          ;
; W8       ; 100        ; 8        ; SRAM_DQ[13]                              ; bidir  ; 3.3-V LVTTL  ;         ; Column I/O ; Y               ; no       ; Off          ;
; W9       ; 105        ; 8        ; SRAM_DQ[9]                               ; bidir  ; 3.3-V LVTTL  ;         ; Column I/O ; Y               ; no       ; Off          ;
; W10      ;            ;          ; GND                                      ; gnd    ;              ;         ; --         ;                 ; --       ; --           ;
; W11      ; 117        ; 8        ; SRAM_ADDR[9]                             ; output ; 3.3-V LVTTL  ;         ; Column I/O ; Y               ; no       ; Off          ;
; W12      ; 125        ; 7        ; SW[4]                                    ; input  ; 3.3-V LVTTL  ;         ; Column I/O ; Y               ; no       ; Off          ;
; W13      ;            ;          ; GND                                      ; gnd    ;              ;         ; --         ;                 ; --       ; --           ;
; W14      ; 141        ; 7        ; FL_RST_N                                 ; output ; 3.3-V LVTTL  ;         ; Column I/O ; Y               ; no       ; Off          ;
; W15      ; 149        ; 7        ; FL_ADDR[7]                               ; output ; 3.3-V LVTTL  ;         ; Column I/O ; Y               ; no       ; Off          ;
; W16      ; 160        ; 7        ; GND*                                     ;        ;              ;         ; Column I/O ;                 ; no       ; Off          ;
; W17      ;            ; 7        ; VCCIO7                                   ; power  ;              ; 3.3V    ; --         ;                 ; --       ; --           ;
; W18      ;            ;          ; NC                                       ;        ;              ;         ; --         ;                 ; --       ; --           ;
; W19      ;            ;          ; GND                                      ; gnd    ;              ;         ; --         ;                 ; --       ; --           ;
; W20      ; 167        ; 6        ; ~LVDS91p/nCEO~                           ; output ; 3.3-V LVTTL  ;         ; Row I/O    ; N               ; no       ; Off          ;
; W21      ; 174        ; 6        ; LEDG[5]                                  ; output ; 3.3-V LVTTL  ;         ; Row I/O    ; Y               ; no       ; Off          ;
; W22      ; 175        ; 6        ; LEDG[4]                                  ; output ; 3.3-V LVTTL  ;         ; Row I/O    ; Y               ; no       ; Off          ;
; Y1       ; 73         ; 1        ; DRAM_DQ[6]                               ; bidir  ; 3.3-V LVTTL  ;         ; Row I/O    ; Y               ; no       ; Off          ;
; Y2       ; 74         ; 1        ; DRAM_DQ[7]                               ; bidir  ; 3.3-V LVTTL  ;         ; Row I/O    ; Y               ; no       ; Off          ;
; Y3       ; 77         ; 1        ; DRAM_ADDR[2]                             ; output ; 3.3-V LVTTL  ;         ; Row I/O    ; Y               ; no       ; Off          ;
; Y4       ; 78         ; 1        ; DRAM_ADDR[3]                             ; output ; 3.3-V LVTTL  ;         ; Row I/O    ; Y               ; no       ; Off          ;
; Y5       ; 86         ; 8        ; SRAM_ADDR[17]                            ; output ; 3.3-V LVTTL  ;         ; Column I/O ; Y               ; no       ; Off          ;
; Y6       ; 87         ; 8        ; SRAM_ADDR[16]                            ; output ; 3.3-V LVTTL  ;         ; Column I/O ; Y               ; no       ; Off          ;
; Y7       ; 93         ; 8        ; SRAM_LB_N                                ; output ; 3.3-V LVTTL  ;         ; Column I/O ; Y               ; no       ; Off          ;
; Y8       ;            ;          ; GND                                      ; gnd    ;              ;         ; --         ;                 ; --       ; --           ;
; Y9       ; 104        ; 8        ; SRAM_DQ[8]                               ; bidir  ; 3.3-V LVTTL  ;         ; Column I/O ; Y               ; no       ; Off          ;
; Y10      ; 112        ; 8        ; SRAM_ADDR[12]                            ; output ; 3.3-V LVTTL  ;         ; Column I/O ; Y               ; no       ; Off          ;
; Y11      ;            ; 8        ; VCCIO8                                   ; power  ;              ; 3.3V    ; --         ;                 ; --       ; --           ;
; Y12      ;            ; 7        ; VCCIO7                                   ; power  ;              ; 3.3V    ; --         ;                 ; --       ; --           ;
; Y13      ; 133        ; 7        ; FL_ADDR[9]                               ; output ; 3.3-V LVTTL  ;         ; Column I/O ; Y               ; no       ; Off          ;
; Y14      ; 148        ; 7        ; FL_WE_N                                  ; output ; 3.3-V LVTTL  ;         ; Column I/O ; Y               ; no       ; Off          ;
; Y15      ;            ;          ; GND                                      ; gnd    ;              ;         ; --         ;                 ; --       ; --           ;
; Y16      ; 154        ; 7        ; FL_ADDR[2]                               ; output ; 3.3-V LVTTL  ;         ; Column I/O ; Y               ; no       ; Off          ;
; Y17      ; 159        ; 7        ; GND*                                     ;        ;              ;         ; Column I/O ;                 ; no       ; Off          ;
; Y18      ; 165        ; 6        ; LEDR[6]                                  ; output ; 3.3-V LVTTL  ;         ; Row I/O    ; Y               ; no       ; Off          ;
; Y19      ; 168        ; 6        ; LEDR[3]                                  ; output ; 3.3-V LVTTL  ;         ; Row I/O    ; Y               ; no       ; Off          ;
; Y20      ; 169        ; 6        ; GND*                                     ;        ;              ;         ; Row I/O    ;                 ; no       ; Off          ;
; Y21      ; 178        ; 6        ; LEDG[7]                                  ; output ; 3.3-V LVTTL  ;         ; Row I/O    ; Y               ; no       ; Off          ;
; Y22      ; 179        ; 6        ; LEDG[6]                                  ; output ; 3.3-V LVTTL  ;         ; Row I/O    ; Y               ; no       ; Off          ;
+----------+------------+----------+------------------------------------------+--------+--------------+---------+------------+-----------------+----------+--------------+


+------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; PLL Summary                                                                                                                                                      ;
+----------------------------------+--------------------------------------------------------------------------------+----------------------------------------------+
; Name                             ; Multi_Sdram:u3|Sdram_Controller:u1|PLL1:sdram_pll1|altpll:altpll_component|pll ; VGA_Audio_PLL:p1|altpll:altpll_component|pll ;
+----------------------------------+--------------------------------------------------------------------------------+----------------------------------------------+
; PLL mode                         ; Normal                                                                         ; Normal                                       ;
; Compensate clock                 ; clock0                                                                         ; clock0                                       ;
; Self reset on gated loss of lock ; Off                                                                            ; Off                                          ;
; Gate lock counter                ; --                                                                             ; --                                           ;
; Input frequency 0                ; 50.0 MHz                                                                       ; 27.0 MHz                                     ;
; Input frequency 1                ; --                                                                             ; --                                           ;
; Nominal PFD frequency            ; 50.0 MHz                                                                       ; 27.0 MHz                                     ;
; Nominal VCO frequency            ; 800.0 MHz                                                                      ; 377.9 MHz                                    ;
; VCO post scale                   ; --                                                                             ; 2                                            ;
; VCO multiply                     ; --                                                                             ; --                                           ;
; VCO divide                       ; --                                                                             ; --                                           ;
; Freq min lock                    ; 31.25 MHz                                                                      ; 21.43 MHz                                    ;
; Freq max lock                    ; 62.5 MHz                                                                       ; 35.71 MHz                                    ;
; M VCO Tap                        ; 0                                                                              ; 0                                            ;
; M Initial                        ; 1                                                                              ; 1                                            ;
; M value                          ; 16                                                                             ; 14                                           ;
; N value                          ; 1                                                                              ; 1                                            ;
; Preserve counter order           ; Off                                                                            ; Off                                          ;
; PLL location                     ; PLL_1                                                                          ; PLL_3                                        ;
; Inclk0 signal                    ; CLOCK_50                                                                       ; CLOCK_27[0]                                  ;
; Inclk1 signal                    ; --                                                                             ; --                                           ;
; Inclk0 signal type               ; Dedicated Pin                                                                  ; Dedicated Pin                                ;
; Inclk1 signal type               ; --                                                                             ; --                                           ;
+----------------------------------+--------------------------------------------------------------------------------+----------------------------------------------+


+-----------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; PLL Usage                                                                                                                                                                                                             ;
+----------------------------------------------------------------------------------+--------------+------+-----+------------------+-------------+------------+---------+---------------+------------+---------+---------+
; Name                                                                             ; Output Clock ; Mult ; Div ; Output Frequency ; Phase Shift ; Duty Cycle ; Counter ; Counter Value ; High / Low ; Initial ; VCO Tap ;
+----------------------------------------------------------------------------------+--------------+------+-----+------------------+-------------+------------+---------+---------------+------------+---------+---------+
; Multi_Sdram:u3|Sdram_Controller:u1|PLL1:sdram_pll1|altpll:altpll_component|_clk0 ; clock0       ; 1    ; 1   ; 50.0 MHz         ; 0 (0 ps)    ; 50/50      ; C0      ; 16            ; 8/8 Even   ; 1       ; 0       ;
; Multi_Sdram:u3|Sdram_Controller:u1|PLL1:sdram_pll1|altpll:altpll_component|_clk2 ; clock2       ; 1    ; 1   ; 50.0 MHz         ; 0 (0 ps)    ; 50/50      ; C2      ; 16            ; 8/8 Even   ; 1       ; 0       ;
; VGA_Audio_PLL:p1|altpll:altpll_component|_clk0                                   ; clock0       ; 14   ; 15  ; 25.2 MHz         ; 0 (0 ps)    ; 50/50      ; C0      ; 15            ; 8/7 Odd    ; 1       ; 0       ;
; VGA_Audio_PLL:p1|altpll:altpll_component|_clk1                                   ; clock1       ; 2    ; 3   ; 18.0 MHz         ; 0 (0 ps)    ; 50/50      ; C1      ; 21            ; 11/10 Odd  ; 1       ; 0       ;
+----------------------------------------------------------------------------------+--------------+------+-----+------------------+-------------+------------+---------+---------------+------------+---------+---------+


+-------------------------------------------------------------------------------+
; Output Pin Default Load For Reported TCO                                      ;
+----------------------------------+-------+------------------------------------+
; I/O Standard                     ; Load  ; Termination Resistance             ;
+----------------------------------+-------+------------------------------------+
; 3.3-V LVTTL                      ; 0 pF  ; Not Available                      ;
; 3.3-V LVCMOS                     ; 0 pF  ; Not Available                      ;
; 2.5 V                            ; 0 pF  ; Not Available                      ;
; 1.8 V                            ; 0 pF  ; Not Available                      ;
; 1.5 V                            ; 0 pF  ; Not Available                      ;
; 3.3-V PCI                        ; 10 pF ; 25 Ohm (Parallel)                  ;
; 3.3-V PCI-X                      ; 10 pF ; 25 Ohm (Parallel)                  ;
; SSTL-2 Class I                   ; 0 pF  ; 50 Ohm (Parallel), 25 Ohm (Serial) ;
; SSTL-2 Class II                  ; 0 pF  ; 25 Ohm (Parallel), 25 Ohm (Serial) ;
; SSTL-18 Class I                  ; 0 pF  ; 50 Ohm (Parallel), 25 Ohm (Serial) ;
; SSTL-18 Class II                 ; 0 pF  ; 25 Ohm (Parallel), 25 Ohm (Serial) ;
; 1.5-V HSTL Class I               ; 0 pF  ; 50 Ohm (Parallel)                  ;
; 1.5-V HSTL Class II              ; 0 pF  ; 25 Ohm (Parallel)                  ;
; 1.8-V HSTL Class I               ; 0 pF  ; 50 Ohm (Parallel)                  ;
; 1.8-V HSTL Class II              ; 0 pF  ; 25 Ohm (Parallel)                  ;
; Differential SSTL-2              ; 0 pF  ; (See SSTL-2)                       ;
; Differential 2.5-V SSTL Class II ; 0 pF  ; (See SSTL-2 Class II)              ;
; Differential 1.8-V SSTL Class I  ; 0 pF  ; (See 1.8-V SSTL Class I)           ;
; Differential 1.8-V SSTL Class II ; 0 pF  ; (See 1.8-V SSTL Class II)          ;
; Differential 1.5-V HSTL Class I  ; 0 pF  ; (See 1.5-V HSTL Class I)           ;
; Differential 1.5-V HSTL Class II ; 0 pF  ; (See 1.5-V HSTL Class II)          ;
; Differential 1.8-V HSTL Class I  ; 0 pF  ; (See 1.8-V HSTL Class I)           ;
; Differential 1.8-V HSTL Class II ; 0 pF  ; (See 1.8-V HSTL Class II)          ;
; LVDS                             ; 0 pF  ; 100 Ohm (Differential)             ;
; mini-LVDS                        ; 0 pF  ; 100 Ohm (Differential)             ;
; RSDS                             ; 0 pF  ; 100 Ohm (Differential)             ;
; Simple RSDS                      ; 0 pF  ; Not Available                      ;
; Differential LVPECL              ; 0 pF  ; 100 Ohm (Differential)             ;
+----------------------------------+-------+------------------------------------+
Note: User assignments will override these defaults. The user specified values are listed in the Output Pins and Bidir Pins tables.


+------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Fitter Resource Utilization by Entity                                                                                                                                                                                                                                                                                                                                                                                                    ;
+-------------------------------------------------------------------+-------------+---------------------------+---------------+-------------+------+--------------+---------+-----------+------+--------------+--------------+-------------------+------------------+-------------------------------------------------------------------------------------------------------------------------------------------------------+--------------+
; Compilation Hierarchy Node                                        ; Logic Cells ; Dedicated Logic Registers ; I/O Registers ; Memory Bits ; M4Ks ; DSP Elements ; DSP 9x9 ; DSP 18x18 ; Pins ; Virtual Pins ; LUT-Only LCs ; Register-Only LCs ; LUT/Register LCs ; Full Hierarchy Name                                                                                                                                   ; Library Name ;
+-------------------------------------------------------------------+-------------+---------------------------+---------------+-------------+------+--------------+---------+-----------+------+--------------+--------------+-------------------+------------------+-------------------------------------------------------------------------------------------------------------------------------------------------------+--------------+
; |DE1_USB_API                                                      ; 2117 (5)    ; 1004 (0)                  ; 1 (1)         ; 208000      ; 51   ; 0            ; 0       ; 0         ; 283  ; 0            ; 1113 (5)     ; 250 (0)           ; 754 (1)          ; |DE1_USB_API                                                                                                                                          ; work         ;
;    |AUDIO_DAC:u11|                                                ; 188 (188)   ; 95 (95)                   ; 0 (0)         ; 0           ; 0    ; 0            ; 0       ; 0         ; 0    ; 0            ; 93 (93)      ; 16 (16)           ; 79 (79)          ; |DE1_USB_API|AUDIO_DAC:u11                                                                                                                            ; work         ;
;    |CLK_LOCK:p0|                                                  ; 0 (0)       ; 0 (0)                     ; 0 (0)         ; 0           ; 0    ; 0            ; 0       ; 0         ; 0    ; 0            ; 0 (0)        ; 0 (0)             ; 0 (0)            ; |DE1_USB_API|CLK_LOCK:p0                                                                                                                              ; work         ;
;       |CLK_LOCK_altclkctrl_tb8:CLK_LOCK_altclkctrl_tb8_component| ; 0 (0)       ; 0 (0)                     ; 0 (0)         ; 0           ; 0    ; 0            ; 0       ; 0         ; 0    ; 0            ; 0 (0)        ; 0 (0)             ; 0 (0)            ; |DE1_USB_API|CLK_LOCK:p0|CLK_LOCK_altclkctrl_tb8:CLK_LOCK_altclkctrl_tb8_component                                                                    ; work         ;
;    |CMD_Decode:u5|                                                ; 374 (374)   ; 316 (316)                 ; 0 (0)         ; 0           ; 0    ; 0            ; 0       ; 0         ; 0    ; 0            ; 58 (58)      ; 127 (127)         ; 189 (189)        ; |DE1_USB_API|CMD_Decode:u5                                                                                                                            ; work         ;
;    |I2C_AV_Config:u10|                                            ; 89 (44)     ; 57 (35)                   ; 0 (0)         ; 0           ; 0    ; 0            ; 0       ; 0         ; 0    ; 0            ; 32 (9)       ; 3 (0)             ; 54 (35)          ; |DE1_USB_API|I2C_AV_Config:u10                                                                                                                        ; work         ;
;       |I2C_Controller:u0|                                         ; 45 (45)     ; 22 (22)                   ; 0 (0)         ; 0           ; 0    ; 0            ; 0       ; 0         ; 0    ; 0            ; 23 (23)      ; 3 (3)             ; 19 (19)          ; |DE1_USB_API|I2C_AV_Config:u10|I2C_Controller:u0                                                                                                      ; work         ;
;    |Multi_Flash:u2|                                               ; 188 (0)     ; 112 (0)                   ; 0 (0)         ; 0           ; 0    ; 0            ; 0       ; 0         ; 0    ; 0            ; 58 (0)       ; 20 (0)            ; 110 (0)          ; |DE1_USB_API|Multi_Flash:u2                                                                                                                           ; work         ;
;       |Flash_Controller:u1|                                       ; 155 (155)   ; 99 (99)                   ; 0 (0)         ; 0           ; 0    ; 0            ; 0       ; 0         ; 0    ; 0            ; 56 (56)      ; 12 (12)           ; 87 (87)          ; |DE1_USB_API|Multi_Flash:u2|Flash_Controller:u1                                                                                                       ; work         ;
;       |Flash_Multiplexer:u0|                                      ; 66 (66)     ; 13 (13)                   ; 0 (0)         ; 0           ; 0    ; 0            ; 0       ; 0         ; 0    ; 0            ; 2 (2)        ; 8 (8)             ; 56 (56)          ; |DE1_USB_API|Multi_Flash:u2|Flash_Multiplexer:u0                                                                                                      ; work         ;
;    |Multi_Sdram:u3|                                               ; 289 (0)     ; 217 (0)                   ; 0 (0)         ; 0           ; 0    ; 0            ; 0       ; 0         ; 0    ; 0            ; 71 (0)       ; 56 (0)            ; 162 (0)          ; |DE1_USB_API|Multi_Sdram:u3                                                                                                                           ; work         ;
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;          |PLL1:sdram_pll1|                                        ; 0 (0)       ; 0 (0)                     ; 0 (0)         ; 0           ; 0    ; 0            ; 0       ; 0         ; 0    ; 0            ; 0 (0)        ; 0 (0)             ; 0 (0)            ; |DE1_USB_API|Multi_Sdram:u3|Sdram_Controller:u1|PLL1:sdram_pll1                                                                                       ; work         ;
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;       |JTAG_REC:u0|                                               ; 20 (20)     ; 19 (19)                   ; 0 (0)         ; 0           ; 0    ; 0            ; 0       ; 0         ; 0    ; 0            ; 1 (1)        ; 15 (15)           ; 4 (4)            ; |DE1_USB_API|USB_JTAG:u1|JTAG_REC:u0                                                                                                                  ; work         ;
;       |JTAG_TRANS:u1|                                             ; 12 (12)     ; 4 (4)                     ; 0 (0)         ; 0           ; 0    ; 0            ; 0       ; 0         ; 0    ; 0            ; 8 (8)        ; 0 (0)             ; 4 (4)            ; |DE1_USB_API|USB_JTAG:u1|JTAG_TRANS:u1                                                                                                                ; work         ;
;    |VGA_Audio_PLL:p1|                                             ; 0 (0)       ; 0 (0)                     ; 0 (0)         ; 0           ; 0    ; 0            ; 0       ; 0         ; 0    ; 0            ; 0 (0)        ; 0 (0)             ; 0 (0)            ; |DE1_USB_API|VGA_Audio_PLL:p1                                                                                                                         ; work         ;
;       |altpll:altpll_component|                                   ; 0 (0)       ; 0 (0)                     ; 0 (0)         ; 0           ; 0    ; 0            ; 0       ; 0         ; 0    ; 0            ; 0 (0)        ; 0 (0)             ; 0 (0)            ; |DE1_USB_API|VGA_Audio_PLL:p1|altpll:altpll_component                                                                                                 ; work         ;
;    |VGA_Controller:u8|                                            ; 243 (243)   ; 73 (73)                   ; 0 (0)         ; 0           ; 0    ; 0            ; 0       ; 0         ; 0    ; 0            ; 149 (149)    ; 2 (2)             ; 92 (92)          ; |DE1_USB_API|VGA_Controller:u8                                                                                                                        ; work         ;
;    |VGA_OSD_RAM:u9|                                               ; 442 (73)    ; 20 (8)                    ; 0 (0)         ; 208000      ; 51   ; 0            ; 0       ; 0         ; 0    ; 0            ; 421 (61)     ; 1 (1)             ; 20 (14)          ; |DE1_USB_API|VGA_OSD_RAM:u9                                                                                                                           ; work         ;
;       |Img_RAM:u0|                                                ; 372 (0)     ; 12 (0)                    ; 0 (0)         ; 208000      ; 51   ; 0            ; 0       ; 0         ; 0    ; 0            ; 360 (0)      ; 0 (0)             ; 12 (0)           ; |DE1_USB_API|VGA_OSD_RAM:u9|Img_RAM:u0                                                                                                                ; work         ;
;          |altsyncram:altsyncram_component|                        ; 372 (0)     ; 12 (0)                    ; 0 (0)         ; 208000      ; 51   ; 0            ; 0       ; 0         ; 0    ; 0            ; 360 (0)      ; 0 (0)             ; 12 (0)           ; |DE1_USB_API|VGA_OSD_RAM:u9|Img_RAM:u0|altsyncram:altsyncram_component                                                                                ; work         ;
;             |altsyncram_f7o1:auto_generated|                      ; 372 (0)     ; 12 (0)                    ; 0 (0)         ; 208000      ; 51   ; 0            ; 0       ; 0         ; 0    ; 0            ; 360 (0)      ; 0 (0)             ; 12 (0)           ; |DE1_USB_API|VGA_OSD_RAM:u9|Img_RAM:u0|altsyncram:altsyncram_component|altsyncram_f7o1:auto_generated                                                 ; work         ;
;                |altsyncram_e132:altsyncram1|                      ; 372 (12)    ; 12 (12)                   ; 0 (0)         ; 208000      ; 51   ; 0            ; 0       ; 0         ; 0    ; 0            ; 360 (0)      ; 0 (0)             ; 12 (6)           ; |DE1_USB_API|VGA_OSD_RAM:u9|Img_RAM:u0|altsyncram:altsyncram_component|altsyncram_f7o1:auto_generated|altsyncram_e132:altsyncram1                     ; work         ;
;                   |decode_qpa:decode_a|                           ; 60 (60)     ; 0 (0)                     ; 0 (0)         ; 0           ; 0    ; 0            ; 0       ; 0         ; 0    ; 0            ; 60 (60)      ; 0 (0)             ; 0 (0)            ; |DE1_USB_API|VGA_OSD_RAM:u9|Img_RAM:u0|altsyncram:altsyncram_component|altsyncram_f7o1:auto_generated|altsyncram_e132:altsyncram1|decode_qpa:decode_a ; work         ;
;                   |mux_akb:mux5|                                  ; 306 (306)   ; 0 (0)                     ; 0 (0)         ; 0           ; 0    ; 0            ; 0       ; 0         ; 0    ; 0            ; 300 (300)    ; 0 (0)             ; 6 (6)            ; |DE1_USB_API|VGA_OSD_RAM:u9|Img_RAM:u0|altsyncram:altsyncram_component|altsyncram_f7o1:auto_generated|altsyncram_e132:altsyncram1|mux_akb:mux5        ; work         ;
;    |ps2_keyboard:u4|                                              ; 253 (253)   ; 57 (57)                   ; 0 (0)         ; 0           ; 0    ; 0            ; 0       ; 0         ; 0    ; 0            ; 196 (196)    ; 0 (0)             ; 57 (57)          ; |DE1_USB_API|ps2_keyboard:u4                                                                                                                          ; work         ;
+-------------------------------------------------------------------+-------------+---------------------------+---------------+-------------+------+--------------+---------+-----------+------+--------------+--------------+-------------------+------------------+-------------------------------------------------------------------------------------------------------------------------------------------------------+--------------+
Note: For table entries with two numbers listed, the numbers in parentheses indicate the number of resources of the given type used by the specific entity alone. The numbers listed outside of parentheses indicate the total resources of the given type used by the specific entity and all of its sub-entities in the hierarchy.


+----------------------------------------------------------------------------------------+
; Delay Chain Summary                                                                    ;
+---------------+----------+---------------+---------------+-----------------------+-----+
; Name          ; Pin Type ; Pad to Core 0 ; Pad to Core 1 ; Pad to Input Register ; TCO ;
+---------------+----------+---------------+---------------+-----------------------+-----+
; CLOCK_24[0]   ; Input    ; 0             ; 0             ; --                    ; --  ;
; CLOCK_24[1]   ; Input    ; 0             ; 0             ; --                    ; --  ;
; CLOCK_27[1]   ; Input    ; 0             ; 0             ; --                    ; --  ;
; EXT_CLOCK     ; Input    ; 0             ; 0             ; --                    ; --  ;
; KEY[1]        ; Input    ; 0             ; 0             ; --                    ; --  ;
; KEY[2]        ; Input    ; 0             ; 0             ; --                    ; --  ;
; KEY[3]        ; Input    ; 0             ; 0             ; --                    ; --  ;
; SW[2]         ; Input    ; 0             ; 0             ; --                    ; --  ;
; SW[3]         ; Input    ; 0             ; 0             ; --                    ; --  ;
; SW[4]         ; Input    ; 0             ; 0             ; --                    ; --  ;
; SW[5]         ; Input    ; 0             ; 0             ; --                    ; --  ;
; SW[6]         ; Input    ; 0             ; 0             ; --                    ; --  ;
; SW[7]         ; Input    ; 0             ; 0             ; --                    ; --  ;
; SW[8]         ; Input    ; 0             ; 0             ; --                    ; --  ;
; SW[9]         ; Input    ; 0             ; 0             ; --                    ; --  ;
; UART_RXD      ; Input    ; 0             ; 0             ; --                    ; --  ;
; AUD_ADCDAT    ; Input    ; 0             ; 0             ; --                    ; --  ;
; SW[0]         ; Input    ; 0             ; 0             ; --                    ; --  ;
; SW[1]         ; Input    ; 0             ; 0             ; --                    ; --  ;
; CLOCK_50      ; Input    ; --            ; --            ; --                    ; --  ;
; KEY[0]        ; Input    ; 6             ; 6             ; --                    ; --  ;
; TCS           ; Input    ; 0             ; 0             ; --                    ; --  ;
; CLOCK_27[0]   ; Input    ; --            ; --            ; --                    ; --  ;
; TCK           ; Input    ; 0             ; 0             ; --                    ; --  ;
; TDI           ; Input    ; 0             ; 0             ; --                    ; --  ;
; PS2_CLK       ; Input    ; 6             ; 6             ; --                    ; --  ;
; PS2_DAT       ; Input    ; 6             ; 6             ; --                    ; --  ;
; HEX0[0]       ; Output   ; --            ; --            ; --                    ; --  ;
; HEX0[1]       ; Output   ; --            ; --            ; --                    ; --  ;
; HEX0[2]       ; Output   ; --            ; --            ; --                    ; --  ;
; HEX0[3]       ; Output   ; --            ; --            ; --                    ; --  ;
; HEX0[4]       ; Output   ; --            ; --            ; --                    ; --  ;
; HEX0[5]       ; Output   ; --            ; --            ; --                    ; --  ;
; HEX0[6]       ; Output   ; --            ; --            ; --                    ; --  ;
; HEX1[0]       ; Output   ; --            ; --            ; --                    ; --  ;
; HEX1[1]       ; Output   ; --            ; --            ; --                    ; --  ;
; HEX1[2]       ; Output   ; --            ; --            ; --                    ; --  ;
; HEX1[3]       ; Output   ; --            ; --            ; --                    ; --  ;
; HEX1[4]       ; Output   ; --            ; --            ; --                    ; --  ;
; HEX1[5]       ; Output   ; --            ; --            ; --                    ; --  ;
; HEX1[6]       ; Output   ; --            ; --            ; --                    ; --  ;
; HEX2[0]       ; Output   ; --            ; --            ; --                    ; --  ;
; HEX2[1]       ; Output   ; --            ; --            ; --                    ; --  ;
; HEX2[2]       ; Output   ; --            ; --            ; --                    ; --  ;
; HEX2[3]       ; Output   ; --            ; --            ; --                    ; --  ;
; HEX2[4]       ; Output   ; --            ; --            ; --                    ; --  ;
; HEX2[5]       ; Output   ; --            ; --            ; --                    ; --  ;
; HEX2[6]       ; Output   ; --            ; --            ; --                    ; --  ;
; HEX3[0]       ; Output   ; --            ; --            ; --                    ; --  ;
; HEX3[1]       ; Output   ; --            ; --            ; --                    ; --  ;
; HEX3[2]       ; Output   ; --            ; --            ; --                    ; --  ;
; HEX3[3]       ; Output   ; --            ; --            ; --                    ; --  ;
; HEX3[4]       ; Output   ; --            ; --            ; --                    ; --  ;
; HEX3[5]       ; Output   ; --            ; --            ; --                    ; --  ;
; HEX3[6]       ; Output   ; --            ; --            ; --                    ; --  ;
; LEDG[0]       ; Output   ; --            ; --            ; --                    ; --  ;
; LEDG[1]       ; Output   ; --            ; --            ; --                    ; --  ;
; LEDG[2]       ; Output   ; --            ; --            ; --                    ; --  ;
; LEDG[3]       ; Output   ; --            ; --            ; --                    ; --  ;
; LEDG[4]       ; Output   ; --            ; --            ; --                    ; --  ;
; LEDG[5]       ; Output   ; --            ; --            ; --                    ; --  ;
; LEDG[6]       ; Output   ; --            ; --            ; --                    ; --  ;
; LEDG[7]       ; Output   ; --            ; --            ; --                    ; --  ;
; LEDR[0]       ; Output   ; --            ; --            ; --                    ; --  ;
; LEDR[1]       ; Output   ; --            ; --            ; --                    ; --  ;
; LEDR[2]       ; Output   ; --            ; --            ; --                    ; --  ;
; LEDR[3]       ; Output   ; --            ; --            ; --                    ; --  ;
; LEDR[4]       ; Output   ; --            ; --            ; --                    ; --  ;
; LEDR[5]       ; Output   ; --            ; --            ; --                    ; --  ;
; LEDR[6]       ; Output   ; --            ; --            ; --                    ; --  ;
; LEDR[7]       ; Output   ; --            ; --            ; --                    ; --  ;
; LEDR[8]       ; Output   ; --            ; --            ; --                    ; --  ;
; LEDR[9]       ; Output   ; --            ; --            ; --                    ; --  ;
; UART_TXD      ; Output   ; --            ; --            ; --                    ; --  ;
; DRAM_ADDR[0]  ; Output   ; --            ; --            ; --                    ; --  ;
; DRAM_ADDR[1]  ; Output   ; --            ; --            ; --                    ; --  ;
; DRAM_ADDR[2]  ; Output   ; --            ; --            ; --                    ; --  ;
; DRAM_ADDR[3]  ; Output   ; --            ; --            ; --                    ; --  ;
; DRAM_ADDR[4]  ; Output   ; --            ; --            ; --                    ; --  ;
; DRAM_ADDR[5]  ; Output   ; --            ; --            ; --                    ; --  ;
; DRAM_ADDR[6]  ; Output   ; --            ; --            ; --                    ; --  ;
; DRAM_ADDR[7]  ; Output   ; --            ; --            ; --                    ; --  ;
; DRAM_ADDR[8]  ; Output   ; --            ; --            ; --                    ; --  ;
; DRAM_ADDR[9]  ; Output   ; --            ; --            ; --                    ; --  ;
; DRAM_ADDR[10] ; Output   ; --            ; --            ; --                    ; --  ;
; DRAM_ADDR[11] ; Output   ; --            ; --            ; --                    ; --  ;
; DRAM_LDQM     ; Output   ; --            ; --            ; --                    ; --  ;
; DRAM_UDQM     ; Output   ; --            ; --            ; --                    ; --  ;
; DRAM_WE_N     ; Output   ; --            ; --            ; --                    ; --  ;
; DRAM_CAS_N    ; Output   ; --            ; --            ; --                    ; --  ;
; DRAM_RAS_N    ; Output   ; --            ; --            ; --                    ; --  ;
; DRAM_CS_N     ; Output   ; --            ; --            ; --                    ; --  ;
; DRAM_BA_0     ; Output   ; --            ; --            ; --                    ; --  ;
; DRAM_BA_1     ; Output   ; --            ; --            ; --                    ; --  ;
; DRAM_CLK      ; Output   ; --            ; --            ; --                    ; --  ;
; DRAM_CKE      ; Output   ; --            ; --            ; --                    ; --  ;
; FL_ADDR[0]    ; Output   ; --            ; --            ; --                    ; --  ;
; FL_ADDR[1]    ; Output   ; --            ; --            ; --                    ; --  ;
; FL_ADDR[2]    ; Output   ; --            ; --            ; --                    ; --  ;
; FL_ADDR[3]    ; Output   ; --            ; --            ; --                    ; --  ;
; FL_ADDR[4]    ; Output   ; --            ; --            ; --                    ; --  ;
; FL_ADDR[5]    ; Output   ; --            ; --            ; --                    ; --  ;
; FL_ADDR[6]    ; Output   ; --            ; --            ; --                    ; --  ;
; FL_ADDR[7]    ; Output   ; --            ; --            ; --                    ; --  ;
; FL_ADDR[8]    ; Output   ; --            ; --            ; --                    ; --  ;
; FL_ADDR[9]    ; Output   ; --            ; --            ; --                    ; --  ;
; FL_ADDR[10]   ; Output   ; --            ; --            ; --                    ; --  ;
; FL_ADDR[11]   ; Output   ; --            ; --            ; --                    ; --  ;
; FL_ADDR[12]   ; Output   ; --            ; --            ; --                    ; --  ;
; FL_ADDR[13]   ; Output   ; --            ; --            ; --                    ; --  ;
; FL_ADDR[14]   ; Output   ; --            ; --            ; --                    ; --  ;
; FL_ADDR[15]   ; Output   ; --            ; --            ; --                    ; --  ;
; FL_ADDR[16]   ; Output   ; --            ; --            ; --                    ; --  ;
; FL_ADDR[17]   ; Output   ; --            ; --            ; --                    ; --  ;
; FL_ADDR[18]   ; Output   ; --            ; --            ; --                    ; --  ;
; FL_ADDR[19]   ; Output   ; --            ; --            ; --                    ; --  ;
; FL_ADDR[20]   ; Output   ; --            ; --            ; --                    ; --  ;
; FL_ADDR[21]   ; Output   ; --            ; --            ; --                    ; --  ;
; FL_WE_N       ; Output   ; --            ; --            ; --                    ; --  ;
; FL_RST_N      ; Output   ; --            ; --            ; --                    ; --  ;
; FL_OE_N       ; Output   ; --            ; --            ; --                    ; --  ;
; FL_CE_N       ; Output   ; --            ; --            ; --                    ; --  ;
; SRAM_ADDR[0]  ; Output   ; --            ; --            ; --                    ; --  ;
; SRAM_ADDR[1]  ; Output   ; --            ; --            ; --                    ; --  ;
; SRAM_ADDR[2]  ; Output   ; --            ; --            ; --                    ; --  ;
; SRAM_ADDR[3]  ; Output   ; --            ; --            ; --                    ; --  ;
; SRAM_ADDR[4]  ; Output   ; --            ; --            ; --                    ; --  ;
; SRAM_ADDR[5]  ; Output   ; --            ; --            ; --                    ; --  ;
; SRAM_ADDR[6]  ; Output   ; --            ; --            ; --                    ; --  ;
; SRAM_ADDR[7]  ; Output   ; --            ; --            ; --                    ; --  ;
; SRAM_ADDR[8]  ; Output   ; --            ; --            ; --                    ; --  ;
; SRAM_ADDR[9]  ; Output   ; --            ; --            ; --                    ; --  ;
; SRAM_ADDR[10] ; Output   ; --            ; --            ; --                    ; --  ;
; SRAM_ADDR[11] ; Output   ; --            ; --            ; --                    ; --  ;
; SRAM_ADDR[12] ; Output   ; --            ; --            ; --                    ; --  ;
; SRAM_ADDR[13] ; Output   ; --            ; --            ; --                    ; --  ;
; SRAM_ADDR[14] ; Output   ; --            ; --            ; --                    ; --  ;
; SRAM_ADDR[15] ; Output   ; --            ; --            ; --                    ; --  ;
; SRAM_ADDR[16] ; Output   ; --            ; --            ; --                    ; --  ;
; SRAM_ADDR[17] ; Output   ; --            ; --            ; --                    ; --  ;
; SRAM_UB_N     ; Output   ; --            ; --            ; --                    ; --  ;
; SRAM_LB_N     ; Output   ; --            ; --            ; --                    ; --  ;
; SRAM_WE_N     ; Output   ; --            ; --            ; --                    ; --  ;
; SRAM_CE_N     ; Output   ; --            ; --            ; --                    ; --  ;
; SRAM_OE_N     ; Output   ; --            ; --            ; --                    ; --  ;
; SD_CLK        ; Output   ; --            ; --            ; --                    ; --  ;
; TDO           ; Output   ; --            ; --            ; --                    ; 0   ;
; I2C_SCLK      ; Output   ; --            ; --            ; --                    ; --  ;
; VGA_HS        ; Output   ; --            ; --            ; --                    ; --  ;
; VGA_VS        ; Output   ; --            ; --            ; --                    ; --  ;
; VGA_R[0]      ; Output   ; --            ; --            ; --                    ; --  ;
; VGA_R[1]      ; Output   ; --            ; --            ; --                    ; --  ;
; VGA_R[2]      ; Output   ; --            ; --            ; --                    ; --  ;
; VGA_R[3]      ; Output   ; --            ; --            ; --                    ; --  ;
; VGA_G[0]      ; Output   ; --            ; --            ; --                    ; --  ;
; VGA_G[1]      ; Output   ; --            ; --            ; --                    ; --  ;
; VGA_G[2]      ; Output   ; --            ; --            ; --                    ; --  ;
; VGA_G[3]      ; Output   ; --            ; --            ; --                    ; --  ;
; VGA_B[0]      ; Output   ; --            ; --            ; --                    ; --  ;
; VGA_B[1]      ; Output   ; --            ; --            ; --                    ; --  ;
; VGA_B[2]      ; Output   ; --            ; --            ; --                    ; --  ;
; VGA_B[3]      ; Output   ; --            ; --            ; --                    ; --  ;
; AUD_ADCLRCK   ; Output   ; --            ; --            ; --                    ; --  ;
; AUD_DACLRCK   ; Output   ; --            ; --            ; --                    ; --  ;
; AUD_DACDAT    ; Output   ; --            ; --            ; --                    ; --  ;
; AUD_XCK       ; Output   ; --            ; --            ; --                    ; --  ;
; SD_DAT3       ; Bidir    ; 0             ; 0             ; --                    ; --  ;
; SD_CMD        ; Bidir    ; 0             ; 0             ; --                    ; --  ;
; DRAM_DQ[0]    ; Bidir    ; 6             ; 6             ; --                    ; --  ;
; DRAM_DQ[1]    ; Bidir    ; 6             ; 6             ; --                    ; --  ;
; DRAM_DQ[2]    ; Bidir    ; 6             ; 6             ; --                    ; --  ;
; DRAM_DQ[3]    ; Bidir    ; 6             ; 6             ; --                    ; --  ;
; DRAM_DQ[4]    ; Bidir    ; 6             ; 6             ; --                    ; --  ;
; DRAM_DQ[5]    ; Bidir    ; 6             ; 6             ; --                    ; --  ;
; DRAM_DQ[6]    ; Bidir    ; 6             ; 6             ; --                    ; --  ;
; DRAM_DQ[7]    ; Bidir    ; 6             ; 6             ; --                    ; --  ;
; DRAM_DQ[8]    ; Bidir    ; 6             ; 6             ; --                    ; --  ;
; DRAM_DQ[9]    ; Bidir    ; 6             ; 6             ; --                    ; --  ;
; DRAM_DQ[10]   ; Bidir    ; 6             ; 6             ; --                    ; --  ;
; DRAM_DQ[11]   ; Bidir    ; 6             ; 6             ; --                    ; --  ;
; DRAM_DQ[12]   ; Bidir    ; 6             ; 6             ; --                    ; --  ;
; DRAM_DQ[13]   ; Bidir    ; 6             ; 6             ; --                    ; --  ;
; DRAM_DQ[14]   ; Bidir    ; 6             ; 6             ; --                    ; --  ;
; DRAM_DQ[15]   ; Bidir    ; 6             ; 6             ; --                    ; --  ;
; FL_DQ[0]      ; Bidir    ; 6             ; 6             ; --                    ; --  ;
; FL_DQ[1]      ; Bidir    ; 6             ; 6             ; --                    ; --  ;
; FL_DQ[2]      ; Bidir    ; 6             ; 6             ; --                    ; --  ;
; FL_DQ[3]      ; Bidir    ; 6             ; 6             ; --                    ; --  ;
; FL_DQ[4]      ; Bidir    ; 6             ; 6             ; --                    ; --  ;
; FL_DQ[5]      ; Bidir    ; 6             ; 6             ; --                    ; --  ;
; FL_DQ[6]      ; Bidir    ; 6             ; 6             ; --                    ; --  ;
; FL_DQ[7]      ; Bidir    ; 6             ; 6             ; --                    ; --  ;
; SRAM_DQ[0]    ; Bidir    ; 6             ; 6             ; --                    ; --  ;
; SRAM_DQ[1]    ; Bidir    ; 6             ; 6             ; --                    ; --  ;
; SRAM_DQ[2]    ; Bidir    ; 6             ; 6             ; --                    ; --  ;
; SRAM_DQ[3]    ; Bidir    ; 6             ; 6             ; --                    ; --  ;
; SRAM_DQ[4]    ; Bidir    ; 6             ; 6             ; --                    ; --  ;
; SRAM_DQ[5]    ; Bidir    ; 6             ; 6             ; --                    ; --  ;
; SRAM_DQ[6]    ; Bidir    ; 6             ; 6             ; --                    ; --  ;
; SRAM_DQ[7]    ; Bidir    ; 6             ; 6             ; --                    ; --  ;
; SRAM_DQ[8]    ; Bidir    ; 6             ; 6             ; --                    ; --  ;
; SRAM_DQ[9]    ; Bidir    ; 6             ; 6             ; --                    ; --  ;
; SRAM_DQ[10]   ; Bidir    ; 6             ; 6             ; --                    ; --  ;
; SRAM_DQ[11]   ; Bidir    ; 6             ; 6             ; --                    ; --  ;
; SRAM_DQ[12]   ; Bidir    ; 6             ; 6             ; --                    ; --  ;
; SRAM_DQ[13]   ; Bidir    ; 6             ; 6             ; --                    ; --  ;
; SRAM_DQ[14]   ; Bidir    ; 6             ; 6             ; --                    ; --  ;
; SRAM_DQ[15]   ; Bidir    ; 6             ; 6             ; --                    ; --  ;
; SD_DAT        ; Bidir    ; 0             ; 0             ; --                    ; --  ;
; I2C_SDAT      ; Bidir    ; 6             ; 6             ; --                    ; --  ;
; AUD_BCLK      ; Bidir    ; 0             ; 0             ; --                    ; --  ;
; GPIO_0[0]     ; Bidir    ; 0             ; 0             ; --                    ; --  ;
; GPIO_0[1]     ; Bidir    ; 0             ; 0             ; --                    ; --  ;
; GPIO_0[2]     ; Bidir    ; 0             ; 0             ; --                    ; --  ;
; GPIO_0[3]     ; Bidir    ; 0             ; 0             ; --                    ; --  ;
; GPIO_0[4]     ; Bidir    ; 0             ; 0             ; --                    ; --  ;
; GPIO_0[5]     ; Bidir    ; 0             ; 0             ; --                    ; --  ;
; GPIO_0[6]     ; Bidir    ; 0             ; 0             ; --                    ; --  ;
; GPIO_0[7]     ; Bidir    ; 0             ; 0             ; --                    ; --  ;
; GPIO_0[8]     ; Bidir    ; 0             ; 0             ; --                    ; --  ;
; GPIO_0[9]     ; Bidir    ; 0             ; 0             ; --                    ; --  ;
; GPIO_0[10]    ; Bidir    ; 0             ; 0             ; --                    ; --  ;
; GPIO_0[11]    ; Bidir    ; 0             ; 0             ; --                    ; --  ;
; GPIO_0[12]    ; Bidir    ; 0             ; 0             ; --                    ; --  ;
; GPIO_0[13]    ; Bidir    ; 0             ; 0             ; --                    ; --  ;
; GPIO_0[14]    ; Bidir    ; 0             ; 0             ; --                    ; --  ;
; GPIO_0[15]    ; Bidir    ; 0             ; 0             ; --                    ; --  ;
; GPIO_0[16]    ; Bidir    ; 0             ; 0             ; --                    ; --  ;
; GPIO_0[17]    ; Bidir    ; 0             ; 0             ; --                    ; --  ;
; GPIO_0[18]    ; Bidir    ; 0             ; 0             ; --                    ; --  ;
; GPIO_0[19]    ; Bidir    ; 0             ; 0             ; --                    ; --  ;
; GPIO_0[20]    ; Bidir    ; 0             ; 0             ; --                    ; --  ;
; GPIO_0[21]    ; Bidir    ; 0             ; 0             ; --                    ; --  ;
; GPIO_0[22]    ; Bidir    ; 0             ; 0             ; --                    ; --  ;
; GPIO_0[23]    ; Bidir    ; 0             ; 0             ; --                    ; --  ;
; GPIO_0[24]    ; Bidir    ; 0             ; 0             ; --                    ; --  ;
; GPIO_0[25]    ; Bidir    ; 0             ; 0             ; --                    ; --  ;
; GPIO_0[26]    ; Bidir    ; 0             ; 0             ; --                    ; --  ;
; GPIO_0[27]    ; Bidir    ; 0             ; 0             ; --                    ; --  ;
; GPIO_0[28]    ; Bidir    ; 0             ; 0             ; --                    ; --  ;
; GPIO_0[29]    ; Bidir    ; 0             ; 0             ; --                    ; --  ;
; GPIO_0[30]    ; Bidir    ; 0             ; 0             ; --                    ; --  ;
; GPIO_0[31]    ; Bidir    ; 0             ; 0             ; --                    ; --  ;
; GPIO_0[32]    ; Bidir    ; 0             ; 0             ; --                    ; --  ;
; GPIO_0[33]    ; Bidir    ; 0             ; 0             ; --                    ; --  ;
; GPIO_0[34]    ; Bidir    ; 0             ; 0             ; --                    ; --  ;
; GPIO_0[35]    ; Bidir    ; 0             ; 0             ; --                    ; --  ;
; GPIO_1[0]     ; Bidir    ; 0             ; 0             ; --                    ; --  ;
; GPIO_1[1]     ; Bidir    ; 0             ; 0             ; --                    ; --  ;
; GPIO_1[2]     ; Bidir    ; 0             ; 0             ; --                    ; --  ;
; GPIO_1[3]     ; Bidir    ; 0             ; 0             ; --                    ; --  ;
; GPIO_1[4]     ; Bidir    ; 0             ; 0             ; --                    ; --  ;
; GPIO_1[5]     ; Bidir    ; 0             ; 0             ; --                    ; --  ;
; GPIO_1[6]     ; Bidir    ; 0             ; 0             ; --                    ; --  ;
; GPIO_1[7]     ; Bidir    ; 0             ; 0             ; --                    ; --  ;
; GPIO_1[8]     ; Bidir    ; 0             ; 0             ; --                    ; --  ;
; GPIO_1[9]     ; Bidir    ; 0             ; 0             ; --                    ; --  ;
; GPIO_1[10]    ; Bidir    ; 0             ; 0             ; --                    ; --  ;
; GPIO_1[11]    ; Bidir    ; 0             ; 0             ; --                    ; --  ;
; GPIO_1[12]    ; Bidir    ; 0             ; 0             ; --                    ; --  ;
; GPIO_1[13]    ; Bidir    ; 0             ; 0             ; --                    ; --  ;
; GPIO_1[14]    ; Bidir    ; 0             ; 0             ; --                    ; --  ;
; GPIO_1[15]    ; Bidir    ; 0             ; 0             ; --                    ; --  ;
; GPIO_1[16]    ; Bidir    ; 0             ; 0             ; --                    ; --  ;
; GPIO_1[17]    ; Bidir    ; 0             ; 0             ; --                    ; --  ;
; GPIO_1[18]    ; Bidir    ; 0             ; 0             ; --                    ; --  ;
; GPIO_1[19]    ; Bidir    ; 0             ; 0             ; --                    ; --  ;
; GPIO_1[20]    ; Bidir    ; 0             ; 0             ; --                    ; --  ;
; GPIO_1[21]    ; Bidir    ; 0             ; 0             ; --                    ; --  ;
; GPIO_1[22]    ; Bidir    ; 0             ; 0             ; --                    ; --  ;
; GPIO_1[23]    ; Bidir    ; 0             ; 0             ; --                    ; --  ;
; GPIO_1[24]    ; Bidir    ; 0             ; 0             ; --                    ; --  ;
; GPIO_1[25]    ; Bidir    ; 0             ; 0             ; --                    ; --  ;
; GPIO_1[26]    ; Bidir    ; 0             ; 0             ; --                    ; --  ;
; GPIO_1[27]    ; Bidir    ; 0             ; 0             ; --                    ; --  ;
; GPIO_1[28]    ; Bidir    ; 0             ; 0             ; --                    ; --  ;
; GPIO_1[29]    ; Bidir    ; 0             ; 0             ; --                    ; --  ;
; GPIO_1[30]    ; Bidir    ; 0             ; 0             ; --                    ; --  ;
; GPIO_1[31]    ; Bidir    ; 0             ; 0             ; --                    ; --  ;
; GPIO_1[32]    ; Bidir    ; 0             ; 0             ; --                    ; --  ;
; GPIO_1[33]    ; Bidir    ; 0             ; 0             ; --                    ; --  ;
; GPIO_1[34]    ; Bidir    ; 0             ; 0             ; --                    ; --  ;
; GPIO_1[35]    ; Bidir    ; 0             ; 0             ; --                    ; --  ;
+---------------+----------+---------------+---------------+-----------------------+-----+


+---------------------------------------------------------------------------------------------------------------------+
; Pad To Core Delay Chain Fanout                                                                                      ;
+---------------------------------------------------------------------------------------+-------------------+---------+
; Source Pin / Fanout                                                                   ; Pad To Core Index ; Setting ;
+---------------------------------------------------------------------------------------+-------------------+---------+
; CLOCK_24[0]                                                                           ;                   ;         ;
; CLOCK_24[1]                                                                           ;                   ;         ;
; CLOCK_27[1]                                                                           ;                   ;         ;
; EXT_CLOCK                                                                             ;                   ;         ;
; KEY[1]                                                                                ;                   ;         ;
; KEY[2]                                                                                ;                   ;         ;
; KEY[3]                                                                                ;                   ;         ;
; SW[2]                                                                                 ;                   ;         ;
; SW[3]                                                                                 ;                   ;         ;
; SW[4]                                                                                 ;                   ;         ;
; SW[5]                                                                                 ;                   ;         ;
; SW[6]                                                                                 ;                   ;         ;
; SW[7]                                                                                 ;                   ;         ;
; SW[8]                                                                                 ;                   ;         ;
; SW[9]                                                                                 ;                   ;         ;
; UART_RXD                                                                              ;                   ;         ;
; AUD_ADCDAT                                                                            ;                   ;         ;
; SW[0]                                                                                 ;                   ;         ;
; SW[1]                                                                                 ;                   ;         ;
; CLOCK_50                                                                              ;                   ;         ;
; KEY[0]                                                                                ;                   ;         ;
;      - I2C_AV_Config:u10|mI2C_CTRL_CLK                                                ; 1                 ; 6       ;
;      - CMD_Decode:u5|CMD_Tmp[8]                                                       ; 1                 ; 6       ;
;      - CMD_Decode:u5|oSR_Select[0]                                                    ; 1                 ; 6       ;
;      - CMD_Decode:u5|oSR_Select[1]                                                    ; 1                 ; 6       ;
;      - CMD_Decode:u5|mSR_Start                                                        ; 1                 ; 6       ;
;      - CMD_Decode:u5|mSDR_WRn                                                         ; 1                 ; 6       ;
;      - CMD_Decode:u5|oLED_GREEN[0]                                                    ; 1                 ; 6       ;
;      - CMD_Decode:u5|oLED_GREEN[1]                                                    ; 1                 ; 6       ;
;      - CMD_Decode:u5|oLED_GREEN[2]                                                    ; 1                 ; 6       ;
;      - CMD_Decode:u5|oLED_GREEN[3]                                                    ; 1                 ; 6       ;
;      - CMD_Decode:u5|oLED_GREEN[4]                                                    ; 1                 ; 6       ;
;      - CMD_Decode:u5|oLED_GREEN[5]                                                    ; 1                 ; 6       ;
;      - CMD_Decode:u5|oLED_GREEN[6]                                                    ; 1                 ; 6       ;
;      - CMD_Decode:u5|oLED_GREEN[7]                                                    ; 1                 ; 6       ;
;      - CMD_Decode:u5|oLED_RED[0]                                                      ; 1                 ; 6       ;
;      - CMD_Decode:u5|oLED_RED[1]                                                      ; 1                 ; 6       ;
;      - CMD_Decode:u5|oLED_RED[2]                                                      ; 1                 ; 6       ;
;      - CMD_Decode:u5|oLED_RED[3]                                                      ; 1                 ; 6       ;
;      - CMD_Decode:u5|oLED_RED[4]                                                      ; 1                 ; 6       ;
;      - CMD_Decode:u5|oLED_RED[5]                                                      ; 1                 ; 6       ;
;      - CMD_Decode:u5|oLED_RED[6]                                                      ; 1                 ; 6       ;
;      - CMD_Decode:u5|oLED_RED[7]                                                      ; 1                 ; 6       ;
;      - CMD_Decode:u5|oLED_RED[8]                                                      ; 1                 ; 6       ;
;      - CMD_Decode:u5|oLED_RED[9]                                                      ; 1                 ; 6       ;
;      - CMD_Decode:u5|oSEG7_DIG[15]                                                    ; 1                 ; 6       ;
;      - CMD_Decode:u5|oSEG7_DIG[14]                                                    ; 1                 ; 6       ;
;      - CMD_Decode:u5|oSEG7_DIG[13]                                                    ; 1                 ; 6       ;
;      - CMD_Decode:u5|oSEG7_DIG[12]                                                    ; 1                 ; 6       ;
;      - CMD_Decode:u5|oSEG7_DIG[11]                                                    ; 1                 ; 6       ;
;      - CMD_Decode:u5|oSEG7_DIG[10]                                                    ; 1                 ; 6       ;
;      - CMD_Decode:u5|oSEG7_DIG[9]                                                     ; 1                 ; 6       ;
;      - CMD_Decode:u5|oSEG7_DIG[8]                                                     ; 1                 ; 6       ;
;      - CMD_Decode:u5|oSEG7_DIG[7]                                                     ; 1                 ; 6       ;
;      - CMD_Decode:u5|oSEG7_DIG[6]                                                     ; 1                 ; 6       ;
;      - CMD_Decode:u5|oSEG7_DIG[5]                                                     ; 1                 ; 6       ;
;      - CMD_Decode:u5|oSEG7_DIG[4]                                                     ; 1                 ; 6       ;
;      - CMD_Decode:u5|oSEG7_DIG[3]                                                     ; 1                 ; 6       ;
;      - CMD_Decode:u5|oSEG7_DIG[2]                                                     ; 1                 ; 6       ;
;      - CMD_Decode:u5|oSEG7_DIG[1]                                                     ; 1                 ; 6       ;
;      - CMD_Decode:u5|oSEG7_DIG[0]                                                     ; 1                 ; 6       ;
;      - Multi_Flash:u2|Flash_Controller:u1|WE_CLK_Delay[4]                             ; 1                 ; 6       ;
;      - Multi_Flash:u2|Flash_Controller:u1|ST.IDEL                                     ; 1                 ; 6       ;
;      - Multi_Flash:u2|Flash_Controller:u1|ST.P6_CHP_ERA                               ; 1                 ; 6       ;
;      - Multi_Flash:u2|Flash_Controller:u1|ST.P4                                       ; 1                 ; 6       ;
;      - Multi_Flash:u2|Flash_Controller:u1|ST.P3                                       ; 1                 ; 6       ;
;      - Multi_Flash:u2|Flash_Controller:u1|ST.P3_DEV                                   ; 1                 ; 6       ;
;      - Multi_Flash:u2|Flash_Controller:u1|ST.P3_PRG                                   ; 1                 ; 6       ;
;      - Multi_Flash:u2|Flash_Controller:u1|ST.P2                                       ; 1                 ; 6       ;
;      - Multi_Flash:u2|Flash_Controller:u1|ST.P1                                       ; 1                 ; 6       ;
;      - Multi_Flash:u2|Flash_Controller:u1|ST.P4_PRG                                   ; 1                 ; 6       ;
;      - Multi_Flash:u2|Flash_Controller:u1|ST.READ                                     ; 1                 ; 6       ;
;      - Multi_Flash:u2|Flash_Controller:u1|ST.P5                                       ; 1                 ; 6       ;
;      - I2C_AV_Config:u10|I2C_Controller:u0|SD_COUNTER[5]                              ; 1                 ; 6       ;
;      - I2C_AV_Config:u10|I2C_Controller:u0|SD_COUNTER[2]                              ; 1                 ; 6       ;
;      - I2C_AV_Config:u10|I2C_Controller:u0|SD_COUNTER[3]                              ; 1                 ; 6       ;
;      - I2C_AV_Config:u10|I2C_Controller:u0|SD_COUNTER[0]                              ; 1                 ; 6       ;
;      - I2C_AV_Config:u10|I2C_Controller:u0|SD_COUNTER[1]                              ; 1                 ; 6       ;
;      - I2C_AV_Config:u10|I2C_Controller:u0|SD_COUNTER[4]                              ; 1                 ; 6       ;
;      - I2C_AV_Config:u10|I2C_Controller:u0|SCLK                                       ; 1                 ; 6       ;
;      - CMD_Decode:u5|f_SEG7                                                           ; 1                 ; 6       ;
;      - CMD_Decode:u5|CMD_Tmp[63]                                                      ; 1                 ; 6       ;
;      - CMD_Decode:u5|CMD_Tmp[62]                                                      ; 1                 ; 6       ;
;      - CMD_Decode:u5|CMD_Tmp[61]                                                      ; 1                 ; 6       ;
;      - CMD_Decode:u5|CMD_Tmp[59]                                                      ; 1                 ; 6       ;
;      - CMD_Decode:u5|CMD_Tmp[56]                                                      ; 1                 ; 6       ;
;      - CMD_Decode:u5|CMD_Tmp[60]                                                      ; 1                 ; 6       ;
;      - CMD_Decode:u5|CMD_Tmp[57]                                                      ; 1                 ; 6       ;
;      - CMD_Decode:u5|CMD_Tmp[58]                                                      ; 1                 ; 6       ;
;      - CMD_Decode:u5|CMD_Tmp[7]                                                       ; 1                 ; 6       ;
;      - CMD_Decode:u5|CMD_Tmp[3]                                                       ; 1                 ; 6       ;
;      - CMD_Decode:u5|CMD_Tmp[4]                                                       ; 1                 ; 6       ;
;      - CMD_Decode:u5|CMD_Tmp[0]                                                       ; 1                 ; 6       ;
;      - CMD_Decode:u5|CMD_Tmp[6]                                                       ; 1                 ; 6       ;
;      - CMD_Decode:u5|CMD_Tmp[2]                                                       ; 1                 ; 6       ;
;      - CMD_Decode:u5|CMD_Tmp[5]                                                       ; 1                 ; 6       ;
;      - CMD_Decode:u5|CMD_Tmp[1]                                                       ; 1                 ; 6       ;
;      - CMD_Decode:u5|CMD_Tmp[9]                                                       ; 1                 ; 6       ;
;      - CMD_Decode:u5|CMD_Tmp[10]                                                      ; 1                 ; 6       ;
;      - CMD_Decode:u5|CMD_Tmp[11]                                                      ; 1                 ; 6       ;
;      - CMD_Decode:u5|CMD_Tmp[12]                                                      ; 1                 ; 6       ;
;      - CMD_Decode:u5|CMD_Tmp[13]                                                      ; 1                 ; 6       ;
;      - CMD_Decode:u5|CMD_Tmp[14]                                                      ; 1                 ; 6       ;
;      - CMD_Decode:u5|CMD_Tmp[15]                                                      ; 1                 ; 6       ;
;      - CMD_Decode:u5|CMD_Tmp[16]                                                      ; 1                 ; 6       ;
;      - CMD_Decode:u5|CMD_Tmp[17]                                                      ; 1                 ; 6       ;
;      - CMD_Decode:u5|CMD_Tmp[18]                                                      ; 1                 ; 6       ;
;      - CMD_Decode:u5|CMD_Tmp[19]                                                      ; 1                 ; 6       ;
;      - CMD_Decode:u5|CMD_Tmp[20]                                                      ; 1                 ; 6       ;
;      - CMD_Decode:u5|CMD_Tmp[21]                                                      ; 1                 ; 6       ;
;      - CMD_Decode:u5|CMD_Tmp[22]                                                      ; 1                 ; 6       ;
;      - CMD_Decode:u5|CMD_Tmp[23]                                                      ; 1                 ; 6       ;
;      - CMD_Decode:u5|f_LED                                                            ; 1                 ; 6       ;
;      - CMD_Decode:u5|CMD_Tmp[24]                                                      ; 1                 ; 6       ;
;      - CMD_Decode:u5|CMD_Tmp[25]                                                      ; 1                 ; 6       ;
;      - CMD_Decode:u5|CMD_Tmp[26]                                                      ; 1                 ; 6       ;
;      - CMD_Decode:u5|CMD_Tmp[27]                                                      ; 1                 ; 6       ;
;      - CMD_Decode:u5|CMD_Tmp[28]                                                      ; 1                 ; 6       ;
;      - CMD_Decode:u5|CMD_Tmp[29]                                                      ; 1                 ; 6       ;
;      - CMD_Decode:u5|CMD_Tmp[30]                                                      ; 1                 ; 6       ;
;      - CMD_Decode:u5|CMD_Tmp[31]                                                      ; 1                 ; 6       ;
;      - CMD_Decode:u5|CMD_Tmp[32]                                                      ; 1                 ; 6       ;
;      - CMD_Decode:u5|CMD_Tmp[33]                                                      ; 1                 ; 6       ;
;      - Multi_Sdram:u3|Sdram_Controller:u1|command:command1|SA[0]                      ; 1                 ; 6       ;
;      - Multi_Sdram:u3|Sdram_Controller:u1|ST[8]                                       ; 1                 ; 6       ;
;      - Multi_Sdram:u3|Sdram_Controller:u1|ST[7]                                       ; 1                 ; 6       ;
;      - Multi_Sdram:u3|Sdram_Controller:u1|ST[4]                                       ; 1                 ; 6       ;
;      - Multi_Sdram:u3|Sdram_Controller:u1|ST[6]                                       ; 1                 ; 6       ;
;      - Multi_Sdram:u3|Sdram_Controller:u1|ST[5]                                       ; 1                 ; 6       ;
;      - Multi_Sdram:u3|Sdram_Controller:u1|ST[1]                                       ; 1                 ; 6       ;
;      - Multi_Sdram:u3|Sdram_Controller:u1|ST[0]                                       ; 1                 ; 6       ;
;      - Multi_Sdram:u3|Sdram_Controller:u1|ST[2]                                       ; 1                 ; 6       ;
;      - Multi_Sdram:u3|Sdram_Controller:u1|ST[3]                                       ; 1                 ; 6       ;
;      - Multi_Sdram:u3|Sdram_Controller:u1|command:command1|SA[1]                      ; 1                 ; 6       ;
;      - Multi_Sdram:u3|Sdram_Controller:u1|command:command1|SA[2]                      ; 1                 ; 6       ;
;      - Multi_Sdram:u3|Sdram_Controller:u1|command:command1|SA[4]                      ; 1                 ; 6       ;
;      - Multi_Sdram:u3|Sdram_Controller:u1|command:command1|SA[5]                      ; 1                 ; 6       ;
;      - Multi_Sdram:u3|Sdram_Controller:u1|command:command1|SA[10]                     ; 1                 ; 6       ;
;      - Multi_Sdram:u3|Sdram_Controller:u1|Write                                       ; 1                 ; 6       ;
;      - Multi_Sdram:u3|Sdram_Controller:u1|Read                                        ; 1                 ; 6       ;
;      - Multi_Sdram:u3|Sdram_Controller:u1|command:command1|WE_N                       ; 1                 ; 6       ;
;      - Multi_Sdram:u3|Sdram_Controller:u1|command:command1|CAS_N                      ; 1                 ; 6       ;
;      - Multi_Sdram:u3|Sdram_Controller:u1|command:command1|RAS_N                      ; 1                 ; 6       ;
;      - CMD_Decode:u5|oFL_Select[0]                                                    ; 1                 ; 6       ;
;      - CMD_Decode:u5|oFL_Select[1]                                                    ; 1                 ; 6       ;
;      - Multi_Flash:u2|Flash_Multiplexer:u0|mFL_Start                                  ; 1                 ; 6       ;
;      - CMD_Decode:u5|oFL_Start                                                        ; 1                 ; 6       ;
;      - Multi_Flash:u2|Flash_Controller:u1|preStart                                    ; 1                 ; 6       ;
;      - Multi_Flash:u2|Flash_Controller:u1|r_CMD[2]~1009                               ; 1                 ; 6       ;
;      - Multi_Flash:u2|Flash_Controller:u1|mStart                                      ; 1                 ; 6       ;
;      - Multi_Flash:u2|Flash_Controller:u1|mACT                                        ; 1                 ; 6       ;
;      - Multi_Flash:u2|Flash_Controller:u1|WE_CLK_Delay[3]                             ; 1                 ; 6       ;
;      - CMD_Decode:u5|f_SRAM                                                           ; 1                 ; 6       ;
;      - CMD_Decode:u5|CMD_Tmp[55]                                                      ; 1                 ; 6       ;
;      - CMD_Decode:u5|CMD_Tmp[51]                                                      ; 1                 ; 6       ;
;      - CMD_Decode:u5|CMD_Tmp[53]                                                      ; 1                 ; 6       ;
;      - CMD_Decode:u5|CMD_Tmp[50]                                                      ; 1                 ; 6       ;
;      - CMD_Decode:u5|CMD_Tmp[54]                                                      ; 1                 ; 6       ;
;      - CMD_Decode:u5|CMD_Tmp[49]                                                      ; 1                 ; 6       ;
;      - CMD_Decode:u5|CMD_Tmp[48]                                                      ; 1                 ; 6       ;
;      - CMD_Decode:u5|CMD_Tmp[52]                                                      ; 1                 ; 6       ;
;      - CMD_Decode:u5|mSR_ST.000                                                       ; 1                 ; 6       ;
;      - CMD_Decode:u5|oSR_ADDR[0]~1205                                                 ; 1                 ; 6       ;
;      - CMD_Decode:u5|f_SR_SEL                                                         ; 1                 ; 6       ;
;      - CMD_Decode:u5|CMD_Tmp[41]                                                      ; 1                 ; 6       ;
;      - CMD_Decode:u5|CMD_Tmp[44]                                                      ; 1                 ; 6       ;
;      - CMD_Decode:u5|CMD_Tmp[45]                                                      ; 1                 ; 6       ;
;      - CMD_Decode:u5|CMD_Tmp[47]                                                      ; 1                 ; 6       ;
;      - CMD_Decode:u5|CMD_Tmp[46]                                                      ; 1                 ; 6       ;
;      - CMD_Decode:u5|CMD_Tmp[43]                                                      ; 1                 ; 6       ;
;      - CMD_Decode:u5|CMD_Tmp[42]                                                      ; 1                 ; 6       ;
;      - CMD_Decode:u5|CMD_Tmp[37]                                                      ; 1                 ; 6       ;
;      - CMD_Decode:u5|CMD_Tmp[40]                                                      ; 1                 ; 6       ;
;      - CMD_Decode:u5|CMD_Tmp[39]                                                      ; 1                 ; 6       ;
;      - CMD_Decode:u5|CMD_Tmp[38]                                                      ; 1                 ; 6       ;
;      - CMD_Decode:u5|CMD_Tmp[36]                                                      ; 1                 ; 6       ;
;      - CMD_Decode:u5|CMD_Tmp[34]                                                      ; 1                 ; 6       ;
;      - CMD_Decode:u5|CMD_Tmp[35]                                                      ; 1                 ; 6       ;
;      - CMD_Decode:u5|mSR_ST.100                                                       ; 1                 ; 6       ;
;      - CMD_Decode:u5|mSR_ST.101                                                       ; 1                 ; 6       ;
;      - USB_JTAG:u1|oTxD_Done                                                          ; 1                 ; 6       ;
;      - CMD_Decode:u5|mSR_ST.011                                                       ; 1                 ; 6       ;
;      - CMD_Decode:u5|mSR_ST.010                                                       ; 1                 ; 6       ;
;      - CMD_Decode:u5|mSR_ST.001                                                       ; 1                 ; 6       ;
;      - CMD_Decode:u5|oFL_TXD_Start                                                    ; 1                 ; 6       ;
;      - CMD_Decode:u5|oSDR_TXD_Start                                                   ; 1                 ; 6       ;
;      - CMD_Decode:u5|oSR_TXD_Start                                                    ; 1                 ; 6       ;
;      - CMD_Decode:u5|oPS2_TXD_Start                                                   ; 1                 ; 6       ;
;      - CMD_Decode:u5|sel_SR                                                           ; 1                 ; 6       ;
;      - CMD_Decode:u5|sel_SDR                                                          ; 1                 ; 6       ;
;      - CMD_Decode:u5|sel_FL                                                           ; 1                 ; 6       ;
;      - I2C_AV_Config:u10|mI2C_GO                                                      ; 1                 ; 6       ;
;      - I2C_AV_Config:u10|mI2C_CLK_DIV[12]                                             ; 1                 ; 6       ;
;      - I2C_AV_Config:u10|mI2C_CLK_DIV[13]                                             ; 1                 ; 6       ;
;      - I2C_AV_Config:u10|mI2C_CLK_DIV[14]                                             ; 1                 ; 6       ;
;      - I2C_AV_Config:u10|mI2C_CLK_DIV[15]                                             ; 1                 ; 6       ;
;      - I2C_AV_Config:u10|mI2C_CLK_DIV[2]                                              ; 1                 ; 6       ;
;      - I2C_AV_Config:u10|mI2C_CLK_DIV[3]                                              ; 1                 ; 6       ;
;      - I2C_AV_Config:u10|mI2C_CLK_DIV[4]                                              ; 1                 ; 6       ;
;      - I2C_AV_Config:u10|mI2C_CLK_DIV[5]                                              ; 1                 ; 6       ;
;      - I2C_AV_Config:u10|mI2C_CLK_DIV[6]                                              ; 1                 ; 6       ;
;      - I2C_AV_Config:u10|mI2C_CLK_DIV[7]                                              ; 1                 ; 6       ;
;      - I2C_AV_Config:u10|mI2C_CLK_DIV[8]                                              ; 1                 ; 6       ;
;      - I2C_AV_Config:u10|mI2C_CLK_DIV[9]                                              ; 1                 ; 6       ;
;      - I2C_AV_Config:u10|mI2C_CLK_DIV[10]                                             ; 1                 ; 6       ;
;      - I2C_AV_Config:u10|mI2C_CLK_DIV[11]                                             ; 1                 ; 6       ;
;      - VGA_OSD_RAM:u9|oRed[9]                                                         ; 1                 ; 6       ;
;      - CMD_Decode:u5|oOSD_CUR_EN[1]                                                   ; 1                 ; 6       ;
;      - CMD_Decode:u5|oCursor_R[6]                                                     ; 1                 ; 6       ;
;      - CMD_Decode:u5|oOSD_CUR_EN[0]                                                   ; 1                 ; 6       ;
;      - CMD_Decode:u5|oCursor_Y[5]                                                     ; 1                 ; 6       ;
;      - CMD_Decode:u5|oCursor_Y[4]                                                     ; 1                 ; 6       ;
;      - CMD_Decode:u5|oCursor_Y[3]                                                     ; 1                 ; 6       ;
;      - CMD_Decode:u5|oCursor_Y[2]                                                     ; 1                 ; 6       ;
;      - CMD_Decode:u5|oCursor_Y[1]                                                     ; 1                 ; 6       ;
;      - CMD_Decode:u5|oCursor_Y[0]                                                     ; 1                 ; 6       ;
;      - CMD_Decode:u5|oCursor_Y[9]                                                     ; 1                 ; 6       ;
;      - CMD_Decode:u5|oCursor_Y[8]                                                     ; 1                 ; 6       ;
;      - CMD_Decode:u5|oCursor_Y[7]                                                     ; 1                 ; 6       ;
;      - CMD_Decode:u5|oCursor_Y[6]                                                     ; 1                 ; 6       ;
;      - CMD_Decode:u5|oCursor_X[8]                                                     ; 1                 ; 6       ;
;      - CMD_Decode:u5|oCursor_X[7]                                                     ; 1                 ; 6       ;
;      - CMD_Decode:u5|oCursor_X[6]                                                     ; 1                 ; 6       ;
;      - CMD_Decode:u5|oCursor_X[5]                                                     ; 1                 ; 6       ;
;      - CMD_Decode:u5|oCursor_X[4]                                                     ; 1                 ; 6       ;
;      - CMD_Decode:u5|oCursor_X[3]                                                     ; 1                 ; 6       ;
;      - CMD_Decode:u5|oCursor_X[2]                                                     ; 1                 ; 6       ;
;      - CMD_Decode:u5|oCursor_X[0]                                                     ; 1                 ; 6       ;
;      - CMD_Decode:u5|oCursor_X[1]                                                     ; 1                 ; 6       ;
;      - CMD_Decode:u5|oCursor_X[9]                                                     ; 1                 ; 6       ;
;      - CMD_Decode:u5|oCursor_R[7]                                                     ; 1                 ; 6       ;
;      - CMD_Decode:u5|oCursor_R[8]                                                     ; 1                 ; 6       ;
;      - CMD_Decode:u5|oCursor_R[9]                                                     ; 1                 ; 6       ;
;      - CMD_Decode:u5|oCursor_G[6]                                                     ; 1                 ; 6       ;
;      - CMD_Decode:u5|oCursor_G[7]                                                     ; 1                 ; 6       ;
;      - CMD_Decode:u5|oCursor_G[8]                                                     ; 1                 ; 6       ;
;      - CMD_Decode:u5|oCursor_G[9]                                                     ; 1                 ; 6       ;
;      - CMD_Decode:u5|oCursor_B[6]                                                     ; 1                 ; 6       ;
;      - CMD_Decode:u5|oCursor_B[7]                                                     ; 1                 ; 6       ;
;      - CMD_Decode:u5|oCursor_B[8]                                                     ; 1                 ; 6       ;
;      - CMD_Decode:u5|oCursor_B[9]                                                     ; 1                 ; 6       ;
;      - VGA_OSD_RAM:u9|oBlue[9]                                                        ; 1                 ; 6       ;
;      - USB_JTAG:u1|oRxD_Ready                                                         ; 1                 ; 6       ;
;      - Multi_Sdram:u3|Sdram_Controller:u1|control_interface:control1|SADDR[0]         ; 1                 ; 6       ;
;      - Multi_Sdram:u3|Sdram_Controller:u1|control_interface:control1|SADDR[8]         ; 1                 ; 6       ;
;      - Multi_Sdram:u3|Sdram_Controller:u1|command:command1|do_reada                   ; 1                 ; 6       ;
;      - Multi_Sdram:u3|Sdram_Controller:u1|command:command1|do_writea                  ; 1                 ; 6       ;
;      - Multi_Sdram:u3|Sdram_Controller:u1|command:command1|do_load_mode               ; 1                 ; 6       ;
;      - Multi_Sdram:u3|Sdram_Controller:u1|command:command1|SA~784                     ; 1                 ; 6       ;
;      - Multi_Sdram:u3|Sdram_Controller:u1|Pre_RD                                      ; 1                 ; 6       ;
;      - Multi_Sdram:u3|Sdram_Multiplexer:u0|mSDR_RD                                    ; 1                 ; 6       ;
;      - CMD_Decode:u5|oSDR_Select[1]                                                   ; 1                 ; 6       ;
;      - CMD_Decode:u5|oSDR_Select[0]                                                   ; 1                 ; 6       ;
;      - CMD_Decode:u5|mSDR_Start                                                       ; 1                 ; 6       ;
;      - Multi_Sdram:u3|Sdram_Controller:u1|Pre_WR                                      ; 1                 ; 6       ;
;      - Multi_Sdram:u3|Sdram_Controller:u1|control_interface:control1|CMD_ACK          ; 1                 ; 6       ;
;      - Multi_Sdram:u3|Sdram_Controller:u1|control_interface:control1|SADDR[1]         ; 1                 ; 6       ;
;      - Multi_Sdram:u3|Sdram_Controller:u1|control_interface:control1|SADDR[9]         ; 1                 ; 6       ;
;      - Multi_Sdram:u3|Sdram_Controller:u1|control_interface:control1|SADDR[2]         ; 1                 ; 6       ;
;      - Multi_Sdram:u3|Sdram_Controller:u1|control_interface:control1|SADDR[10]        ; 1                 ; 6       ;
;      - Multi_Sdram:u3|Sdram_Controller:u1|control_interface:control1|SADDR[11]        ; 1                 ; 6       ;
;      - Multi_Sdram:u3|Sdram_Controller:u1|control_interface:control1|SADDR[3]         ; 1                 ; 6       ;
;      - Multi_Sdram:u3|Sdram_Controller:u1|control_interface:control1|SADDR[4]         ; 1                 ; 6       ;
;      - Multi_Sdram:u3|Sdram_Controller:u1|control_interface:control1|SADDR[12]        ; 1                 ; 6       ;
;      - Multi_Sdram:u3|Sdram_Controller:u1|control_interface:control1|SADDR[5]         ; 1                 ; 6       ;
;      - Multi_Sdram:u3|Sdram_Controller:u1|control_interface:control1|SADDR[13]        ; 1                 ; 6       ;
;      - Multi_Sdram:u3|Sdram_Controller:u1|control_interface:control1|SADDR[14]        ; 1                 ; 6       ;
;      - Multi_Sdram:u3|Sdram_Controller:u1|control_interface:control1|SADDR[6]         ; 1                 ; 6       ;
;      - Multi_Sdram:u3|Sdram_Controller:u1|control_interface:control1|SADDR[15]        ; 1                 ; 6       ;
;      - Multi_Sdram:u3|Sdram_Controller:u1|control_interface:control1|SADDR[7]         ; 1                 ; 6       ;
;      - Multi_Sdram:u3|Sdram_Controller:u1|control_interface:control1|SADDR[16]        ; 1                 ; 6       ;
;      - Multi_Sdram:u3|Sdram_Controller:u1|control_interface:control1|SADDR[17]        ; 1                 ; 6       ;
;      - Multi_Sdram:u3|Sdram_Controller:u1|command:command1|do_precharge               ; 1                 ; 6       ;
;      - Multi_Sdram:u3|Sdram_Controller:u1|control_interface:control1|SADDR[18]        ; 1                 ; 6       ;
;      - Multi_Sdram:u3|Sdram_Controller:u1|command:command1|do_rw                      ; 1                 ; 6       ;
;      - Multi_Sdram:u3|Sdram_Controller:u1|control_interface:control1|SADDR[19]        ; 1                 ; 6       ;
;      - Multi_Sdram:u3|Sdram_Controller:u1|command:command1|do_refresh                 ; 1                 ; 6       ;
;      - Multi_Sdram:u3|Sdram_Controller:u1|command:command1|rw_flag                    ; 1                 ; 6       ;
;      - Multi_Sdram:u3|Sdram_Controller:u1|command:command1|oe4                        ; 1                 ; 6       ;
;      - Multi_Sdram:u3|Sdram_Controller:u1|control_interface:control1|SADDR[20]        ; 1                 ; 6       ;
;      - Multi_Sdram:u3|Sdram_Controller:u1|command:command1|BA~43                      ; 1                 ; 6       ;
;      - Multi_Sdram:u3|Sdram_Controller:u1|control_interface:control1|SADDR[21]        ; 1                 ; 6       ;
;      - Multi_Sdram:u3|Sdram_Controller:u1|command:command1|BA~44                      ; 1                 ; 6       ;
;      - CMD_Decode:u5|f_FLASH                                                          ; 1                 ; 6       ;
;      - CMD_Decode:u5|mFL_ST.000                                                       ; 1                 ; 6       ;
;      - CMD_Decode:u5|oFL_ADDR[0]~1192                                                 ; 1                 ; 6       ;
;      - CMD_Decode:u5|f_FL_SEL                                                         ; 1                 ; 6       ;
;      - Multi_Flash:u2|Flash_Multiplexer:u0|ST.10                                      ; 1                 ; 6       ;
;      - Multi_Flash:u2|Flash_Multiplexer:u0|ST.11                                      ; 1                 ; 6       ;
;      - Multi_Flash:u2|Flash_Multiplexer:u0|ST.01                                      ; 1                 ; 6       ;
;      - Multi_Flash:u2|Flash_Controller:u1|mFinish                                     ; 1                 ; 6       ;
;      - CMD_Decode:u5|mFL_ST.101                                                       ; 1                 ; 6       ;
;      - CMD_Decode:u5|mFL_ST.011                                                       ; 1                 ; 6       ;
;      - CMD_Decode:u5|mFL_ST.001                                                       ; 1                 ; 6       ;
;      - CMD_Decode:u5|mFL_ST.110                                                       ; 1                 ; 6       ;
;      - CMD_Decode:u5|mFL_ST.111                                                       ; 1                 ; 6       ;
;      - Multi_Flash:u2|Flash_Controller:u1|Start_Delay[3]                              ; 1                 ; 6       ;
;      - Multi_Flash:u2|Flash_Controller:u1|Start_Delay[4]                              ; 1                 ; 6       ;
;      - Multi_Flash:u2|Flash_Controller:u1|Start_Delay[5]                              ; 1                 ; 6       ;
;      - Multi_Flash:u2|Flash_Controller:u1|Start_Delay[6]                              ; 1                 ; 6       ;
;      - Multi_Flash:u2|Flash_Controller:u1|Start_Delay[7]                              ; 1                 ; 6       ;
;      - Multi_Flash:u2|Flash_Controller:u1|Start_Delay[8]                              ; 1                 ; 6       ;
;      - Multi_Flash:u2|Flash_Controller:u1|Start_Delay[9]                              ; 1                 ; 6       ;
;      - Multi_Flash:u2|Flash_Controller:u1|Start_Delay[10]                             ; 1                 ; 6       ;
;      - Multi_Flash:u2|Flash_Controller:u1|mCLK                                        ; 1                 ; 6       ;
;      - Multi_Flash:u2|Flash_Controller:u1|WE_CLK_Delay[1]                             ; 1                 ; 6       ;
;      - CMD_Decode:u5|oFL_CMD[2]                                                       ; 1                 ; 6       ;
;      - CMD_Decode:u5|oFL_CMD[0]                                                       ; 1                 ; 6       ;
;      - Multi_Flash:u2|Flash_Controller:u1|WE_CLK_Delay[2]                             ; 1                 ; 6       ;
;      - USB_JTAG:u1|Pre_TxD_Done                                                       ; 1                 ; 6       ;
;      - CMD_Decode:u5|mSDR_ST.000                                                      ; 1                 ; 6       ;
;      - CMD_Decode:u5|mSDR_ST.001                                                      ; 1                 ; 6       ;
;      - CMD_Decode:u5|mSDR_ST.101                                                      ; 1                 ; 6       ;
;      - CMD_Decode:u5|mSDR_ST.011                                                      ; 1                 ; 6       ;
;      - CMD_Decode:u5|f_SDRAM                                                          ; 1                 ; 6       ;
;      - CMD_Decode:u5|f_PS2                                                            ; 1                 ; 6       ;
;      - CMD_Decode:u5|mPS2_ST.001                                                      ; 1                 ; 6       ;
;      - CMD_Decode:u5|f_SETUP                                                          ; 1                 ; 6       ;
;      - Multi_Flash:u2|Flash_Controller:u1|oDATA[5]                                    ; 1                 ; 6       ;
;      - CMD_Decode:u5|oFL_TXD_DATA[7]~744                                              ; 1                 ; 6       ;
;      - Multi_Sdram:u3|Sdram_Controller:u1|DATAOUT[13]                                 ; 1                 ; 6       ;
;      - Multi_Sdram:u3|Sdram_Controller:u1|DATAOUT[5]                                  ; 1                 ; 6       ;
;      - CMD_Decode:u5|mSDR_ST.100                                                      ; 1                 ; 6       ;
;      - CMD_Decode:u5|mSDR_ST.010                                                      ; 1                 ; 6       ;
;      - CMD_Decode:u5|oSDR_TXD_DATA[7]~70                                              ; 1                 ; 6       ;
;      - CMD_Decode:u5|oSR_TXD_DATA[7]~70                                               ; 1                 ; 6       ;
;      - ps2_keyboard:u4|rx_ascii[5]                                                    ; 1                 ; 6       ;
;      - ps2_keyboard:u4|m2_state                                                       ; 1                 ; 6       ;
;      - ps2_keyboard:u4|rx_ascii[6]                                                    ; 1                 ; 6       ;
;      - ps2_keyboard:u4|rx_ascii[4]                                                    ; 1                 ; 6       ;
;      - ps2_keyboard:u4|rx_ascii[2]                                                    ; 1                 ; 6       ;
;      - ps2_keyboard:u4|rx_ascii[0]                                                    ; 1                 ; 6       ;
;      - ps2_keyboard:u4|rx_ascii[1]                                                    ; 1                 ; 6       ;
;      - ps2_keyboard:u4|rx_ascii[3]                                                    ; 1                 ; 6       ;
;      - CMD_Decode:u5|oPS2_TXD_DATA[6]~737                                             ; 1                 ; 6       ;
;      - Multi_Sdram:u3|Sdram_Controller:u1|DATAOUT[14]                                 ; 1                 ; 6       ;
;      - Multi_Sdram:u3|Sdram_Controller:u1|DATAOUT[6]                                  ; 1                 ; 6       ;
;      - Multi_Sdram:u3|Sdram_Controller:u1|DATAOUT[12]                                 ; 1                 ; 6       ;
;      - Multi_Sdram:u3|Sdram_Controller:u1|DATAOUT[4]                                  ; 1                 ; 6       ;
;      - Multi_Flash:u2|Flash_Controller:u1|oDATA[6]                                    ; 1                 ; 6       ;
;      - Multi_Flash:u2|Flash_Controller:u1|oDATA[4]                                    ; 1                 ; 6       ;
;      - Multi_Flash:u2|Flash_Controller:u1|oDATA[7]                                    ; 1                 ; 6       ;
;      - Multi_Sdram:u3|Sdram_Controller:u1|DATAOUT[15]                                 ; 1                 ; 6       ;
;      - Multi_Sdram:u3|Sdram_Controller:u1|DATAOUT[7]                                  ; 1                 ; 6       ;
;      - Multi_Flash:u2|Flash_Controller:u1|oDATA[2]                                    ; 1                 ; 6       ;
;      - Multi_Sdram:u3|Sdram_Controller:u1|DATAOUT[10]                                 ; 1                 ; 6       ;
;      - Multi_Sdram:u3|Sdram_Controller:u1|DATAOUT[2]                                  ; 1                 ; 6       ;
;      - Multi_Flash:u2|Flash_Controller:u1|oDATA[1]                                    ; 1                 ; 6       ;
;      - Multi_Sdram:u3|Sdram_Controller:u1|DATAOUT[9]                                  ; 1                 ; 6       ;
;      - Multi_Sdram:u3|Sdram_Controller:u1|DATAOUT[1]                                  ; 1                 ; 6       ;
;      - Multi_Flash:u2|Flash_Controller:u1|oDATA[0]                                    ; 1                 ; 6       ;
;      - Multi_Sdram:u3|Sdram_Controller:u1|DATAOUT[8]                                  ; 1                 ; 6       ;
;      - Multi_Sdram:u3|Sdram_Controller:u1|DATAOUT[0]                                  ; 1                 ; 6       ;
;      - Multi_Flash:u2|Flash_Controller:u1|oDATA[3]                                    ; 1                 ; 6       ;
;      - Multi_Sdram:u3|Sdram_Controller:u1|DATAOUT[11]                                 ; 1                 ; 6       ;
;      - Multi_Sdram:u3|Sdram_Controller:u1|DATAOUT[3]                                  ; 1                 ; 6       ;
;      - I2C_AV_Config:u10|I2C_Controller:u0|END                                        ; 1                 ; 6       ;
;      - I2C_AV_Config:u10|mSetup_ST.10                                                 ; 1                 ; 6       ;
;      - I2C_AV_Config:u10|mSetup_ST.01                                                 ; 1                 ; 6       ;
;      - I2C_AV_Config:u10|LUT_INDEX[1]                                                 ; 1                 ; 6       ;
;      - I2C_AV_Config:u10|LUT_INDEX[0]                                                 ; 1                 ; 6       ;
;      - I2C_AV_Config:u10|LUT_INDEX[2]                                                 ; 1                 ; 6       ;
;      - I2C_AV_Config:u10|LUT_INDEX[3]                                                 ; 1                 ; 6       ;
;      - I2C_AV_Config:u10|mI2C_CLK_DIV[1]                                              ; 1                 ; 6       ;
;      - I2C_AV_Config:u10|mI2C_CLK_DIV[0]                                              ; 1                 ; 6       ;
;      - VGA_OSD_RAM:u9|ADDR_dd[0]                                                      ; 1                 ; 6       ;
;      - VGA_OSD_RAM:u9|ADDR_dd[1]                                                      ; 1                 ; 6       ;
;      - VGA_OSD_RAM:u9|ADDR_dd[2]                                                      ; 1                 ; 6       ;
;      - CMD_Decode:u5|f_VGA                                                            ; 1                 ; 6       ;
;      - Multi_Flash:u2|Flash_Multiplexer:u0|mFL_DATA[1]                                ; 1                 ; 6       ;
;      - Multi_Flash:u2|Flash_Multiplexer:u0|mFL_DATA[5]                                ; 1                 ; 6       ;
;      - Multi_Flash:u2|Flash_Multiplexer:u0|mFL_DATA[2]                                ; 1                 ; 6       ;
;      - Multi_Flash:u2|Flash_Multiplexer:u0|mFL_DATA[6]                                ; 1                 ; 6       ;
;      - Multi_Flash:u2|Flash_Multiplexer:u0|mFL_DATA[3]                                ; 1                 ; 6       ;
;      - Multi_Flash:u2|Flash_Multiplexer:u0|mFL_DATA[7]                                ; 1                 ; 6       ;
;      - Multi_Flash:u2|Flash_Multiplexer:u0|mFL_DATA[4]                                ; 1                 ; 6       ;
;      - Multi_Flash:u2|Flash_Multiplexer:u0|mFL_DATA[0]                                ; 1                 ; 6       ;
;      - Multi_Sdram:u3|Sdram_Controller:u1|sdr_data_path:data_path1|DIN2[0]            ; 1                 ; 6       ;
;      - Multi_Sdram:u3|Sdram_Controller:u1|command:command1|OE                         ; 1                 ; 6       ;
;      - Multi_Sdram:u3|Sdram_Controller:u1|sdr_data_path:data_path1|DIN2[1]            ; 1                 ; 6       ;
;      - Multi_Sdram:u3|Sdram_Controller:u1|sdr_data_path:data_path1|DIN2[2]            ; 1                 ; 6       ;
;      - Multi_Sdram:u3|Sdram_Controller:u1|sdr_data_path:data_path1|DIN2[3]            ; 1                 ; 6       ;
;      - Multi_Sdram:u3|Sdram_Controller:u1|sdr_data_path:data_path1|DIN2[4]            ; 1                 ; 6       ;
;      - Multi_Sdram:u3|Sdram_Controller:u1|sdr_data_path:data_path1|DIN2[5]            ; 1                 ; 6       ;
;      - Multi_Sdram:u3|Sdram_Controller:u1|sdr_data_path:data_path1|DIN2[6]            ; 1                 ; 6       ;
;      - Multi_Sdram:u3|Sdram_Controller:u1|sdr_data_path:data_path1|DIN2[7]            ; 1                 ; 6       ;
;      - Multi_Sdram:u3|Sdram_Controller:u1|sdr_data_path:data_path1|DIN2[8]            ; 1                 ; 6       ;
;      - Multi_Sdram:u3|Sdram_Controller:u1|sdr_data_path:data_path1|DIN2[9]            ; 1                 ; 6       ;
;      - Multi_Sdram:u3|Sdram_Controller:u1|sdr_data_path:data_path1|DIN2[10]           ; 1                 ; 6       ;
;      - Multi_Sdram:u3|Sdram_Controller:u1|sdr_data_path:data_path1|DIN2[11]           ; 1                 ; 6       ;
;      - Multi_Sdram:u3|Sdram_Controller:u1|sdr_data_path:data_path1|DIN2[12]           ; 1                 ; 6       ;
;      - Multi_Sdram:u3|Sdram_Controller:u1|sdr_data_path:data_path1|DIN2[13]           ; 1                 ; 6       ;
;      - Multi_Sdram:u3|Sdram_Controller:u1|sdr_data_path:data_path1|DIN2[14]           ; 1                 ; 6       ;
;      - Multi_Sdram:u3|Sdram_Controller:u1|sdr_data_path:data_path1|DIN2[15]           ; 1                 ; 6       ;
;      - I2C_AV_Config:u10|I2C_Controller:u0|SDO                                        ; 1                 ; 6       ;
;      - USB_JTAG:u1|Pre_RxD_Ready                                                      ; 1                 ; 6       ;
;      - USB_JTAG:u1|oRxD_DATA[7]~797                                                   ; 1                 ; 6       ;
;      - Multi_Sdram:u3|Sdram_Controller:u1|control_interface:control1|READA            ; 1                 ; 6       ;
;      - Multi_Sdram:u3|Sdram_Controller:u1|command:command1|command_done               ; 1                 ; 6       ;
;      - Multi_Sdram:u3|Sdram_Controller:u1|command:command1|rp_done                    ; 1                 ; 6       ;
;      - Multi_Sdram:u3|Sdram_Controller:u1|control_interface:control1|REF_REQ          ; 1                 ; 6       ;
;      - Multi_Sdram:u3|Sdram_Controller:u1|control_interface:control1|INIT_REQ         ; 1                 ; 6       ;
;      - Multi_Sdram:u3|Sdram_Controller:u1|control_interface:control1|WRITEA           ; 1                 ; 6       ;
;      - Multi_Sdram:u3|Sdram_Controller:u1|control_interface:control1|LOAD_MODE        ; 1                 ; 6       ;
;      - Multi_Sdram:u3|Sdram_Multiplexer:u0|ST.10                                      ; 1                 ; 6       ;
;      - Multi_Sdram:u3|Sdram_Multiplexer:u0|ST.11                                      ; 1                 ; 6       ;
;      - Multi_Sdram:u3|Sdram_Controller:u1|DONE                                        ; 1                 ; 6       ;
;      - Multi_Sdram:u3|Sdram_Multiplexer:u0|ST.01                                      ; 1                 ; 6       ;
;      - CMD_Decode:u5|f_SDR_SEL                                                        ; 1                 ; 6       ;
;      - Multi_Sdram:u3|Sdram_Controller:u1|command:command1|CM_ACK                     ; 1                 ; 6       ;
;      - Multi_Sdram:u3|Sdram_Controller:u1|control_interface:control1|PRECHARGE        ; 1                 ; 6       ;
;      - Multi_Sdram:u3|Sdram_Controller:u1|command:command1|rw_shift[0]                ; 1                 ; 6       ;
;      - Multi_Sdram:u3|Sdram_Controller:u1|control_interface:control1|REFRESH          ; 1                 ; 6       ;
;      - Multi_Sdram:u3|Sdram_Controller:u1|command:command1|do_initial                 ; 1                 ; 6       ;
;      - Multi_Flash:u2|Flash_Multiplexer:u0|ST.00                                      ; 1                 ; 6       ;
;      - Multi_Flash:u2|Flash_Controller:u1|Cont_Finish[19]                             ; 1                 ; 6       ;
;      - Multi_Flash:u2|Flash_Controller:u1|Cont_Finish[10]                             ; 1                 ; 6       ;
;      - Multi_Flash:u2|Flash_Controller:u1|Cont_Finish[11]                             ; 1                 ; 6       ;
;      - Multi_Flash:u2|Flash_Controller:u1|Cont_Finish[12]                             ; 1                 ; 6       ;
;      - Multi_Flash:u2|Flash_Controller:u1|Cont_Finish[13]                             ; 1                 ; 6       ;
;      - Multi_Flash:u2|Flash_Controller:u1|Cont_Finish[1]                              ; 1                 ; 6       ;
;      - Multi_Flash:u2|Flash_Controller:u1|Cont_Finish[0]                              ; 1                 ; 6       ;
;      - Multi_Flash:u2|Flash_Controller:u1|Cont_Finish[2]                              ; 1                 ; 6       ;
;      - Multi_Flash:u2|Flash_Controller:u1|Cont_Finish[16]                             ; 1                 ; 6       ;
;      - Multi_Flash:u2|Flash_Controller:u1|Cont_Finish[15]                             ; 1                 ; 6       ;
;      - Multi_Flash:u2|Flash_Controller:u1|Cont_Finish[14]                             ; 1                 ; 6       ;
;      - Multi_Flash:u2|Flash_Controller:u1|Cont_Finish[9]                              ; 1                 ; 6       ;
;      - Multi_Flash:u2|Flash_Controller:u1|Cont_Finish[8]                              ; 1                 ; 6       ;
;      - Multi_Flash:u2|Flash_Controller:u1|Cont_Finish[7]                              ; 1                 ; 6       ;
;      - Multi_Flash:u2|Flash_Controller:u1|Cont_Finish[6]                              ; 1                 ; 6       ;
;      - Multi_Flash:u2|Flash_Controller:u1|Cont_Finish[5]                              ; 1                 ; 6       ;
;      - Multi_Flash:u2|Flash_Controller:u1|Cont_Finish[4]                              ; 1                 ; 6       ;
;      - Multi_Flash:u2|Flash_Controller:u1|Cont_Finish[3]                              ; 1                 ; 6       ;
;      - Multi_Flash:u2|Flash_Controller:u1|Cont_Finish[17]                             ; 1                 ; 6       ;
;      - Multi_Flash:u2|Flash_Controller:u1|Cont_Finish[18]                             ; 1                 ; 6       ;
;      - Multi_Flash:u2|Flash_Controller:u1|Cont_Finish[20]                             ; 1                 ; 6       ;
;      - Multi_Flash:u2|Flash_Controller:u1|Cont_Finish[21]                             ; 1                 ; 6       ;
;      - CMD_Decode:u5|mFL_ST.100                                                       ; 1                 ; 6       ;
;      - CMD_Decode:u5|mFL_ST.010                                                       ; 1                 ; 6       ;
;      - Multi_Flash:u2|Flash_Controller:u1|Start_Delay[2]                              ; 1                 ; 6       ;
;      - Multi_Flash:u2|Flash_Controller:u1|Start_Delay[1]                              ; 1                 ; 6       ;
;      - Multi_Flash:u2|Flash_Controller:u1|Start_Delay[0]                              ; 1                 ; 6       ;
;      - Multi_Flash:u2|Flash_Controller:u1|Cont_DIV[2]                                 ; 1                 ; 6       ;
;      - ps2_keyboard:u4|left_shift_key                                                 ; 1                 ; 6       ;
;      - ps2_keyboard:u4|right_shift_key                                                ; 1                 ; 6       ;
;      - ps2_keyboard:u4|rx_ascii[3]~822                                                ; 1                 ; 6       ;
;      - I2C_AV_Config:u10|I2C_Controller:u0|ACK3                                       ; 1                 ; 6       ;
;      - I2C_AV_Config:u10|I2C_Controller:u0|ACK1                                       ; 1                 ; 6       ;
;      - I2C_AV_Config:u10|I2C_Controller:u0|ACK2                                       ; 1                 ; 6       ;
;      - I2C_AV_Config:u10|mSetup_ST.00                                                 ; 1                 ; 6       ;
;      - VGA_OSD_RAM:u9|ADDR_d[0]                                                       ; 1                 ; 6       ;
;      - VGA_OSD_RAM:u9|ADDR_d[1]                                                       ; 1                 ; 6       ;
;      - VGA_OSD_RAM:u9|ADDR_d[2]                                                       ; 1                 ; 6       ;
;      - Multi_Sdram:u3|Sdram_Controller:u1|sdr_data_path:data_path1|DIN1[0]            ; 1                 ; 6       ;
;      - Multi_Sdram:u3|Sdram_Controller:u1|sdr_data_path:data_path1|DIN1[1]            ; 1                 ; 6       ;
;      - Multi_Sdram:u3|Sdram_Controller:u1|sdr_data_path:data_path1|DIN1[2]            ; 1                 ; 6       ;
;      - Multi_Sdram:u3|Sdram_Controller:u1|sdr_data_path:data_path1|DIN1[3]            ; 1                 ; 6       ;
;      - Multi_Sdram:u3|Sdram_Controller:u1|sdr_data_path:data_path1|DIN1[4]            ; 1                 ; 6       ;
;      - Multi_Sdram:u3|Sdram_Controller:u1|sdr_data_path:data_path1|DIN1[5]            ; 1                 ; 6       ;
;      - Multi_Sdram:u3|Sdram_Controller:u1|sdr_data_path:data_path1|DIN1[6]            ; 1                 ; 6       ;
;      - Multi_Sdram:u3|Sdram_Controller:u1|sdr_data_path:data_path1|DIN1[7]            ; 1                 ; 6       ;
;      - Multi_Sdram:u3|Sdram_Controller:u1|sdr_data_path:data_path1|DIN1[8]            ; 1                 ; 6       ;
;      - Multi_Sdram:u3|Sdram_Controller:u1|sdr_data_path:data_path1|DIN1[9]            ; 1                 ; 6       ;
;      - Multi_Sdram:u3|Sdram_Controller:u1|sdr_data_path:data_path1|DIN1[10]           ; 1                 ; 6       ;
;      - Multi_Sdram:u3|Sdram_Controller:u1|sdr_data_path:data_path1|DIN1[11]           ; 1                 ; 6       ;
;      - Multi_Sdram:u3|Sdram_Controller:u1|sdr_data_path:data_path1|DIN1[12]           ; 1                 ; 6       ;
;      - Multi_Sdram:u3|Sdram_Controller:u1|sdr_data_path:data_path1|DIN1[13]           ; 1                 ; 6       ;
;      - Multi_Sdram:u3|Sdram_Controller:u1|sdr_data_path:data_path1|DIN1[14]           ; 1                 ; 6       ;
;      - Multi_Sdram:u3|Sdram_Controller:u1|sdr_data_path:data_path1|DIN1[15]           ; 1                 ; 6       ;
;      - CMD_Decode:u5|oSDR_ADDR[0]~1289                                                ; 1                 ; 6       ;
;      - Multi_Sdram:u3|Sdram_Controller:u1|CMD[0]                                      ; 1                 ; 6       ;
;      - Multi_Sdram:u3|Sdram_Controller:u1|CMD[1]                                      ; 1                 ; 6       ;
;      - Multi_Sdram:u3|Sdram_Controller:u1|command:command1|command_delay[0]           ; 1                 ; 6       ;
;      - Multi_Sdram:u3|Sdram_Controller:u1|command:command1|rp_shift[0]                ; 1                 ; 6       ;
;      - Multi_Sdram:u3|Sdram_Controller:u1|command:command1|ex_read                    ; 1                 ; 6       ;
;      - Multi_Sdram:u3|Sdram_Controller:u1|command:command1|ex_write                   ; 1                 ; 6       ;
;      - Multi_Sdram:u3|Sdram_Controller:u1|control_interface:control1|timer[0]         ; 1                 ; 6       ;
;      - Multi_Sdram:u3|Sdram_Controller:u1|control_interface:control1|timer[1]         ; 1                 ; 6       ;
;      - Multi_Sdram:u3|Sdram_Controller:u1|control_interface:control1|timer[2]         ; 1                 ; 6       ;
;      - Multi_Sdram:u3|Sdram_Controller:u1|control_interface:control1|timer[3]         ; 1                 ; 6       ;
;      - Multi_Sdram:u3|Sdram_Controller:u1|control_interface:control1|timer[4]         ; 1                 ; 6       ;
;      - Multi_Sdram:u3|Sdram_Controller:u1|control_interface:control1|timer[5]         ; 1                 ; 6       ;
;      - Multi_Sdram:u3|Sdram_Controller:u1|control_interface:control1|timer[6]         ; 1                 ; 6       ;
;      - Multi_Sdram:u3|Sdram_Controller:u1|control_interface:control1|timer[7]         ; 1                 ; 6       ;
;      - Multi_Sdram:u3|Sdram_Controller:u1|control_interface:control1|timer[8]         ; 1                 ; 6       ;
;      - Multi_Sdram:u3|Sdram_Controller:u1|control_interface:control1|timer[9]         ; 1                 ; 6       ;
;      - Multi_Sdram:u3|Sdram_Controller:u1|control_interface:control1|timer[10]        ; 1                 ; 6       ;
;      - Multi_Sdram:u3|Sdram_Controller:u1|control_interface:control1|timer[11]        ; 1                 ; 6       ;
;      - Multi_Sdram:u3|Sdram_Controller:u1|control_interface:control1|timer[12]        ; 1                 ; 6       ;
;      - Multi_Sdram:u3|Sdram_Controller:u1|control_interface:control1|timer[13]        ; 1                 ; 6       ;
;      - Multi_Sdram:u3|Sdram_Controller:u1|control_interface:control1|timer[14]        ; 1                 ; 6       ;
;      - Multi_Sdram:u3|Sdram_Controller:u1|control_interface:control1|timer[15]        ; 1                 ; 6       ;
;      - Multi_Sdram:u3|Sdram_Controller:u1|command:command1|REF_ACK                    ; 1                 ; 6       ;
;      - Multi_Sdram:u3|Sdram_Controller:u1|control_interface:control1|init_timer[9]    ; 1                 ; 6       ;
;      - Multi_Sdram:u3|Sdram_Controller:u1|control_interface:control1|init_timer[6]    ; 1                 ; 6       ;
;      - Multi_Sdram:u3|Sdram_Controller:u1|control_interface:control1|init_timer[7]    ; 1                 ; 6       ;
;      - Multi_Sdram:u3|Sdram_Controller:u1|control_interface:control1|init_timer[8]    ; 1                 ; 6       ;
;      - Multi_Sdram:u3|Sdram_Controller:u1|control_interface:control1|init_timer[10]   ; 1                 ; 6       ;
;      - Multi_Sdram:u3|Sdram_Controller:u1|control_interface:control1|init_timer[11]   ; 1                 ; 6       ;
;      - Multi_Sdram:u3|Sdram_Controller:u1|control_interface:control1|init_timer[12]   ; 1                 ; 6       ;
;      - Multi_Sdram:u3|Sdram_Controller:u1|control_interface:control1|init_timer[13]   ; 1                 ; 6       ;
;      - Multi_Sdram:u3|Sdram_Controller:u1|control_interface:control1|init_timer[14]   ; 1                 ; 6       ;
;      - Multi_Sdram:u3|Sdram_Controller:u1|control_interface:control1|init_timer[15]   ; 1                 ; 6       ;
;      - Multi_Sdram:u3|Sdram_Controller:u1|control_interface:control1|init_timer[0]    ; 1                 ; 6       ;
;      - Multi_Sdram:u3|Sdram_Controller:u1|control_interface:control1|init_timer[1]    ; 1                 ; 6       ;
;      - Multi_Sdram:u3|Sdram_Controller:u1|control_interface:control1|init_timer[4]    ; 1                 ; 6       ;
;      - Multi_Sdram:u3|Sdram_Controller:u1|control_interface:control1|init_timer[5]    ; 1                 ; 6       ;
;      - Multi_Sdram:u3|Sdram_Controller:u1|control_interface:control1|init_timer[3]    ; 1                 ; 6       ;
;      - Multi_Sdram:u3|Sdram_Controller:u1|control_interface:control1|init_timer[2]    ; 1                 ; 6       ;
;      - Multi_Sdram:u3|Sdram_Controller:u1|mDONE                                       ; 1                 ; 6       ;
;      - Multi_Sdram:u3|Sdram_Controller:u1|Pre_DONE                                    ; 1                 ; 6       ;
;      - Multi_Sdram:u3|Sdram_Multiplexer:u0|ST.00                                      ; 1                 ; 6       ;
;      - Multi_Sdram:u3|Sdram_Controller:u1|command:command1|rw_shift[1]                ; 1                 ; 6       ;
;      - Multi_Flash:u2|Flash_Controller:u1|Cont_DIV[0]                                 ; 1                 ; 6       ;
;      - Multi_Flash:u2|Flash_Controller:u1|Cont_DIV[1]                                 ; 1                 ; 6       ;
;      - ps2_keyboard:u4|q~1246                                                         ; 1                 ; 6       ;
;      - ps2_keyboard:u4|q[7]~1247                                                      ; 1                 ; 6       ;
;      - ps2_keyboard:u4|q~1248                                                         ; 1                 ; 6       ;
;      - ps2_keyboard:u4|q~1249                                                         ; 1                 ; 6       ;
;      - ps2_keyboard:u4|q~1250                                                         ; 1                 ; 6       ;
;      - ps2_keyboard:u4|q~1251                                                         ; 1                 ; 6       ;
;      - ps2_keyboard:u4|q~1252                                                         ; 1                 ; 6       ;
;      - ps2_keyboard:u4|q~1253                                                         ; 1                 ; 6       ;
;      - ps2_keyboard:u4|q~1254                                                         ; 1                 ; 6       ;
;      - ps2_keyboard:u4|m1_state.m1_tx_wait_keyboard_ack                               ; 1                 ; 6       ;
;      - Multi_Sdram:u3|Sdram_Controller:u1|command:command1|command_delay[1]           ; 1                 ; 6       ;
;      - Multi_Sdram:u3|Sdram_Controller:u1|command:command1|rp_shift[1]                ; 1                 ; 6       ;
;      - ps2_keyboard:u4|m1_state.m1_tx_wait_clk_h                                      ; 1                 ; 6       ;
;      - ps2_keyboard:u4|m1_state~204                                                   ; 1                 ; 6       ;
;      - ps2_keyboard:u4|m1_state~205                                                   ; 1                 ; 6       ;
;      - ps2_keyboard:u4|q~1255                                                         ; 1                 ; 6       ;
;      - ps2_keyboard:u4|m1_state.m1_tx_error_no_keyboard_ack                           ; 1                 ; 6       ;
;      - ps2_keyboard:u4|m1_state.m1_tx_done_recovery                                   ; 1                 ; 6       ;
;      - ps2_keyboard:u4|m1_state~207                                                   ; 1                 ; 6       ;
;      - ps2_keyboard:u4|m1_state.m1_rx_clk_l                                           ; 1                 ; 6       ;
;      - ps2_keyboard:u4|m1_state.m1_tx_clk_h                                           ; 1                 ; 6       ;
;      - I2C_AV_Config:u10|mI2C_DATA[12]~962                                            ; 1                 ; 6       ;
;      - Multi_Sdram:u3|Sdram_Controller:u1|command:command1|command_delay[2]           ; 1                 ; 6       ;
;      - Multi_Sdram:u3|Sdram_Controller:u1|command:command1|rp_shift[2]                ; 1                 ; 6       ;
;      - ps2_keyboard:u4|m1_state.m1_tx_clk_l                                           ; 1                 ; 6       ;
;      - ps2_keyboard:u4|q~1256                                                         ; 1                 ; 6       ;
;      - ps2_keyboard:u4|m1_state~209                                                   ; 1                 ; 6       ;
;      - Multi_Sdram:u3|Sdram_Controller:u1|command:command1|command_delay[3]           ; 1                 ; 6       ;
;      - Multi_Sdram:u3|Sdram_Controller:u1|command:command1|rp_shift[3]                ; 1                 ; 6       ;
;      - Multi_Sdram:u3|Sdram_Controller:u1|command:command1|command_delay[4]           ; 1                 ; 6       ;
;      - Multi_Sdram:u3|Sdram_Controller:u1|command:command1|command_delay[5]           ; 1                 ; 6       ;
;      - Multi_Sdram:u3|Sdram_Controller:u1|command:command1|command_delay[6]           ; 1                 ; 6       ;
;      - Multi_Sdram:u3|Sdram_Controller:u1|command:command1|command_delay[7]           ; 1                 ; 6       ;
;      - I2C_AV_Config:u10|I2C_Controller:u0|SD[12]~846                                 ; 1                 ; 6       ;
;      - Multi_Sdram:u3|Sdram_Controller:u1|command:command1|CS_N[0]~6                  ; 1                 ; 6       ;
; TCS                                                                                   ;                   ;         ;
;      - TCS~clkctrl                                                                    ; 1                 ; 0       ;
; CLOCK_27[0]                                                                           ;                   ;         ;
; TCK                                                                                   ;                   ;         ;
;      - CLK_LOCK:p0|CLK_LOCK_altclkctrl_tb8:CLK_LOCK_altclkctrl_tb8_component|clkctrl1 ; 1                 ; 0       ;
; TDI                                                                                   ;                   ;         ;
;      - TDI~clkctrl                                                                    ; 1                 ; 0       ;
; PS2_CLK                                                                               ;                   ;         ;
;      - ps2_keyboard:u4|ps2_clk_s                                                      ; 0                 ; 6       ;
; PS2_DAT                                                                               ;                   ;         ;
;      - ps2_keyboard:u4|ps2_data_s                                                     ; 1                 ; 6       ;
; SD_DAT3                                                                               ;                   ;         ;
; SD_CMD                                                                                ;                   ;         ;
; DRAM_DQ[0]                                                                            ;                   ;         ;
;      - Multi_Sdram:u3|Sdram_Controller:u1|mDATAOUT[0]~feeder                          ; 0                 ; 6       ;
; DRAM_DQ[1]                                                                            ;                   ;         ;
;      - Multi_Sdram:u3|Sdram_Controller:u1|mDATAOUT[1]~feeder                          ; 1                 ; 6       ;
; DRAM_DQ[2]                                                                            ;                   ;         ;
;      - Multi_Sdram:u3|Sdram_Controller:u1|mDATAOUT[2]~feeder                          ; 0                 ; 6       ;
; DRAM_DQ[3]                                                                            ;                   ;         ;
;      - Multi_Sdram:u3|Sdram_Controller:u1|mDATAOUT[3]~feeder                          ; 1                 ; 6       ;
; DRAM_DQ[4]                                                                            ;                   ;         ;
;      - Multi_Sdram:u3|Sdram_Controller:u1|mDATAOUT[4]~feeder                          ; 0                 ; 6       ;
; DRAM_DQ[5]                                                                            ;                   ;         ;
;      - Multi_Sdram:u3|Sdram_Controller:u1|mDATAOUT[5]~feeder                          ; 0                 ; 6       ;
; DRAM_DQ[6]                                                                            ;                   ;         ;
;      - Multi_Sdram:u3|Sdram_Controller:u1|mDATAOUT[6]~feeder                          ; 1                 ; 6       ;
; DRAM_DQ[7]                                                                            ;                   ;         ;
;      - Multi_Sdram:u3|Sdram_Controller:u1|mDATAOUT[7]                                 ; 1                 ; 6       ;
; DRAM_DQ[8]                                                                            ;                   ;         ;
;      - Multi_Sdram:u3|Sdram_Controller:u1|mDATAOUT[8]                                 ; 0                 ; 6       ;
; DRAM_DQ[9]                                                                            ;                   ;         ;
;      - Multi_Sdram:u3|Sdram_Controller:u1|mDATAOUT[9]~feeder                          ; 1                 ; 6       ;
; DRAM_DQ[10]                                                                           ;                   ;         ;
;      - Multi_Sdram:u3|Sdram_Controller:u1|mDATAOUT[10]                                ; 1                 ; 6       ;
; DRAM_DQ[11]                                                                           ;                   ;         ;
;      - Multi_Sdram:u3|Sdram_Controller:u1|mDATAOUT[11]~feeder                         ; 0                 ; 6       ;
; DRAM_DQ[12]                                                                           ;                   ;         ;
;      - Multi_Sdram:u3|Sdram_Controller:u1|mDATAOUT[12]~feeder                         ; 0                 ; 6       ;
; DRAM_DQ[13]                                                                           ;                   ;         ;
;      - Multi_Sdram:u3|Sdram_Controller:u1|mDATAOUT[13]~feeder                         ; 0                 ; 6       ;
; DRAM_DQ[14]                                                                           ;                   ;         ;
;      - Multi_Sdram:u3|Sdram_Controller:u1|mDATAOUT[14]                                ; 1                 ; 6       ;
; DRAM_DQ[15]                                                                           ;                   ;         ;
;      - Multi_Sdram:u3|Sdram_Controller:u1|mDATAOUT[15]                                ; 1                 ; 6       ;
; FL_DQ[0]                                                                              ;                   ;         ;
;      - Multi_Flash:u2|Flash_Controller:u1|oDATA[0]                                    ; 0                 ; 6       ;
; FL_DQ[1]                                                                              ;                   ;         ;
;      - Multi_Flash:u2|Flash_Controller:u1|oDATA[1]~feeder                             ; 1                 ; 6       ;
; FL_DQ[2]                                                                              ;                   ;         ;
;      - Multi_Flash:u2|Flash_Controller:u1|oDATA[2]                                    ; 0                 ; 6       ;
; FL_DQ[3]                                                                              ;                   ;         ;
;      - Multi_Flash:u2|Flash_Controller:u1|oDATA[3]~feeder                             ; 1                 ; 6       ;
; FL_DQ[4]                                                                              ;                   ;         ;
;      - Multi_Flash:u2|Flash_Controller:u1|oDATA[4]~feeder                             ; 0                 ; 6       ;
; FL_DQ[5]                                                                              ;                   ;         ;
;      - Multi_Flash:u2|Flash_Controller:u1|oDATA[5]~feeder                             ; 0                 ; 6       ;
; FL_DQ[6]                                                                              ;                   ;         ;
;      - Multi_Flash:u2|Flash_Controller:u1|oDATA[6]                                    ; 0                 ; 6       ;
; FL_DQ[7]                                                                              ;                   ;         ;
;      - Multi_Flash:u2|Flash_Controller:u1|oDATA[7]~feeder                             ; 0                 ; 6       ;
; SRAM_DQ[0]                                                                            ;                   ;         ;
;      - CMD_Decode:u5|Selector46~73                                                    ; 0                 ; 6       ;
; SRAM_DQ[1]                                                                            ;                   ;         ;
;      - CMD_Decode:u5|Selector45~73                                                    ; 1                 ; 6       ;
; SRAM_DQ[2]                                                                            ;                   ;         ;
;      - CMD_Decode:u5|Selector44~73                                                    ; 0                 ; 6       ;
; SRAM_DQ[3]                                                                            ;                   ;         ;
;      - CMD_Decode:u5|Selector43~73                                                    ; 0                 ; 6       ;
; SRAM_DQ[4]                                                                            ;                   ;         ;
;      - mVGA_R[6]~263                                                                  ; 1                 ; 6       ;
;      - CMD_Decode:u5|Selector42~73                                                    ; 1                 ; 6       ;
; SRAM_DQ[5]                                                                            ;                   ;         ;
;      - mVGA_R[7]~264                                                                  ; 0                 ; 6       ;
;      - CMD_Decode:u5|Selector41~73                                                    ; 0                 ; 6       ;
; SRAM_DQ[6]                                                                            ;                   ;         ;
;      - mVGA_R[8]~265                                                                  ; 0                 ; 6       ;
;      - CMD_Decode:u5|Selector40~73                                                    ; 0                 ; 6       ;
; SRAM_DQ[7]                                                                            ;                   ;         ;
;      - mVIN_R[9]~71                                                                   ; 0                 ; 6       ;
;      - CMD_Decode:u5|Selector39~73                                                    ; 0                 ; 6       ;
; SRAM_DQ[8]                                                                            ;                   ;         ;
;      - CMD_Decode:u5|Selector46~73                                                    ; 1                 ; 6       ;
; SRAM_DQ[9]                                                                            ;                   ;         ;
;      - CMD_Decode:u5|Selector45~73                                                    ; 0                 ; 6       ;
; SRAM_DQ[10]                                                                           ;                   ;         ;
;      - CMD_Decode:u5|Selector44~73                                                    ; 0                 ; 6       ;
; SRAM_DQ[11]                                                                           ;                   ;         ;
;      - CMD_Decode:u5|Selector43~73                                                    ; 1                 ; 6       ;
; SRAM_DQ[12]                                                                           ;                   ;         ;
;      - mVGA_R[6]~263                                                                  ; 1                 ; 6       ;
;      - CMD_Decode:u5|Selector42~73                                                    ; 1                 ; 6       ;
; SRAM_DQ[13]                                                                           ;                   ;         ;
;      - mVGA_R[7]~264                                                                  ; 0                 ; 6       ;
;      - CMD_Decode:u5|Selector41~73                                                    ; 0                 ; 6       ;
; SRAM_DQ[14]                                                                           ;                   ;         ;
;      - mVGA_R[8]~265                                                                  ; 1                 ; 6       ;
;      - CMD_Decode:u5|Selector40~73                                                    ; 1                 ; 6       ;
; SRAM_DQ[15]                                                                           ;                   ;         ;
;      - mVIN_R[9]~71                                                                   ; 1                 ; 6       ;
;      - CMD_Decode:u5|Selector39~73                                                    ; 1                 ; 6       ;
; SD_DAT                                                                                ;                   ;         ;
; I2C_SDAT                                                                              ;                   ;         ;
;      - I2C_AV_Config:u10|I2C_Controller:u0|Selector4~98                               ; 0                 ; 6       ;
;      - I2C_AV_Config:u10|I2C_Controller:u0|ACK3~216                                   ; 0                 ; 6       ;
;      - I2C_AV_Config:u10|I2C_Controller:u0|ACK2~252                                   ; 0                 ; 6       ;
; AUD_BCLK                                                                              ;                   ;         ;
; GPIO_0[0]                                                                             ;                   ;         ;
; GPIO_0[1]                                                                             ;                   ;         ;
; GPIO_0[2]                                                                             ;                   ;         ;
; GPIO_0[3]                                                                             ;                   ;         ;
; GPIO_0[4]                                                                             ;                   ;         ;
; GPIO_0[5]                                                                             ;                   ;         ;
; GPIO_0[6]                                                                             ;                   ;         ;
; GPIO_0[7]                                                                             ;                   ;         ;
; GPIO_0[8]                                                                             ;                   ;         ;
; GPIO_0[9]                                                                             ;                   ;         ;
; GPIO_0[10]                                                                            ;                   ;         ;
; GPIO_0[11]                                                                            ;                   ;         ;
; GPIO_0[12]                                                                            ;                   ;         ;
; GPIO_0[13]                                                                            ;                   ;         ;
; GPIO_0[14]                                                                            ;                   ;         ;
; GPIO_0[15]                                                                            ;                   ;         ;
; GPIO_0[16]                                                                            ;                   ;         ;
; GPIO_0[17]                                                                            ;                   ;         ;
; GPIO_0[18]                                                                            ;                   ;         ;
; GPIO_0[19]                                                                            ;                   ;         ;
; GPIO_0[20]                                                                            ;                   ;         ;
; GPIO_0[21]                                                                            ;                   ;         ;
; GPIO_0[22]                                                                            ;                   ;         ;
; GPIO_0[23]                                                                            ;                   ;         ;
; GPIO_0[24]                                                                            ;                   ;         ;
; GPIO_0[25]                                                                            ;                   ;         ;
; GPIO_0[26]                                                                            ;                   ;         ;
; GPIO_0[27]                                                                            ;                   ;         ;
; GPIO_0[28]                                                                            ;                   ;         ;
; GPIO_0[29]                                                                            ;                   ;         ;
; GPIO_0[30]                                                                            ;                   ;         ;
; GPIO_0[31]                                                                            ;                   ;         ;
; GPIO_0[32]                                                                            ;                   ;         ;
; GPIO_0[33]                                                                            ;                   ;         ;
; GPIO_0[34]                                                                            ;                   ;         ;
; GPIO_0[35]                                                                            ;                   ;         ;
; GPIO_1[0]                                                                             ;                   ;         ;
; GPIO_1[1]                                                                             ;                   ;         ;
; GPIO_1[2]                                                                             ;                   ;         ;
; GPIO_1[3]                                                                             ;                   ;         ;
; GPIO_1[4]                                                                             ;                   ;         ;
; GPIO_1[5]                                                                             ;                   ;         ;
; GPIO_1[6]                                                                             ;                   ;         ;
; GPIO_1[7]                                                                             ;                   ;         ;
; GPIO_1[8]                                                                             ;                   ;         ;
; GPIO_1[9]                                                                             ;                   ;         ;
; GPIO_1[10]                                                                            ;                   ;         ;
; GPIO_1[11]                                                                            ;                   ;         ;
; GPIO_1[12]                                                                            ;                   ;         ;
; GPIO_1[13]                                                                            ;                   ;         ;
; GPIO_1[14]                                                                            ;                   ;         ;
; GPIO_1[15]                                                                            ;                   ;         ;
; GPIO_1[16]                                                                            ;                   ;         ;
; GPIO_1[17]                                                                            ;                   ;         ;
; GPIO_1[18]                                                                            ;                   ;         ;
; GPIO_1[19]                                                                            ;                   ;         ;
; GPIO_1[20]                                                                            ;                   ;         ;
; GPIO_1[21]                                                                            ;                   ;         ;
; GPIO_1[22]                                                                            ;                   ;         ;
; GPIO_1[23]                                                                            ;                   ;         ;
; GPIO_1[24]                                                                            ;                   ;         ;
; GPIO_1[25]                                                                            ;                   ;         ;
; GPIO_1[26]                                                                            ;                   ;         ;
; GPIO_1[27]                                                                            ;                   ;         ;
; GPIO_1[28]                                                                            ;                   ;         ;
; GPIO_1[29]                                                                            ;                   ;         ;
; GPIO_1[30]                                                                            ;                   ;         ;
; GPIO_1[31]                                                                            ;                   ;         ;
; GPIO_1[32]                                                                            ;                   ;         ;
; GPIO_1[33]                                                                            ;                   ;         ;
; GPIO_1[34]                                                                            ;                   ;         ;
; GPIO_1[35]                                                                            ;                   ;         ;
+---------------------------------------------------------------------------------------+-------------------+---------+


+---------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Control Signals                                                                                                                                                                                                                                                                                                                 ;
+-------------------------------------------------------------------------------------------------------------------------------------------------------------+--------------------+---------+-----------------------------------------------------+--------+----------------------+------------------+---------------------------+
; Name                                                                                                                                                        ; Location           ; Fan-Out ; Usage                                               ; Global ; Global Resource Used ; Global Line Name ; Enable Signal Source Name ;
+-------------------------------------------------------------------------------------------------------------------------------------------------------------+--------------------+---------+-----------------------------------------------------+--------+----------------------+------------------+---------------------------+
; AUDIO_DAC:u11|FLASH_Cont[0]                                                                                                                                 ; LCFF_X22_Y4_N11    ; 19      ; Clock enable                                        ; no     ; --                   ; --               ; --                        ;
; AUDIO_DAC:u11|LRCK_1X                                                                                                                                       ; LCFF_X27_Y1_N7     ; 6       ; Clock                                               ; yes    ; Global Clock         ; GCLK14           ; --                        ;
; AUDIO_DAC:u11|LRCK_2X                                                                                                                                       ; LCFF_X27_Y1_N11    ; 16      ; Clock                                               ; yes    ; Global Clock         ; GCLK15           ; --                        ;
; AUDIO_DAC:u11|LRCK_4X                                                                                                                                       ; LCFF_X49_Y14_N25   ; 38      ; Clock                                               ; yes    ; Global Clock         ; GCLK5            ; --                        ;
; AUDIO_DAC:u11|LessThan1~143                                                                                                                                 ; LCCOMB_X26_Y1_N0   ; 10      ; Sync. clear                                         ; no     ; --                   ; --               ; --                        ;
; AUDIO_DAC:u11|LessThan2~127                                                                                                                                 ; LCCOMB_X27_Y1_N2   ; 9       ; Sync. clear                                         ; no     ; --                   ; --               ; --                        ;
; AUDIO_DAC:u11|LessThan3~110                                                                                                                                 ; LCCOMB_X49_Y14_N28 ; 8       ; Sync. clear                                         ; no     ; --                   ; --               ; --                        ;
; AUDIO_DAC:u11|LessThan4~83                                                                                                                                  ; LCCOMB_X23_Y10_N24 ; 6       ; Sync. clear                                         ; no     ; --                   ; --               ; --                        ;
; AUDIO_DAC:u11|LessThan5~345                                                                                                                                 ; LCCOMB_X22_Y4_N0   ; 22      ; Sync. clear                                         ; no     ; --                   ; --               ; --                        ;
; AUDIO_DAC:u11|oAUD_BCK                                                                                                                                      ; LCFF_X49_Y14_N31   ; 4       ; Clock                                               ; yes    ; Global Clock         ; GCLK4            ; --                        ;
; CLOCK_27[0]                                                                                                                                                 ; PIN_D12            ; 1       ; Clock                                               ; no     ; --                   ; --               ; --                        ;
; CLOCK_50                                                                                                                                                    ; PIN_L1             ; 557     ; Clock                                               ; yes    ; Global Clock         ; GCLK2            ; --                        ;
; CLOCK_50                                                                                                                                                    ; PIN_L1             ; 4       ; Clock                                               ; no     ; --                   ; --               ; --                        ;
; CMD_Decode:u5|Decoder1~131                                                                                                                                  ; LCCOMB_X18_Y6_N30  ; 2       ; Clock enable                                        ; no     ; --                   ; --               ; --                        ;
; CMD_Decode:u5|Decoder1~132                                                                                                                                  ; LCCOMB_X15_Y6_N0   ; 4       ; Clock enable                                        ; no     ; --                   ; --               ; --                        ;
; CMD_Decode:u5|Decoder1~133                                                                                                                                  ; LCCOMB_X15_Y4_N12  ; 10      ; Clock enable                                        ; no     ; --                   ; --               ; --                        ;
; CMD_Decode:u5|Decoder1~134                                                                                                                                  ; LCCOMB_X15_Y6_N30  ; 10      ; Clock enable                                        ; no     ; --                   ; --               ; --                        ;
; CMD_Decode:u5|Decoder1~135                                                                                                                                  ; LCCOMB_X18_Y6_N6   ; 4       ; Clock enable                                        ; no     ; --                   ; --               ; --                        ;
; CMD_Decode:u5|Decoder1~136                                                                                                                                  ; LCCOMB_X15_Y4_N22  ; 4       ; Clock enable                                        ; no     ; --                   ; --               ; --                        ;
; CMD_Decode:u5|f_FLASH                                                                                                                                       ; LCFF_X21_Y7_N5     ; 13      ; Clock enable                                        ; no     ; --                   ; --               ; --                        ;
; CMD_Decode:u5|f_SDRAM                                                                                                                                       ; LCFF_X18_Y7_N9     ; 11      ; Clock enable                                        ; no     ; --                   ; --               ; --                        ;
; CMD_Decode:u5|f_SRAM                                                                                                                                        ; LCFF_X18_Y7_N13    ; 11      ; Clock enable                                        ; no     ; --                   ; --               ; --                        ;
; CMD_Decode:u5|oFL_ADDR[0]~1192                                                                                                                              ; LCCOMB_X20_Y7_N2   ; 30      ; Clock enable                                        ; no     ; --                   ; --               ; --                        ;
; CMD_Decode:u5|oFL_Select[1]~353                                                                                                                             ; LCCOMB_X20_Y5_N12  ; 2       ; Clock enable                                        ; no     ; --                   ; --               ; --                        ;
; CMD_Decode:u5|oFL_TXD_DATA[7]~744                                                                                                                           ; LCCOMB_X21_Y7_N0   ; 8       ; Clock enable                                        ; no     ; --                   ; --               ; --                        ;
; CMD_Decode:u5|oLED_GREEN[0]~50                                                                                                                              ; LCCOMB_X18_Y7_N20  ; 18      ; Clock enable                                        ; no     ; --                   ; --               ; --                        ;
; CMD_Decode:u5|oPS2_TXD_DATA[6]~737                                                                                                                          ; LCCOMB_X22_Y7_N28  ; 7       ; Clock enable                                        ; no     ; --                   ; --               ; --                        ;
; CMD_Decode:u5|oSDR_ADDR[0]~1289                                                                                                                             ; LCCOMB_X14_Y7_N26  ; 38      ; Clock enable                                        ; no     ; --                   ; --               ; --                        ;
; CMD_Decode:u5|oSDR_Select[1]~353                                                                                                                            ; LCCOMB_X14_Y8_N14  ; 2       ; Clock enable                                        ; no     ; --                   ; --               ; --                        ;
; CMD_Decode:u5|oSDR_TXD_DATA[7]~70                                                                                                                           ; LCCOMB_X14_Y7_N20  ; 8       ; Clock enable                                        ; no     ; --                   ; --               ; --                        ;
; CMD_Decode:u5|oSEG7_DIG[0]~561                                                                                                                              ; LCCOMB_X18_Y7_N2   ; 16      ; Clock enable                                        ; no     ; --                   ; --               ; --                        ;
; CMD_Decode:u5|oSR_ADDR[0]~1205                                                                                                                              ; LCCOMB_X18_Y7_N24  ; 34      ; Clock enable                                        ; no     ; --                   ; --               ; --                        ;
; CMD_Decode:u5|oSR_Select[1]~358                                                                                                                             ; LCCOMB_X14_Y8_N12  ; 2       ; Clock enable                                        ; no     ; --                   ; --               ; --                        ;
; CMD_Decode:u5|oSR_TXD_DATA[7]~70                                                                                                                            ; LCCOMB_X19_Y7_N22  ; 8       ; Clock enable                                        ; no     ; --                   ; --               ; --                        ;
; CMD_Decode:u5|sel_SR~144                                                                                                                                    ; LCCOMB_X20_Y7_N8   ; 3       ; Clock enable                                        ; no     ; --                   ; --               ; --                        ;
; I2C_AV_Config:u10|I2C_Controller:u0|SD[12]~846                                                                                                              ; LCCOMB_X1_Y12_N16  ; 10      ; Clock enable                                        ; no     ; --                   ; --               ; --                        ;
; I2C_AV_Config:u10|LessThan0~229                                                                                                                             ; LCCOMB_X1_Y5_N2    ; 17      ; Sync. clear                                         ; no     ; --                   ; --               ; --                        ;
; I2C_AV_Config:u10|LessThan1~52                                                                                                                              ; LCCOMB_X2_Y12_N18  ; 8       ; Clock enable                                        ; no     ; --                   ; --               ; --                        ;
; I2C_AV_Config:u10|mI2C_CTRL_CLK                                                                                                                             ; LCFF_X1_Y13_N17    ; 40      ; Clock                                               ; yes    ; Global Clock         ; GCLK0            ; --                        ;
; I2C_AV_Config:u10|mI2C_DATA[12]~962                                                                                                                         ; LCCOMB_X2_Y13_N2   ; 10      ; Clock enable                                        ; no     ; --                   ; --               ; --                        ;
; I2C_AV_Config:u10|mI2C_GO                                                                                                                                   ; LCFF_X2_Y13_N15    ; 7       ; Sync. load                                          ; no     ; --                   ; --               ; --                        ;
; KEY[0]                                                                                                                                                      ; PIN_R22            ; 529     ; Async. clear, Clock enable, Sync. clear, Sync. load ; no     ; --                   ; --               ; --                        ;
; Multi_Flash:u2|Flash_Controller:u1|Equal1~44                                                                                                                ; LCCOMB_X25_Y4_N24  ; 13      ; Sync. clear                                         ; no     ; --                   ; --               ; --                        ;
; Multi_Flash:u2|Flash_Controller:u1|ST.READ                                                                                                                  ; LCFF_X24_Y5_N11    ; 28      ; Output enable                                       ; no     ; --                   ; --               ; --                        ;
; Multi_Flash:u2|Flash_Controller:u1|ST~417                                                                                                                   ; LCCOMB_X24_Y5_N4   ; 3       ; Clock enable                                        ; no     ; --                   ; --               ; --                        ;
; Multi_Flash:u2|Flash_Controller:u1|always3~0                                                                                                                ; LCCOMB_X24_Y5_N8   ; 8       ; Clock enable                                        ; no     ; --                   ; --               ; --                        ;
; Multi_Flash:u2|Flash_Controller:u1|mACT                                                                                                                     ; LCFF_X24_Y4_N1     ; 33      ; Clock enable                                        ; no     ; --                   ; --               ; --                        ;
; Multi_Flash:u2|Flash_Controller:u1|mStart                                                                                                                   ; LCFF_X23_Y6_N27    ; 39      ; Sync. clear                                         ; no     ; --                   ; --               ; --                        ;
; Multi_Flash:u2|Flash_Controller:u1|r_CMD[2]~1009                                                                                                            ; LCCOMB_X23_Y6_N28  ; 32      ; Clock enable                                        ; no     ; --                   ; --               ; --                        ;
; Multi_Flash:u2|Flash_Multiplexer:u0|ST~168                                                                                                                  ; LCCOMB_X25_Y4_N12  ; 9       ; Clock enable                                        ; no     ; --                   ; --               ; --                        ;
; Multi_Sdram:u3|Sdram_Controller:u1|CMD[0]~823                                                                                                               ; LCCOMB_X13_Y8_N4   ; 2       ; Clock enable                                        ; no     ; --                   ; --               ; --                        ;
; Multi_Sdram:u3|Sdram_Controller:u1|PLL1:sdram_pll1|altpll:altpll_component|_clk0                                                                            ; PLL_1              ; 194     ; Clock                                               ; yes    ; Global Clock         ; GCLK3            ; --                        ;
; Multi_Sdram:u3|Sdram_Controller:u1|command:command1|OE                                                                                                      ; LCFF_X5_Y8_N21     ; 16      ; Output enable                                       ; no     ; --                   ; --               ; --                        ;
; Multi_Sdram:u3|Sdram_Controller:u1|command:command1|SA~784                                                                                                  ; LCCOMB_X9_Y7_N2    ; 11      ; Sync. load                                          ; no     ; --                   ; --               ; --                        ;
; Multi_Sdram:u3|Sdram_Controller:u1|command:command1|rp_shift[0]~910                                                                                         ; LCCOMB_X10_Y8_N20  ; 4       ; Clock enable                                        ; no     ; --                   ; --               ; --                        ;
; Multi_Sdram:u3|Sdram_Controller:u1|control_interface:control1|INIT_REQ                                                                                      ; LCFF_X8_Y8_N25     ; 26      ; Sync. clear                                         ; no     ; --                   ; --               ; --                        ;
; Multi_Sdram:u3|Sdram_Controller:u1|control_interface:control1|LessThan0~216                                                                                 ; LCCOMB_X8_Y8_N4    ; 16      ; Clock enable                                        ; no     ; --                   ; --               ; --                        ;
; Multi_Sdram:u3|Sdram_Controller:u1|control_interface:control1|REF_REQ~23                                                                                    ; LCCOMB_X9_Y10_N14  ; 16      ; Sync. load                                          ; no     ; --                   ; --               ; --                        ;
; Multi_Sdram:u3|Sdram_Multiplexer:u0|oSDR_RD~53                                                                                                              ; LCCOMB_X13_Y8_N6   ; 19      ; Clock enable                                        ; no     ; --                   ; --               ; --                        ;
; Multi_Sram:u6|SRAM_WE_N~56                                                                                                                                  ; LCCOMB_X15_Y4_N28  ; 17      ; Output enable                                       ; no     ; --                   ; --               ; --                        ;
; Reset_Delay:d0|Equal0~197                                                                                                                                   ; LCCOMB_X48_Y13_N24 ; 21      ; Clock enable                                        ; no     ; --                   ; --               ; --                        ;
; Reset_Delay:d0|oRESET                                                                                                                                       ; LCFF_X48_Y14_N13   ; 169     ; Async. clear                                        ; yes    ; Global Clock         ; GCLK7            ; --                        ;
; TCK                                                                                                                                                         ; PIN_C7             ; 6       ; Clock                                               ; yes    ; Global Clock         ; GCLK1            ; VCC                       ;
; TCS                                                                                                                                                         ; PIN_D8             ; 17      ; Async. clear, Clock enable                          ; yes    ; Global Clock         ; GCLK8            ; --                        ;
; USB_JTAG:u1|JTAG_REC:u0|oRxD_DATA[7]~756                                                                                                                    ; LCCOMB_X20_Y5_N0   ; 8       ; Clock enable                                        ; no     ; --                   ; --               ; --                        ;
; USB_JTAG:u1|mTCK                                                                                                                                            ; LCFF_X25_Y2_N1     ; 19      ; Clock                                               ; yes    ; Global Clock         ; GCLK13           ; --                        ;
; USB_JTAG:u1|oRxD_DATA[7]~797                                                                                                                                ; LCCOMB_X20_Y5_N6   ; 8       ; Clock enable                                        ; no     ; --                   ; --               ; --                        ;
; USB_JTAG:u1|oRxD_Ready                                                                                                                                      ; LCFF_X20_Y5_N17    ; 67      ; Clock enable                                        ; no     ; --                   ; --               ; --                        ;
; VGA_Audio_PLL:p1|altpll:altpll_component|_clk0                                                                                                              ; PLL_3              ; 144     ; Clock                                               ; yes    ; Global Clock         ; GCLK11           ; --                        ;
; VGA_Audio_PLL:p1|altpll:altpll_component|_clk1                                                                                                              ; PLL_3              ; 32      ; Clock                                               ; yes    ; Global Clock         ; GCLK10           ; --                        ;
; VGA_Controller:u8|Cur_Color_B~229                                                                                                                           ; LCCOMB_X13_Y10_N0  ; 12      ; Sync. load                                          ; no     ; --                   ; --               ; --                        ;
; VGA_Controller:u8|Equal6~107                                                                                                                                ; LCCOMB_X13_Y9_N28  ; 11      ; Clock enable                                        ; no     ; --                   ; --               ; --                        ;
; VGA_Controller:u8|LessThan10~110                                                                                                                            ; LCCOMB_X14_Y11_N0  ; 10      ; Sync. clear                                         ; no     ; --                   ; --               ; --                        ;
; VGA_Controller:u8|LessThan8~86                                                                                                                              ; LCCOMB_X13_Y9_N4   ; 10      ; Sync. clear                                         ; no     ; --                   ; --               ; --                        ;
; VGA_Controller:u8|always0~250                                                                                                                               ; LCCOMB_X13_Y10_N16 ; 39      ; Clock enable                                        ; no     ; --                   ; --               ; --                        ;
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; VGA_OSD_RAM:u9|Img_RAM:u0|altsyncram:altsyncram_component|altsyncram_f7o1:auto_generated|altsyncram_e132:altsyncram1|decode_qpa:decode_a|w_anode3262w[3]    ; LCCOMB_X18_Y16_N24 ; 1       ; Clock enable                                        ; no     ; --                   ; --               ; --                        ;
; VGA_OSD_RAM:u9|Img_RAM:u0|altsyncram:altsyncram_component|altsyncram_f7o1:auto_generated|altsyncram_e132:altsyncram1|decode_qpa:decode_a|w_anode3272w[3]    ; LCCOMB_X18_Y16_N0  ; 1       ; Clock enable                                        ; no     ; --                   ; --               ; --                        ;
; VGA_OSD_RAM:u9|Img_RAM:u0|altsyncram:altsyncram_component|altsyncram_f7o1:auto_generated|altsyncram_e132:altsyncram1|decode_qpa:decode_a|w_anode3282w[3]    ; LCCOMB_X18_Y16_N22 ; 1       ; Clock enable                                        ; no     ; --                   ; --               ; --                        ;
; VGA_OSD_RAM:u9|Img_RAM:u0|altsyncram:altsyncram_component|altsyncram_f7o1:auto_generated|altsyncram_e132:altsyncram1|decode_qpa:decode_a|w_anode3292w[3]    ; LCCOMB_X18_Y16_N18 ; 1       ; Clock enable                                        ; no     ; --                   ; --               ; --                        ;
; VGA_OSD_RAM:u9|Img_RAM:u0|altsyncram:altsyncram_component|altsyncram_f7o1:auto_generated|altsyncram_e132:altsyncram1|decode_qpa:decode_a|w_anode3314w[3]    ; LCCOMB_X29_Y12_N4  ; 1       ; Clock enable                                        ; no     ; --                   ; --               ; --                        ;
; VGA_OSD_RAM:u9|Img_RAM:u0|altsyncram:altsyncram_component|altsyncram_f7o1:auto_generated|altsyncram_e132:altsyncram1|decode_qpa:decode_a|w_anode3325w[3]    ; LCCOMB_X21_Y12_N30 ; 1       ; Clock enable                                        ; no     ; --                   ; --               ; --                        ;
; VGA_OSD_RAM:u9|Img_RAM:u0|altsyncram:altsyncram_component|altsyncram_f7o1:auto_generated|altsyncram_e132:altsyncram1|decode_qpa:decode_a|w_anode3335w[3]    ; LCCOMB_X21_Y12_N4  ; 1       ; Clock enable                                        ; no     ; --                   ; --               ; --                        ;
; VGA_OSD_RAM:u9|Img_RAM:u0|altsyncram:altsyncram_component|altsyncram_f7o1:auto_generated|altsyncram_e132:altsyncram1|decode_qpa:decode_a|w_anode3345w[3]    ; LCCOMB_X29_Y12_N30 ; 1       ; Clock enable                                        ; no     ; --                   ; --               ; --                        ;
; VGA_OSD_RAM:u9|Img_RAM:u0|altsyncram:altsyncram_component|altsyncram_f7o1:auto_generated|altsyncram_e132:altsyncram1|decode_qpa:decode_a|w_anode3355w[3]    ; LCCOMB_X37_Y16_N24 ; 1       ; Clock enable                                        ; no     ; --                   ; --               ; --                        ;
; VGA_OSD_RAM:u9|Img_RAM:u0|altsyncram:altsyncram_component|altsyncram_f7o1:auto_generated|altsyncram_e132:altsyncram1|decode_qpa:decode_a|w_anode3365w[3]    ; LCCOMB_X37_Y16_N6  ; 1       ; Clock enable                                        ; no     ; --                   ; --               ; --                        ;
; VGA_OSD_RAM:u9|Img_RAM:u0|altsyncram:altsyncram_component|altsyncram_f7o1:auto_generated|altsyncram_e132:altsyncram1|decode_qpa:decode_a|w_anode3375w[3]    ; LCCOMB_X37_Y16_N26 ; 1       ; Clock enable                                        ; no     ; --                   ; --               ; --                        ;
; VGA_OSD_RAM:u9|Img_RAM:u0|altsyncram:altsyncram_component|altsyncram_f7o1:auto_generated|altsyncram_e132:altsyncram1|decode_qpa:decode_a|w_anode3385w[3]    ; LCCOMB_X37_Y16_N14 ; 1       ; Clock enable                                        ; no     ; --                   ; --               ; --                        ;
; VGA_OSD_RAM:u9|Img_RAM:u0|altsyncram:altsyncram_component|altsyncram_f7o1:auto_generated|altsyncram_e132:altsyncram1|decode_qpa:decode_a|w_anode3407w[3]~11 ; LCCOMB_X21_Y12_N26 ; 1       ; Clock enable                                        ; no     ; --                   ; --               ; --                        ;
; VGA_OSD_RAM:u9|Img_RAM:u0|altsyncram:altsyncram_component|altsyncram_f7o1:auto_generated|altsyncram_e132:altsyncram1|decode_qpa:decode_a|w_anode3418w[3]~10 ; LCCOMB_X21_Y12_N20 ; 1       ; Clock enable                                        ; no     ; --                   ; --               ; --                        ;
; VGA_OSD_RAM:u9|Img_RAM:u0|altsyncram:altsyncram_component|altsyncram_f7o1:auto_generated|altsyncram_e132:altsyncram1|decode_qpa:decode_a|w_anode3428w[3]~24 ; LCCOMB_X21_Y12_N0  ; 1       ; Clock enable                                        ; no     ; --                   ; --               ; --                        ;
; ps2_keyboard:u4|WideOr0                                                                                                                                     ; LCCOMB_X33_Y14_N0  ; 12      ; Sync. clear                                         ; no     ; --                   ; --               ; --                        ;
; ps2_keyboard:u4|bit_count[2]~134                                                                                                                            ; LCCOMB_X33_Y14_N24 ; 4       ; Sync. clear                                         ; no     ; --                   ; --               ; --                        ;
; ps2_keyboard:u4|m1_state.m1_tx_wait_clk_h                                                                                                                   ; LCFF_X33_Y14_N19   ; 10      ; Sync. clear                                         ; no     ; --                   ; --               ; --                        ;
; ps2_keyboard:u4|q[7]~1247                                                                                                                                   ; LCCOMB_X33_Y14_N20 ; 10      ; Clock enable                                        ; no     ; --                   ; --               ; --                        ;
; ps2_keyboard:u4|rx_ascii[3]~822                                                                                                                             ; LCCOMB_X29_Y14_N12 ; 8       ; Clock enable                                        ; no     ; --                   ; --               ; --                        ;
+-------------------------------------------------------------------------------------------------------------------------------------------------------------+--------------------+---------+-----------------------------------------------------+--------+----------------------+------------------+---------------------------+


+-------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Global & Other Fast Signals                                                                                                                                                         ;
+----------------------------------------------------------------------------------+------------------+---------+----------------------+------------------+---------------------------+
; Name                                                                             ; Location         ; Fan-Out ; Global Resource Used ; Global Line Name ; Enable Signal Source Name ;
+----------------------------------------------------------------------------------+------------------+---------+----------------------+------------------+---------------------------+
; AUDIO_DAC:u11|LRCK_1X                                                            ; LCFF_X27_Y1_N7   ; 6       ; Global Clock         ; GCLK14           ; --                        ;
; AUDIO_DAC:u11|LRCK_2X                                                            ; LCFF_X27_Y1_N11  ; 16      ; Global Clock         ; GCLK15           ; --                        ;
; AUDIO_DAC:u11|LRCK_4X                                                            ; LCFF_X49_Y14_N25 ; 38      ; Global Clock         ; GCLK5            ; --                        ;
; AUDIO_DAC:u11|oAUD_BCK                                                           ; LCFF_X49_Y14_N31 ; 4       ; Global Clock         ; GCLK4            ; --                        ;
; CLOCK_50                                                                         ; PIN_L1           ; 557     ; Global Clock         ; GCLK2            ; --                        ;
; I2C_AV_Config:u10|mI2C_CTRL_CLK                                                  ; LCFF_X1_Y13_N17  ; 40      ; Global Clock         ; GCLK0            ; --                        ;
; Multi_Sdram:u3|Sdram_Controller:u1|PLL1:sdram_pll1|altpll:altpll_component|_clk0 ; PLL_1            ; 194     ; Global Clock         ; GCLK3            ; --                        ;
; Reset_Delay:d0|oRESET                                                            ; LCFF_X48_Y14_N13 ; 169     ; Global Clock         ; GCLK7            ; --                        ;
; TCK                                                                              ; PIN_C7           ; 6       ; Global Clock         ; GCLK1            ; VCC                       ;
; TCS                                                                              ; PIN_D8           ; 17      ; Global Clock         ; GCLK8            ; --                        ;
; TDI                                                                              ; PIN_E8           ; 2       ; Global Clock         ; GCLK9            ; --                        ;
; USB_JTAG:u1|mTCK                                                                 ; LCFF_X25_Y2_N1   ; 19      ; Global Clock         ; GCLK13           ; --                        ;
; VGA_Audio_PLL:p1|altpll:altpll_component|_clk0                                   ; PLL_3            ; 144     ; Global Clock         ; GCLK11           ; --                        ;
; VGA_Audio_PLL:p1|altpll:altpll_component|_clk1                                   ; PLL_3            ; 32      ; Global Clock         ; GCLK10           ; --                        ;
+----------------------------------------------------------------------------------+------------------+---------+----------------------+------------------+---------------------------+


+-----------------------------------------------------------------------------------------------------------------------------------------------------+
; Non-Global High Fan-Out Signals                                                                                                                     ;
+-------------------------------------------------------------------------------------------------------------------------------------------+---------+
; Name                                                                                                                                      ; Fan-Out ;
+-------------------------------------------------------------------------------------------------------------------------------------------+---------+
; KEY[0]                                                                                                                                    ; 529     ;
; ~GND                                                                                                                                      ; 522     ;
; VGA_OSD_RAM:u9|Img_RAM:u0|altsyncram:altsyncram_component|altsyncram_f7o1:auto_generated|altsyncram_e132:altsyncram1|out_address_reg_a[1] ; 176     ;
; VGA_OSD_RAM:u9|Img_RAM:u0|altsyncram:altsyncram_component|altsyncram_f7o1:auto_generated|altsyncram_e132:altsyncram1|out_address_reg_a[0] ; 164     ;
; ps2_keyboard:u4|q[5]                                                                                                                      ; 70      ;
; USB_JTAG:u1|oRxD_Ready                                                                                                                    ; 67      ;
; CMD_Decode:u5|oFL_Select[1]                                                                                                               ; 54      ;
; CMD_Decode:u5|oFL_Select[0]                                                                                                               ; 54      ;
; VGA_OSD_RAM:u9|Add3~345                                                                                                                   ; 51      ;
; VGA_OSD_RAM:u9|Add3~343                                                                                                                   ; 51      ;
; VGA_OSD_RAM:u9|Add3~341                                                                                                                   ; 51      ;
; VGA_OSD_RAM:u9|Add3~339                                                                                                                   ; 51      ;
; VGA_OSD_RAM:u9|Add3~337                                                                                                                   ; 51      ;
; VGA_OSD_RAM:u9|Add3~335                                                                                                                   ; 51      ;
; VGA_OSD_RAM:u9|Add3~333                                                                                                                   ; 51      ;
; VGA_OSD_RAM:u9|Add3~331                                                                                                                   ; 51      ;
; VGA_OSD_RAM:u9|Add3~329                                                                                                                   ; 51      ;
; VGA_OSD_RAM:u9|Img_RAM:u0|altsyncram:altsyncram_component|altsyncram_f7o1:auto_generated|altsyncram_e132:altsyncram1|out_address_reg_a[3] ; 48      ;
; AUDIO_DAC:u11|SEL_Cont[0]                                                                                                                 ; 48      ;
; CMD_Decode:u5|oSDR_Select[0]                                                                                                              ; 46      ;
; CMD_Decode:u5|oSDR_Select[1]                                                                                                              ; 46      ;
; AUDIO_DAC:u11|SEL_Cont[1]                                                                                                                 ; 42      ;
; VGA_Controller:u8|always0~250                                                                                                             ; 39      ;
; Multi_Flash:u2|Flash_Controller:u1|mStart                                                                                                 ; 39      ;
; CMD_Decode:u5|oSDR_ADDR[0]~1289                                                                                                           ; 38      ;
; CMD_Decode:u5|oSR_Select[1]                                                                                                               ; 38      ;
; CMD_Decode:u5|oSR_Select[0]                                                                                                               ; 38      ;
; AUDIO_DAC:u11|SEL_Cont[3]                                                                                                                 ; 37      ;
; ps2_keyboard:u4|rx_shift_key_on                                                                                                           ; 36      ;
; ps2_keyboard:u4|q[1]                                                                                                                      ; 36      ;
; AUDIO_DAC:u11|SEL_Cont[2]                                                                                                                 ; 36      ;
; VGA_OSD_RAM:u9|Add3~351                                                                                                                   ; 35      ;
; VGA_OSD_RAM:u9|Add3~349                                                                                                                   ; 35      ;
; VGA_OSD_RAM:u9|Add3~347                                                                                                                   ; 35      ;
; CMD_Decode:u5|oSR_ADDR[0]~1205                                                                                                            ; 34      ;
; Multi_Flash:u2|Flash_Controller:u1|mACT                                                                                                   ; 33      ;
; VGA_OSD_RAM:u9|Img_RAM:u0|altsyncram:altsyncram_component|altsyncram_f7o1:auto_generated|altsyncram_e132:altsyncram1|out_address_reg_a[2] ; 32      ;
; Multi_Flash:u2|Flash_Controller:u1|r_CMD[2]~1009                                                                                          ; 32      ;
; CMD_Decode:u5|oFL_ADDR[0]~1192                                                                                                            ; 30      ;
; Multi_Flash:u2|Flash_Controller:u1|ST.READ                                                                                                ; 28      ;
; VGA_OSD_RAM:u9|Add3~357                                                                                                                   ; 27      ;
; VGA_OSD_RAM:u9|Add3~355                                                                                                                   ; 27      ;
; VGA_OSD_RAM:u9|Add3~353                                                                                                                   ; 27      ;
; Multi_Sdram:u3|Sdram_Controller:u1|control_interface:control1|INIT_REQ                                                                    ; 26      ;
; Multi_Flash:u2|Flash_Controller:u1|ST.P4_PRG                                                                                              ; 25      ;
; ps2_keyboard:u4|q[2]                                                                                                                      ; 24      ;
; AUDIO_DAC:u11|Ram0~22                                                                                                                     ; 24      ;
; ps2_keyboard:u4|Equal70~5974                                                                                                              ; 22      ;
; AUDIO_DAC:u11|LessThan5~345                                                                                                               ; 22      ;
; VGA_OSD_RAM:u9|Img_RAM:u0|altsyncram:altsyncram_component|altsyncram_f7o1:auto_generated|altsyncram_e132:altsyncram1|out_address_reg_a[5] ; 21      ;
+-------------------------------------------------------------------------------------------------------------------------------------------+---------+


+----------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Fitter RAM Summary                                                                                                                                                                                                                                                                                                                                                                                                                                                                                                                                                                                                                                                                                                                                                                                                                                                                                                                                                                                                                                                                                                                                                                           ;
+---------------------------------------------------------------------------------------------------------------------------------+------+----------------+--------------+--------------+--------------+--------------+--------------+------------------------+-------------------------+------------------------+-------------------------+--------+-----------------------------+-----------------------------+-----------------------------+-----------------------------+---------------------+------+--------------+----------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Name                                                                                                                            ; Type ; Mode           ; Clock Mode   ; Port A Depth ; Port A Width ; Port B Depth ; Port B Width ; Port A Input Registers ; Port A Output Registers ; Port B Input Registers ; Port B Output Registers ; Size   ; Implementation Port A Depth ; Implementation Port A Width ; Implementation Port B Depth ; Implementation Port B Width ; Implementation Bits ; M4Ks ; MIF          ; Location                                                                                                                                                                                                                                                                                                                                                                                                                                                                                                                                                                                                                                                             ;
+---------------------------------------------------------------------------------------------------------------------------------+------+----------------+--------------+--------------+--------------+--------------+--------------+------------------------+-------------------------+------------------------+-------------------------+--------+-----------------------------+-----------------------------+-----------------------------+-----------------------------+---------------------+------+--------------+----------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; VGA_OSD_RAM:u9|Img_RAM:u0|altsyncram:altsyncram_component|altsyncram_f7o1:auto_generated|altsyncram_e132:altsyncram1|ALTSYNCRAM ; M4K  ; True Dual Port ; Single Clock ; 26000        ; 8            ; 208000       ; 1            ; yes                    ; yes                     ; yes                    ; no                      ; 208000 ; 26000                       ; 8                           ; 208000                      ; 1                           ; 208000              ; 51   ; Img_DATA.hex ; M4K_X17_Y13, M4K_X17_Y12, M4K_X17_Y14, M4K_X17_Y22, M4K_X17_Y15, M4K_X17_Y26, M4K_X17_Y16, M4K_X17_Y19, M4K_X17_Y24, M4K_X17_Y20, M4K_X17_Y23, M4K_X17_Y6, M4K_X17_Y8, M4K_X17_Y2, M4K_X17_Y4, M4K_X17_Y7, M4K_X17_Y11, M4K_X17_Y3, M4K_X17_Y10, M4K_X41_Y24, M4K_X41_Y25, M4K_X41_Y26, M4K_X41_Y21, M4K_X17_Y17, M4K_X17_Y25, M4K_X17_Y21, M4K_X17_Y18, M4K_X41_Y9, M4K_X41_Y2, M4K_X41_Y1, M4K_X41_Y5, M4K_X17_Y5, M4K_X17_Y9, M4K_X41_Y3, M4K_X41_Y7, M4K_X41_Y20, M4K_X41_Y17, M4K_X41_Y23, M4K_X41_Y16, M4K_X41_Y18, M4K_X41_Y22, M4K_X41_Y15, M4K_X41_Y19, M4K_X41_Y6, M4K_X41_Y14, M4K_X41_Y10, M4K_X41_Y13, M4K_X41_Y11, M4K_X41_Y12, M4K_X41_Y4, M4K_X41_Y8 ;
+---------------------------------------------------------------------------------------------------------------------------------+------+----------------+--------------+--------------+--------------+--------------+--------------+------------------------+-------------------------+------------------------+-------------------------+--------+-----------------------------+-----------------------------+-----------------------------+-----------------------------+---------------------+------+--------------+----------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
Note: Fitter may spread logical memories into multiple blocks to improve timing. The actual required RAM blocks can be found in the Fitter Resource Usage section.


+-----------------------------------------------------+
; Interconnect Usage Summary                          ;
+----------------------------+------------------------+
; Interconnect Resource Type ; Usage                  ;
+----------------------------+------------------------+
; Block interconnects        ; 3,408 / 54,004 ( 6 % ) ;
; C16 interconnects          ; 62 / 2,100 ( 3 % )     ;
; C4 interconnects           ; 1,857 / 36,000 ( 5 % ) ;
; Direct links               ; 483 / 54,004 ( < 1 % ) ;
; Global clocks              ; 14 / 16 ( 88 % )       ;
; Local interconnects        ; 1,176 / 18,752 ( 6 % ) ;
; R24 interconnects          ; 95 / 1,900 ( 5 % )     ;
; R4 interconnects           ; 2,128 / 46,920 ( 5 % ) ;
+----------------------------+------------------------+


+-----------------------------------------------------------------------------+
; LAB Logic Elements                                                          ;
+---------------------------------------------+-------------------------------+
; Number of Logic Elements  (Average = 11.89) ; Number of LABs  (Total = 178) ;
+---------------------------------------------+-------------------------------+
; 1                                           ; 11                            ;
; 2                                           ; 6                             ;
; 3                                           ; 2                             ;
; 4                                           ; 3                             ;
; 5                                           ; 5                             ;
; 6                                           ; 2                             ;
; 7                                           ; 6                             ;
; 8                                           ; 9                             ;
; 9                                           ; 4                             ;
; 10                                          ; 1                             ;
; 11                                          ; 9                             ;
; 12                                          ; 18                            ;
; 13                                          ; 11                            ;
; 14                                          ; 12                            ;
; 15                                          ; 11                            ;
; 16                                          ; 68                            ;
+---------------------------------------------+-------------------------------+


+--------------------------------------------------------------------+
; LAB-wide Signals                                                   ;
+------------------------------------+-------------------------------+
; LAB-wide Signals  (Average = 1.55) ; Number of LABs  (Total = 178) ;
+------------------------------------+-------------------------------+
; 1 Async. clear                     ; 74                            ;
; 1 Clock                            ; 96                            ;
; 1 Clock enable                     ; 41                            ;
; 1 Sync. clear                      ; 12                            ;
; 1 Sync. load                       ; 6                             ;
; 2 Async. clears                    ; 3                             ;
; 2 Clock enables                    ; 22                            ;
; 2 Clocks                           ; 22                            ;
+------------------------------------+-------------------------------+


+------------------------------------------------------------------------------+
; LAB Signals Sourced                                                          ;
+----------------------------------------------+-------------------------------+
; Number of Signals Sourced  (Average = 17.23) ; Number of LABs  (Total = 178) ;
+----------------------------------------------+-------------------------------+
; 0                                            ; 0                             ;
; 1                                            ; 9                             ;
; 2                                            ; 2                             ;
; 3                                            ; 2                             ;
; 4                                            ; 8                             ;
; 5                                            ; 4                             ;
; 6                                            ; 0                             ;
; 7                                            ; 2                             ;
; 8                                            ; 6                             ;
; 9                                            ; 2                             ;
; 10                                           ; 3                             ;
; 11                                           ; 7                             ;
; 12                                           ; 9                             ;
; 13                                           ; 8                             ;
; 14                                           ; 6                             ;
; 15                                           ; 6                             ;
; 16                                           ; 14                            ;
; 17                                           ; 4                             ;
; 18                                           ; 4                             ;
; 19                                           ; 6                             ;
; 20                                           ; 6                             ;
; 21                                           ; 5                             ;
; 22                                           ; 5                             ;
; 23                                           ; 9                             ;
; 24                                           ; 11                            ;
; 25                                           ; 4                             ;
; 26                                           ; 5                             ;
; 27                                           ; 6                             ;
; 28                                           ; 8                             ;
; 29                                           ; 4                             ;
; 30                                           ; 3                             ;
; 31                                           ; 3                             ;
; 32                                           ; 7                             ;
+----------------------------------------------+-------------------------------+


+---------------------------------------------------------------------------------+
; LAB Signals Sourced Out                                                         ;
+-------------------------------------------------+-------------------------------+
; Number of Signals Sourced Out  (Average = 7.69) ; Number of LABs  (Total = 178) ;
+-------------------------------------------------+-------------------------------+
; 0                                               ; 0                             ;
; 1                                               ; 21                            ;
; 2                                               ; 7                             ;
; 3                                               ; 10                            ;
; 4                                               ; 15                            ;
; 5                                               ; 16                            ;
; 6                                               ; 9                             ;
; 7                                               ; 9                             ;
; 8                                               ; 23                            ;
; 9                                               ; 11                            ;
; 10                                              ; 8                             ;
; 11                                              ; 8                             ;
; 12                                              ; 11                            ;
; 13                                              ; 7                             ;
; 14                                              ; 8                             ;
; 15                                              ; 3                             ;
; 16                                              ; 4                             ;
; 17                                              ; 2                             ;
; 18                                              ; 1                             ;
; 19                                              ; 3                             ;
; 20                                              ; 1                             ;
; 21                                              ; 0                             ;
; 22                                              ; 1                             ;
+-------------------------------------------------+-------------------------------+


+------------------------------------------------------------------------------+
; LAB Distinct Inputs                                                          ;
+----------------------------------------------+-------------------------------+
; Number of Distinct Inputs  (Average = 14.40) ; Number of LABs  (Total = 178) ;
+----------------------------------------------+-------------------------------+
; 0                                            ; 0                             ;
; 1                                            ; 0                             ;
; 2                                            ; 7                             ;
; 3                                            ; 7                             ;
; 4                                            ; 12                            ;
; 5                                            ; 5                             ;
; 6                                            ; 7                             ;
; 7                                            ; 4                             ;
; 8                                            ; 7                             ;
; 9                                            ; 4                             ;
; 10                                           ; 10                            ;
; 11                                           ; 8                             ;
; 12                                           ; 12                            ;
; 13                                           ; 5                             ;
; 14                                           ; 6                             ;
; 15                                           ; 5                             ;
; 16                                           ; 4                             ;
; 17                                           ; 7                             ;
; 18                                           ; 6                             ;
; 19                                           ; 12                            ;
; 20                                           ; 1                             ;
; 21                                           ; 8                             ;
; 22                                           ; 7                             ;
; 23                                           ; 4                             ;
; 24                                           ; 4                             ;
; 25                                           ; 5                             ;
; 26                                           ; 6                             ;
; 27                                           ; 3                             ;
; 28                                           ; 2                             ;
; 29                                           ; 2                             ;
; 30                                           ; 4                             ;
; 31                                           ; 3                             ;
+----------------------------------------------+-------------------------------+


+-------------------------------------------------------------------------+
; Fitter Device Options                                                   ;
+----------------------------------------------+--------------------------+
; Option                                       ; Setting                  ;
+----------------------------------------------+--------------------------+
; Enable user-supplied start-up clock (CLKUSR) ; Off                      ;
; Enable device-wide reset (DEV_CLRn)          ; Off                      ;
; Enable device-wide output enable (DEV_OE)    ; Off                      ;
; Enable INIT_DONE output                      ; Off                      ;
; Configuration scheme                         ; Active Serial            ;
; Error detection CRC                          ; Off                      ;
; nCEO                                         ; As output driving ground ;
; ASDO,nCSO                                    ; As input tri-stated      ;
; Reserve all unused pins                      ; As output driving ground ;
; Base pin-out file on sameframe device        ; Off                      ;
+----------------------------------------------+--------------------------+


+----------------------------+
; Advanced Data - General    ;
+--------------------+-------+
; Name               ; Value ;
+--------------------+-------+
; Status Code        ; 0     ;
; Desired User Slack ; 0     ;
; Fit Attempts       ; 1     ;
+--------------------+-------+


+--------------------------------------------------------------------------------------------+
; Advanced Data - Placement Preparation                                                      ;
+------------------------------------------------------------------+-------------------------+
; Name                                                             ; Value                   ;
+------------------------------------------------------------------+-------------------------+
; Mid Wire Use - Fit Attempt 1                                     ; 7                       ;
; Mid Slack - Fit Attempt 1                                        ; -8089                   ;
; Internal Atom Count - Fit Attempt 1                              ; 2870                    ;
; LE/ALM Count - Fit Attempt 1                                     ; 2117                    ;
; LAB Count - Fit Attempt 1                                        ; 169                     ;
; Outputs per Lab - Fit Attempt 1                                  ; 6.929                   ;
; Inputs per LAB - Fit Attempt 1                                   ; 13.213                  ;
; Global Inputs per LAB - Fit Attempt 1                            ; 1.000                   ;
; LAB Constraint 'non-global clock + sync load' - Fit Attempt 1    ; 0:160;1:8;2:1           ;
; LAB Constraint 'non-global controls' - Fit Attempt 1             ; 0:64;1:37;2:42;3:26     ;
; LAB Constraint 'non-global + aclr' - Fit Attempt 1               ; 0:56;1:30;2:53;3:29;4:1 ;
; LAB Constraint 'global non-clock non-aclr' - Fit Attempt 1       ; 0:165;1:3;2:1           ;
; LAB Constraint 'global controls' - Fit Attempt 1                 ; 0:49;1:76;2:35;3:8;4:1  ;
; LAB Constraint 'deterministic LABSMUXA/LABXMUXB' - Fit Attempt 1 ; 0:74;1:49;2:46          ;
; LAB Constraint 'deterministic LABSMUXC/LABXMUXD' - Fit Attempt 1 ; 0:74;1:78;2:17          ;
; LAB Constraint 'clock / ce pair constraint' - Fit Attempt 1      ; 0:49;1:60;2:60          ;
; LAB Constraint 'aclr constraint' - Fit Attempt 1                 ; 0:49;1:94;2:26          ;
; LAB Constraint 'true sload_sclear pair' - Fit Attempt 1          ; 0:104;1:65              ;
; LAB Constraint 'constant sload_sclear pair' - Fit Attempt 1      ; 0:145;1:24              ;
; LAB Constraint 'has placement constraint' - Fit Attempt 1        ; 0:159;1:10              ;
; LEs in Chains - Fit Attempt 1                                    ; 387                     ;
; LEs in Long Chains - Fit Attempt 1                               ; 98                      ;
; LABs with Chains - Fit Attempt 1                                 ; 39                      ;
; LABs with Multiple Chains - Fit Attempt 1                        ; 0                       ;
; Time - Fit Attempt 1                                             ; 4                       ;
; Time in tsm_tan.dll - Fit Attempt 1                              ; 0.374                   ;
+------------------------------------------------------------------+-------------------------+


+---------------------------------------------+
; Advanced Data - Placement                   ;
+-------------------------------------+-------+
; Name                                ; Value ;
+-------------------------------------+-------+
; Early Wire Use - Fit Attempt 1      ; 3     ;
; Early Slack - Fit Attempt 1         ; -4951 ;
; Mid Wire Use - Fit Attempt 1        ; 5     ;
; Mid Slack - Fit Attempt 1           ; -4950 ;
; Late Wire Use - Fit Attempt 1       ; 6     ;
; Late Slack - Fit Attempt 1          ; -4950 ;
; Peak Regional Wire - Fit Attempt 1  ; 0.000 ;
; Time - Fit Attempt 1                ; 19    ;
; Time in tsm_tan.dll - Fit Attempt 1 ; 3.932 ;
+-------------------------------------+-------+


+---------------------------------------------+
; Advanced Data - Routing                     ;
+-------------------------------------+-------+
; Name                                ; Value ;
+-------------------------------------+-------+
; Early Slack - Fit Attempt 1         ; -2764 ;
; Early Wire Use - Fit Attempt 1      ; 5     ;
; Peak Regional Wire - Fit Attempt 1  ; 12    ;
; Mid Slack - Fit Attempt 1           ; -2780 ;
; Late Slack - Fit Attempt 1          ; -2780 ;
; Late Slack - Fit Attempt 1          ; -2780 ;
; Late Wire Use - Fit Attempt 1       ; 5     ;
; Time - Fit Attempt 1                ; 7     ;
; Time in tsm_tan.dll - Fit Attempt 1 ; 2.938 ;
+-------------------------------------+-------+


+-------------------------------------------------------------------------------------------------------------------------------------------+
; Fitter INI Usage                                                                                                                          ;
+----------------------+--------------------------------------------------------------------------------------------------------------------+
; Option               ; Usage                                                                                                              ;
+----------------------+--------------------------------------------------------------------------------------------------------------------+
; Initialization file: ; c:/altera/71/quartus/bin/quartus.ini                                                                               ;
; dev_password         ; e81f0e65b8afc1da24522b894c886f598ff5e3fafae3453dd1029e508011004342234235215526025211557545361520042000410042555455 ;
+----------------------+--------------------------------------------------------------------------------------------------------------------+


+-----------------+
; Fitter Messages ;
+-----------------+
Info: *******************************************************************
Info: Running Quartus II Fitter
    Info: Version 7.1 Build 178 06/25/2007 Service Pack 1 SJ Full Version
    Info: Processing started: Thu Aug 30 15:44:37 2007
Info: Command: quartus_fit --read_settings_files=off --write_settings_files=off DE1_USB_API -c DE1_USB_API
Info: Selected device EP2C20F484C7 for design "DE1_USB_API"
Info: Implemented PLL "Multi_Sdram:u3|Sdram_Controller:u1|PLL1:sdram_pll1|altpll:altpll_component|pll" as Cyclone II PLL type
    Info: Implementing clock multiplication of 1, clock division of 1, and phase shift of 0 degrees (0 ps) for Multi_Sdram:u3|Sdram_Controller:u1|PLL1:sdram_pll1|altpll:altpll_component|_clk0 port
    Info: Implementing clock multiplication of 1, clock division of 1, and phase shift of 0 degrees (0 ps) for Multi_Sdram:u3|Sdram_Controller:u1|PLL1:sdram_pll1|altpll:altpll_component|_clk2 port
Info: Implemented PLL "VGA_Audio_PLL:p1|altpll:altpll_component|pll" as Cyclone II PLL type
    Info: Implementing clock multiplication of 14, clock division of 15, and phase shift of 0 degrees (0 ps) for VGA_Audio_PLL:p1|altpll:altpll_component|_clk0 port
    Info: Implementing clock multiplication of 2, clock division of 3, and phase shift of 0 degrees (0 ps) for VGA_Audio_PLL:p1|altpll:altpll_component|_clk1 port
Info: Fitter is performing an Auto Fit compilation, which may decrease Fitter effort to reduce compilation time
Info: Fitter is using the Classic Timing Analyzer
Info: Detected fmax, tsu, tco, and/or tpd requirements -- optimizing circuit to achieve only the specified requirements
Info: Device migration not selected. If you intend to use device migration later, you may need to change the pin assignments as they may be incompatible with other devices
    Info: Device EP2C15AF484C7 is compatible
    Info: Device EP2C35F484C7 is compatible
    Info: Device EP2C50F484C7 is compatible
Info: Fitter converted 3 user pins into dedicated programming pins
    Info: Pin ~ASDO~ is reserved at location C4
    Info: Pin ~nCSO~ is reserved at location C3
    Info: Pin ~LVDS91p/nCEO~ is reserved at location W20
Info: Design uses memory blocks. Violating setup or hold times of memory block address registers for either read or write operations could cause memory contents to be corrupted. Make sure that all memory block address registers meet the setup and hold time requirements.
Info: Clock Control Block CLK_LOCK:p0|CLK_LOCK_altclkctrl_tb8:CLK_LOCK_altclkctrl_tb8_component|wire_clkctrl1_outclk has its enable register mode parameter set to NONE, but its inclk[0] port is driven by block TCK. De-asserting the ena signal on the Clock Control during a high-pulse of the specified clock input signal can cause a glitch on the clock output.
Warning: No exact pin location assignment(s) for 4 pins of 283 total pins
    Info: Pin SD_CLK not assigned to an exact location on the device
    Info: Pin SD_DAT3 not assigned to an exact location on the device
    Info: Pin SD_CMD not assigned to an exact location on the device
    Info: Pin SD_DAT not assigned to an exact location on the device
Info: Automatically promoted node CLOCK_50 (placed in PIN L1 (CLK0, LVDSCLK0p, Input))
    Info: Automatically promoted destinations to use location or clock signal Global Clock CLKCTRL_G2
    Info: Following destination nodes may be non-global or may not use global or regional clocks
        Info: Destination node I2C_AV_Config:u10|mI2C_CTRL_CLK
        Info: Destination node USB_JTAG:u1|mTCK
Info: Automatically promoted node Multi_Sdram:u3|Sdram_Controller:u1|PLL1:sdram_pll1|altpll:altpll_component|_clk0 (placed in counter C0 of PLL_1)
    Info: Automatically promoted destinations to use location or clock signal Global Clock CLKCTRL_G3
Info: Automatically promoted node Multi_Sdram:u3|Sdram_Controller:u1|PLL1:sdram_pll1|altpll:altpll_component|_clk2 (placed in counter C2 of PLL_1)
    Info: Automatically promoted destinations to use location or clock signal External Clock Output CLKCTRL_X0_Y1_N1
Info: Promoted node TCK 
    Info: Automatically promoted CLK_LOCK:p0|CLK_LOCK_altclkctrl_tb8:CLK_LOCK_altclkctrl_tb8_component|clkctrl1 to use location or clock signal Global Clock
Info: Pin TCK drives global or regional clock Global Clock, but is not placed in a dedicated clock pin position
Info: Promoted node TCS 
    Info: Promoted destinations to use location or clock signal Global Clock
Info: Pin TCS drives global or regional clock Global Clock, but is not placed in a dedicated clock pin position
Info: Promoted node TDI 
    Info: Promoted destinations to use location or clock signal Global Clock
Info: Pin TDI drives global or regional clock Global Clock, but is not placed in a dedicated clock pin position
Info: Automatically promoted node VGA_Audio_PLL:p1|altpll:altpll_component|_clk0 (placed in counter C0 of PLL_3)
    Info: Automatically promoted destinations to use location or clock signal Global Clock CLKCTRL_G11
Info: Automatically promoted node VGA_Audio_PLL:p1|altpll:altpll_component|_clk1 (placed in counter C1 of PLL_3)
    Info: Automatically promoted destinations to use location or clock signal Global Clock CLKCTRL_G10
Info: Automatically promoted node I2C_AV_Config:u10|mI2C_CTRL_CLK 
    Info: Automatically promoted destinations to use location or clock signal Global Clock
    Info: Following destination nodes may be non-global or may not use global or regional clocks
        Info: Destination node I2C_AV_Config:u10|I2C_Controller:u0|I2C_SCLK~255
        Info: Destination node I2C_AV_Config:u10|mI2C_CTRL_CLK~79
Info: Automatically promoted node AUDIO_DAC:u11|LRCK_4X 
    Info: Automatically promoted destinations to use location or clock signal Global Clock
    Info: Following destination nodes may be non-global or may not use global or regional clocks
        Info: Destination node AUDIO_DAC:u11|LRCK_4X~47
Info: Automatically promoted node USB_JTAG:u1|mTCK 
    Info: Automatically promoted destinations to use location or clock signal Global Clock
Info: Automatically promoted node AUDIO_DAC:u11|LRCK_2X 
    Info: Automatically promoted destinations to use location or clock signal Global Clock
    Info: Following destination nodes may be non-global or may not use global or regional clocks
        Info: Destination node AUDIO_DAC:u11|LRCK_2X~49
Info: Automatically promoted node AUDIO_DAC:u11|LRCK_1X 
    Info: Automatically promoted destinations to use location or clock signal Global Clock
    Info: Following destination nodes may be non-global or may not use global or regional clocks
        Info: Destination node AUD_DACLRCK
        Info: Destination node AUD_ADCLRCK
        Info: Destination node AUDIO_DAC:u11|LRCK_1X~51
Info: Automatically promoted node AUDIO_DAC:u11|oAUD_BCK 
    Info: Automatically promoted destinations to use location or clock signal Global Clock
    Info: Following destination nodes may be non-global or may not use global or regional clocks
        Info: Destination node AUD_BCLK
        Info: Destination node AUDIO_DAC:u11|oAUD_BCK~37
Info: Automatically promoted node Reset_Delay:d0|oRESET 
    Info: Automatically promoted destinations to use location or clock signal Global Clock
Info: Starting register packing
Info: Ignoring invalid fast I/O register assignments
Info: Finished register packing: elapsed time is 00:00:01
    Extra Info: Packed 1 registers into blocks of type I/O
Info: Statistics of I/O pins that need to be placed that use the same VCCIO and VREF, before I/O pin placement
    Info: Number of I/O pins in group: 4 (unused VREF, 3.30 VCCIO, 0 input, 1 output, 3 bidirectional)
        Info: I/O standards used: 3.3-V LVTTL.
Info: I/O bank details before I/O pin placement
    Info: Statistics of I/O banks
        Info: I/O bank number 1 does not use VREF pins and has 3.30V VCCIO pins. 40 total pin(s) used --  1 pins available
        Info: I/O bank number 2 does not use VREF pins and has 3.30V VCCIO pins. 32 total pin(s) used --  1 pins available
        Info: I/O bank number 3 does not use VREF pins and has 3.30V VCCIO pins. 28 total pin(s) used --  15 pins available
        Info: I/O bank number 4 does not use VREF pins and has 3.30V VCCIO pins. 38 total pin(s) used --  2 pins available
        Info: I/O bank number 5 does not use VREF pins and has 3.30V VCCIO pins. 36 total pin(s) used --  3 pins available
        Info: I/O bank number 6 does not use VREF pins and has 3.30V VCCIO pins. 31 total pin(s) used --  5 pins available
        Info: I/O bank number 7 does not use VREF pins and has 3.30V VCCIO pins. 36 total pin(s) used --  4 pins available
        Info: I/O bank number 8 does not use VREF pins and has 3.30V VCCIO pins. 41 total pin(s) used --  2 pins available
Warning: PLL "VGA_Audio_PLL:p1|altpll:altpll_component|pll" output port clk[1] feeds output pin "AUD_XCK" via non-dedicated routing -- jitter performance depends on switching rate of other design elements. Use PLL dedicated clock outputs to ensure jitter performance
Warning: WYSIWYG primitive "VGA_OSD_RAM:u9|Img_RAM:u0|altsyncram:altsyncram_component|altsyncram_f7o1:auto_generated|altsyncram_e132:altsyncram1|ram_block2a50" has port clk1 that is stuck at GND
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Warning: WYSIWYG primitive "VGA_OSD_RAM:u9|Img_RAM:u0|altsyncram:altsyncram_component|altsyncram_f7o1:auto_generated|altsyncram_e132:altsyncram1|ram_block2a9" has port clk1 that is stuck at GND
Warning: WYSIWYG primitive "VGA_OSD_RAM:u9|Img_RAM:u0|altsyncram:altsyncram_component|altsyncram_f7o1:auto_generated|altsyncram_e132:altsyncram1|ram_block2a8" has port clk1 that is stuck at GND
Info: Fitter placement preparation operations beginning
Info: Fitter placement preparation operations ending: elapsed time is 00:00:04
Info: Fitter placement operations beginning
Info: Fitter placement was successful
Info: Fitter placement operations ending: elapsed time is 00:00:19
Info: Estimated most critical path is register to register delay of 5.646 ns
    Info: 1: + IC(0.000 ns) + CELL(0.000 ns) = 0.000 ns; Loc. = LAB_X12_Y7; Fanout = 8; REG Node = 'USB_JTAG:u1|JTAG_TRANS:u1|rCont[1]'
    Info: 2: + IC(0.560 ns) + CELL(0.178 ns) = 0.738 ns; Loc. = LAB_X12_Y7; Fanout = 1; COMB Node = 'USB_JTAG:u1|JTAG_TRANS:u1|Mux0~127'
    Info: 3: + IC(0.498 ns) + CELL(0.178 ns) = 1.414 ns; Loc. = LAB_X12_Y7; Fanout = 1; COMB Node = 'USB_JTAG:u1|JTAG_TRANS:u1|Mux0~128'
    Info: 4: + IC(0.154 ns) + CELL(0.516 ns) = 2.084 ns; Loc. = LAB_X12_Y7; Fanout = 1; COMB Node = 'USB_JTAG:u1|JTAG_TRANS:u1|Mux0~130'
    Info: 5: + IC(0.354 ns) + CELL(0.319 ns) = 2.757 ns; Loc. = LAB_X12_Y7; Fanout = 1; COMB Node = 'USB_JTAG:u1|JTAG_TRANS:u1|Mux0~131'
    Info: 6: + IC(0.154 ns) + CELL(0.521 ns) = 3.432 ns; Loc. = LAB_X12_Y7; Fanout = 1; COMB Node = 'USB_JTAG:u1|JTAG_TRANS:u1|TDO~83'
    Info: 7: + IC(1.902 ns) + CELL(0.312 ns) = 5.646 ns; Loc. = IOC_X9_Y27_N2; Fanout = 1; REG Node = 'USB_JTAG:u1|JTAG_TRANS:u1|TDO'
    Info: Total cell delay = 2.024 ns ( 35.85 % )
    Info: Total interconnect delay = 3.622 ns ( 64.15 % )
Info: Fitter routing operations beginning
Info: Average interconnect usage is 4% of the available device resources. Peak interconnect usage is 12%
    Info: The peak interconnect region extends from location X12_Y0 to location X24_Y13
Info: Fitter routing operations ending: elapsed time is 00:00:07
Info: The Fitter performed an Auto Fit compilation.  No optimizations were skipped because the design's timing and routability requirements required full optimization.
Info: Started post-fitting delay annotation
Warning: Found 256 output pins without output pin load capacitance assignment
    Info: Pin "HEX0[0]" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
    Info: Pin "HEX0[1]" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
    Info: Pin "HEX0[2]" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
    Info: Pin "HEX0[3]" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
    Info: Pin "HEX0[4]" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
    Info: Pin "HEX0[5]" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
    Info: Pin "HEX0[6]" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
    Info: Pin "HEX1[0]" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
    Info: Pin "HEX1[1]" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
    Info: Pin "HEX1[2]" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
    Info: Pin "HEX1[3]" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
    Info: Pin "HEX1[4]" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
    Info: Pin "HEX1[5]" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
    Info: Pin "HEX1[6]" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
    Info: Pin "HEX2[0]" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
    Info: Pin "HEX2[1]" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
    Info: Pin "HEX2[2]" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
    Info: Pin "HEX2[3]" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
    Info: Pin "HEX2[4]" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
    Info: Pin "HEX2[5]" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
    Info: Pin "HEX2[6]" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
    Info: Pin "HEX3[0]" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
    Info: Pin "HEX3[1]" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
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    Info: Pin "LEDR[0]" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
    Info: Pin "LEDR[1]" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
    Info: Pin "LEDR[2]" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
    Info: Pin "LEDR[3]" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
    Info: Pin "LEDR[4]" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
    Info: Pin "LEDR[5]" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
    Info: Pin "LEDR[6]" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
    Info: Pin "LEDR[7]" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
    Info: Pin "LEDR[8]" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
    Info: Pin "LEDR[9]" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
    Info: Pin "UART_TXD" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
    Info: Pin "DRAM_ADDR[0]" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
    Info: Pin "DRAM_ADDR[1]" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
    Info: Pin "DRAM_ADDR[2]" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
    Info: Pin "DRAM_ADDR[3]" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
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    Info: Pin "DRAM_ADDR[5]" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
    Info: Pin "DRAM_ADDR[6]" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
    Info: Pin "DRAM_ADDR[7]" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
    Info: Pin "DRAM_ADDR[8]" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
    Info: Pin "DRAM_ADDR[9]" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
    Info: Pin "DRAM_ADDR[10]" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
    Info: Pin "DRAM_ADDR[11]" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
    Info: Pin "DRAM_LDQM" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
    Info: Pin "DRAM_UDQM" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
    Info: Pin "DRAM_WE_N" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
    Info: Pin "DRAM_CAS_N" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
    Info: Pin "DRAM_RAS_N" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
    Info: Pin "DRAM_CS_N" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
    Info: Pin "DRAM_BA_0" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
    Info: Pin "DRAM_BA_1" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
    Info: Pin "DRAM_CLK" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
    Info: Pin "DRAM_CKE" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
    Info: Pin "FL_ADDR[0]" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
    Info: Pin "FL_ADDR[1]" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
    Info: Pin "FL_ADDR[2]" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
    Info: Pin "FL_ADDR[3]" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
    Info: Pin "FL_ADDR[4]" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
    Info: Pin "FL_ADDR[5]" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
    Info: Pin "FL_ADDR[6]" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
    Info: Pin "FL_ADDR[7]" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
    Info: Pin "FL_ADDR[8]" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
    Info: Pin "FL_ADDR[9]" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
    Info: Pin "FL_ADDR[10]" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
    Info: Pin "FL_ADDR[11]" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
    Info: Pin "FL_ADDR[12]" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
    Info: Pin "FL_ADDR[13]" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
    Info: Pin "FL_ADDR[14]" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
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    Info: Pin "FL_ADDR[19]" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
    Info: Pin "FL_ADDR[20]" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
    Info: Pin "FL_ADDR[21]" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
    Info: Pin "FL_WE_N" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
    Info: Pin "FL_RST_N" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
    Info: Pin "FL_OE_N" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
    Info: Pin "FL_CE_N" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
    Info: Pin "SRAM_ADDR[0]" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
    Info: Pin "SRAM_ADDR[1]" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
    Info: Pin "SRAM_ADDR[2]" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
    Info: Pin "SRAM_ADDR[3]" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
    Info: Pin "SRAM_ADDR[4]" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
    Info: Pin "SRAM_ADDR[5]" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
    Info: Pin "SRAM_ADDR[6]" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
    Info: Pin "SRAM_ADDR[7]" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
    Info: Pin "SRAM_ADDR[8]" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
    Info: Pin "SRAM_ADDR[9]" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
    Info: Pin "SRAM_ADDR[10]" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
    Info: Pin "SRAM_ADDR[11]" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
    Info: Pin "SRAM_ADDR[12]" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
    Info: Pin "SRAM_ADDR[13]" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
    Info: Pin "SRAM_ADDR[14]" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
    Info: Pin "SRAM_ADDR[15]" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
    Info: Pin "SRAM_ADDR[16]" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
    Info: Pin "SRAM_ADDR[17]" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
    Info: Pin "SRAM_UB_N" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
    Info: Pin "SRAM_LB_N" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
    Info: Pin "SRAM_WE_N" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
    Info: Pin "SRAM_CE_N" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
    Info: Pin "SRAM_OE_N" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
    Info: Pin "SD_CLK" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
    Info: Pin "TDO" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
    Info: Pin "I2C_SCLK" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
    Info: Pin "VGA_HS" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
    Info: Pin "VGA_VS" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
    Info: Pin "VGA_R[0]" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
    Info: Pin "VGA_R[1]" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
    Info: Pin "VGA_R[2]" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
    Info: Pin "VGA_R[3]" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
    Info: Pin "VGA_G[0]" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
    Info: Pin "VGA_G[1]" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
    Info: Pin "VGA_G[2]" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
    Info: Pin "VGA_G[3]" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
    Info: Pin "VGA_B[0]" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
    Info: Pin "VGA_B[1]" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
    Info: Pin "VGA_B[2]" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
    Info: Pin "VGA_B[3]" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
    Info: Pin "AUD_ADCLRCK" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
    Info: Pin "AUD_DACLRCK" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
    Info: Pin "AUD_DACDAT" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
    Info: Pin "AUD_XCK" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
    Info: Pin "SD_DAT3" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
    Info: Pin "SD_CMD" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
    Info: Pin "DRAM_DQ[0]" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
    Info: Pin "DRAM_DQ[1]" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
    Info: Pin "DRAM_DQ[2]" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
    Info: Pin "DRAM_DQ[3]" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
    Info: Pin "DRAM_DQ[4]" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
    Info: Pin "DRAM_DQ[5]" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
    Info: Pin "DRAM_DQ[6]" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
    Info: Pin "DRAM_DQ[7]" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
    Info: Pin "DRAM_DQ[8]" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
    Info: Pin "DRAM_DQ[9]" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
    Info: Pin "DRAM_DQ[10]" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
    Info: Pin "DRAM_DQ[11]" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
    Info: Pin "DRAM_DQ[12]" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
    Info: Pin "DRAM_DQ[13]" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
    Info: Pin "DRAM_DQ[14]" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
    Info: Pin "DRAM_DQ[15]" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
    Info: Pin "FL_DQ[0]" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
    Info: Pin "FL_DQ[1]" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
    Info: Pin "FL_DQ[2]" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
    Info: Pin "FL_DQ[3]" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
    Info: Pin "FL_DQ[4]" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
    Info: Pin "FL_DQ[5]" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
    Info: Pin "FL_DQ[6]" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
    Info: Pin "FL_DQ[7]" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
    Info: Pin "SRAM_DQ[0]" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
    Info: Pin "SRAM_DQ[1]" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
    Info: Pin "SRAM_DQ[2]" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
    Info: Pin "SRAM_DQ[3]" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
    Info: Pin "SRAM_DQ[4]" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
    Info: Pin "SRAM_DQ[5]" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
    Info: Pin "SRAM_DQ[6]" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
    Info: Pin "SRAM_DQ[7]" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
    Info: Pin "SRAM_DQ[8]" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
    Info: Pin "SRAM_DQ[9]" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
    Info: Pin "SRAM_DQ[10]" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
    Info: Pin "SRAM_DQ[11]" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
    Info: Pin "SRAM_DQ[12]" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
    Info: Pin "SRAM_DQ[13]" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
    Info: Pin "SRAM_DQ[14]" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
    Info: Pin "SRAM_DQ[15]" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
    Info: Pin "SD_DAT" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
    Info: Pin "I2C_SDAT" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
    Info: Pin "AUD_BCLK" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
    Info: Pin "GPIO_0[0]" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
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    Info: Pin "GPIO_0[3]" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
    Info: Pin "GPIO_0[4]" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
    Info: Pin "GPIO_0[5]" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
    Info: Pin "GPIO_0[6]" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
    Info: Pin "GPIO_0[7]" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
    Info: Pin "GPIO_0[8]" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
    Info: Pin "GPIO_0[9]" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
    Info: Pin "GPIO_0[10]" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
    Info: Pin "GPIO_0[11]" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
    Info: Pin "GPIO_0[12]" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
    Info: Pin "GPIO_0[13]" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
    Info: Pin "GPIO_0[14]" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
    Info: Pin "GPIO_0[15]" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
    Info: Pin "GPIO_0[16]" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
    Info: Pin "GPIO_0[17]" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
    Info: Pin "GPIO_0[18]" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
    Info: Pin "GPIO_0[19]" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
    Info: Pin "GPIO_0[20]" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
    Info: Pin "GPIO_0[21]" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
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    Info: Pin "GPIO_0[25]" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
    Info: Pin "GPIO_0[26]" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
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    Info: Pin "GPIO_0[28]" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
    Info: Pin "GPIO_0[29]" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
    Info: Pin "GPIO_0[30]" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
    Info: Pin "GPIO_0[31]" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
    Info: Pin "GPIO_0[32]" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
    Info: Pin "GPIO_0[33]" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
    Info: Pin "GPIO_0[34]" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
    Info: Pin "GPIO_0[35]" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
    Info: Pin "GPIO_1[0]" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
    Info: Pin "GPIO_1[1]" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
    Info: Pin "GPIO_1[2]" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
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    Info: Pin "GPIO_1[18]" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
    Info: Pin "GPIO_1[19]" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
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    Info: Pin "GPIO_1[22]" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
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    Info: Pin "GPIO_1[25]" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
    Info: Pin "GPIO_1[26]" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
    Info: Pin "GPIO_1[27]" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
    Info: Pin "GPIO_1[28]" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
    Info: Pin "GPIO_1[29]" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
    Info: Pin "GPIO_1[30]" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
    Info: Pin "GPIO_1[31]" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
    Info: Pin "GPIO_1[32]" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
    Info: Pin "GPIO_1[33]" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
    Info: Pin "GPIO_1[34]" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
    Info: Pin "GPIO_1[35]" has no specified output pin load capacitance -- assuming default load capacitance of 0 pF for timing analysis
Info: Delay annotation completed successfully
Info: Design uses memory blocks. Violating setup or hold times of memory block address registers for either read or write operations could cause memory contents to be corrupted. Make sure that all memory block address registers meet the setup and hold time requirements.
Warning: Following 76 pins have no output enable or a GND or VCC output enable - later changes to this connectivity may change fitting results
    Info: Pin SD_DAT3 has a permanently disabled output enable
    Info: Pin SD_CMD has a permanently disabled output enable
    Info: Pin SD_DAT has a permanently disabled output enable
    Info: Pin AUD_BCLK has a permanently enabled output enable
    Info: Pin GPIO_0[0] has a permanently disabled output enable
    Info: Pin GPIO_0[1] has a permanently disabled output enable
    Info: Pin GPIO_0[2] has a permanently disabled output enable
    Info: Pin GPIO_0[3] has a permanently disabled output enable
    Info: Pin GPIO_0[4] has a permanently disabled output enable
    Info: Pin GPIO_0[5] has a permanently disabled output enable
    Info: Pin GPIO_0[6] has a permanently disabled output enable
    Info: Pin GPIO_0[7] has a permanently disabled output enable
    Info: Pin GPIO_0[8] has a permanently disabled output enable
    Info: Pin GPIO_0[9] has a permanently disabled output enable
    Info: Pin GPIO_0[10] has a permanently disabled output enable
    Info: Pin GPIO_0[11] has a permanently disabled output enable
    Info: Pin GPIO_0[12] has a permanently disabled output enable
    Info: Pin GPIO_0[13] has a permanently disabled output enable
    Info: Pin GPIO_0[14] has a permanently disabled output enable
    Info: Pin GPIO_0[15] has a permanently disabled output enable
    Info: Pin GPIO_0[16] has a permanently disabled output enable
    Info: Pin GPIO_0[17] has a permanently disabled output enable
    Info: Pin GPIO_0[18] has a permanently disabled output enable
    Info: Pin GPIO_0[19] has a permanently disabled output enable
    Info: Pin GPIO_0[20] has a permanently disabled output enable
    Info: Pin GPIO_0[21] has a permanently disabled output enable
    Info: Pin GPIO_0[22] has a permanently disabled output enable
    Info: Pin GPIO_0[23] has a permanently disabled output enable
    Info: Pin GPIO_0[24] has a permanently disabled output enable
    Info: Pin GPIO_0[25] has a permanently disabled output enable
    Info: Pin GPIO_0[26] has a permanently disabled output enable
    Info: Pin GPIO_0[27] has a permanently disabled output enable
    Info: Pin GPIO_0[28] has a permanently disabled output enable
    Info: Pin GPIO_0[29] has a permanently disabled output enable
    Info: Pin GPIO_0[30] has a permanently disabled output enable
    Info: Pin GPIO_0[31] has a permanently disabled output enable
    Info: Pin GPIO_0[32] has a permanently disabled output enable
    Info: Pin GPIO_0[33] has a permanently disabled output enable
    Info: Pin GPIO_0[34] has a permanently disabled output enable
    Info: Pin GPIO_0[35] has a permanently disabled output enable
    Info: Pin GPIO_1[0] has a permanently disabled output enable
    Info: Pin GPIO_1[1] has a permanently disabled output enable
    Info: Pin GPIO_1[2] has a permanently disabled output enable
    Info: Pin GPIO_1[3] has a permanently disabled output enable
    Info: Pin GPIO_1[4] has a permanently disabled output enable
    Info: Pin GPIO_1[5] has a permanently disabled output enable
    Info: Pin GPIO_1[6] has a permanently disabled output enable
    Info: Pin GPIO_1[7] has a permanently disabled output enable
    Info: Pin GPIO_1[8] has a permanently disabled output enable
    Info: Pin GPIO_1[9] has a permanently disabled output enable
    Info: Pin GPIO_1[10] has a permanently disabled output enable
    Info: Pin GPIO_1[11] has a permanently disabled output enable
    Info: Pin GPIO_1[12] has a permanently disabled output enable
    Info: Pin GPIO_1[13] has a permanently disabled output enable
    Info: Pin GPIO_1[14] has a permanently disabled output enable
    Info: Pin GPIO_1[15] has a permanently disabled output enable
    Info: Pin GPIO_1[16] has a permanently disabled output enable
    Info: Pin GPIO_1[17] has a permanently disabled output enable
    Info: Pin GPIO_1[18] has a permanently disabled output enable
    Info: Pin GPIO_1[19] has a permanently disabled output enable
    Info: Pin GPIO_1[20] has a permanently disabled output enable
    Info: Pin GPIO_1[21] has a permanently disabled output enable
    Info: Pin GPIO_1[22] has a permanently disabled output enable
    Info: Pin GPIO_1[23] has a permanently disabled output enable
    Info: Pin GPIO_1[24] has a permanently disabled output enable
    Info: Pin GPIO_1[25] has a permanently disabled output enable
    Info: Pin GPIO_1[26] has a permanently disabled output enable
    Info: Pin GPIO_1[27] has a permanently disabled output enable
    Info: Pin GPIO_1[28] has a permanently disabled output enable
    Info: Pin GPIO_1[29] has a permanently disabled output enable
    Info: Pin GPIO_1[30] has a permanently disabled output enable
    Info: Pin GPIO_1[31] has a permanently disabled output enable
    Info: Pin GPIO_1[32] has a permanently disabled output enable
    Info: Pin GPIO_1[33] has a permanently disabled output enable
    Info: Pin GPIO_1[34] has a permanently disabled output enable
    Info: Pin GPIO_1[35] has a permanently disabled output enable
Warning: Following 81 pins have nothing, GND, or VCC driving datain port -- changes to this connectivity may change fitting results
    Info: Pin UART_TXD has GND driving its datain port
    Info: Pin FL_RST_N has VCC driving its datain port
    Info: Pin SRAM_UB_N has GND driving its datain port
    Info: Pin SRAM_LB_N has GND driving its datain port
    Info: Pin SRAM_CE_N has GND driving its datain port
    Info: Pin SD_CLK has GND driving its datain port
    Info: Pin SD_DAT3 has VCC driving its datain port
    Info: Pin SD_CMD has VCC driving its datain port
    Info: Pin SD_DAT has VCC driving its datain port
    Info: Pin GPIO_0[0] has VCC driving its datain port
    Info: Pin GPIO_0[1] has VCC driving its datain port
    Info: Pin GPIO_0[2] has VCC driving its datain port
    Info: Pin GPIO_0[3] has VCC driving its datain port
    Info: Pin GPIO_0[4] has VCC driving its datain port
    Info: Pin GPIO_0[5] has VCC driving its datain port
    Info: Pin GPIO_0[6] has VCC driving its datain port
    Info: Pin GPIO_0[7] has VCC driving its datain port
    Info: Pin GPIO_0[8] has VCC driving its datain port
    Info: Pin GPIO_0[9] has VCC driving its datain port
    Info: Pin GPIO_0[10] has VCC driving its datain port
    Info: Pin GPIO_0[11] has VCC driving its datain port
    Info: Pin GPIO_0[12] has VCC driving its datain port
    Info: Pin GPIO_0[13] has VCC driving its datain port
    Info: Pin GPIO_0[14] has VCC driving its datain port
    Info: Pin GPIO_0[15] has VCC driving its datain port
    Info: Pin GPIO_0[16] has VCC driving its datain port
    Info: Pin GPIO_0[17] has VCC driving its datain port
    Info: Pin GPIO_0[18] has VCC driving its datain port
    Info: Pin GPIO_0[19] has VCC driving its datain port
    Info: Pin GPIO_0[20] has VCC driving its datain port
    Info: Pin GPIO_0[21] has VCC driving its datain port
    Info: Pin GPIO_0[22] has VCC driving its datain port
    Info: Pin GPIO_0[23] has VCC driving its datain port
    Info: Pin GPIO_0[24] has VCC driving its datain port
    Info: Pin GPIO_0[25] has VCC driving its datain port
    Info: Pin GPIO_0[26] has VCC driving its datain port
    Info: Pin GPIO_0[27] has VCC driving its datain port
    Info: Pin GPIO_0[28] has VCC driving its datain port
    Info: Pin GPIO_0[29] has VCC driving its datain port
    Info: Pin GPIO_0[30] has VCC driving its datain port
    Info: Pin GPIO_0[31] has VCC driving its datain port
    Info: Pin GPIO_0[32] has VCC driving its datain port
    Info: Pin GPIO_0[33] has VCC driving its datain port
    Info: Pin GPIO_0[34] has VCC driving its datain port
    Info: Pin GPIO_0[35] has VCC driving its datain port
    Info: Pin GPIO_1[0] has VCC driving its datain port
    Info: Pin GPIO_1[1] has VCC driving its datain port
    Info: Pin GPIO_1[2] has VCC driving its datain port
    Info: Pin GPIO_1[3] has VCC driving its datain port
    Info: Pin GPIO_1[4] has VCC driving its datain port
    Info: Pin GPIO_1[5] has VCC driving its datain port
    Info: Pin GPIO_1[6] has VCC driving its datain port
    Info: Pin GPIO_1[7] has VCC driving its datain port
    Info: Pin GPIO_1[8] has VCC driving its datain port
    Info: Pin GPIO_1[9] has VCC driving its datain port
    Info: Pin GPIO_1[10] has VCC driving its datain port
    Info: Pin GPIO_1[11] has VCC driving its datain port
    Info: Pin GPIO_1[12] has VCC driving its datain port
    Info: Pin GPIO_1[13] has VCC driving its datain port
    Info: Pin GPIO_1[14] has VCC driving its datain port
    Info: Pin GPIO_1[15] has VCC driving its datain port
    Info: Pin GPIO_1[16] has VCC driving its datain port
    Info: Pin GPIO_1[17] has VCC driving its datain port
    Info: Pin GPIO_1[18] has VCC driving its datain port
    Info: Pin GPIO_1[19] has VCC driving its datain port
    Info: Pin GPIO_1[20] has VCC driving its datain port
    Info: Pin GPIO_1[21] has VCC driving its datain port
    Info: Pin GPIO_1[22] has VCC driving its datain port
    Info: Pin GPIO_1[23] has VCC driving its datain port
    Info: Pin GPIO_1[24] has VCC driving its datain port
    Info: Pin GPIO_1[25] has VCC driving its datain port
    Info: Pin GPIO_1[26] has VCC driving its datain port
    Info: Pin GPIO_1[27] has VCC driving its datain port
    Info: Pin GPIO_1[28] has VCC driving its datain port
    Info: Pin GPIO_1[29] has VCC driving its datain port
    Info: Pin GPIO_1[30] has VCC driving its datain port
    Info: Pin GPIO_1[31] has VCC driving its datain port
    Info: Pin GPIO_1[32] has VCC driving its datain port
    Info: Pin GPIO_1[33] has VCC driving its datain port
    Info: Pin GPIO_1[34] has VCC driving its datain port
    Info: Pin GPIO_1[35] has VCC driving its datain port
Info: Following groups of pins have the same output enable
    Info: Following pins have the same output enable: Multi_Sdram:u3|Sdram_Controller:u1|command:command1|OE
        Info: Type bidirectional pin DRAM_DQ[2] uses the 3.3-V LVTTL I/O standard
        Info: Type bidirectional pin DRAM_DQ[9] uses the 3.3-V LVTTL I/O standard
        Info: Type bidirectional pin DRAM_DQ[0] uses the 3.3-V LVTTL I/O standard
        Info: Type bidirectional pin DRAM_DQ[7] uses the 3.3-V LVTTL I/O standard
        Info: Type bidirectional pin DRAM_DQ[15] uses the 3.3-V LVTTL I/O standard
        Info: Type bidirectional pin DRAM_DQ[6] uses the 3.3-V LVTTL I/O standard
        Info: Type bidirectional pin DRAM_DQ[14] uses the 3.3-V LVTTL I/O standard
        Info: Type bidirectional pin DRAM_DQ[5] uses the 3.3-V LVTTL I/O standard
        Info: Type bidirectional pin DRAM_DQ[13] uses the 3.3-V LVTTL I/O standard
        Info: Type bidirectional pin DRAM_DQ[4] uses the 3.3-V LVTTL I/O standard
        Info: Type bidirectional pin DRAM_DQ[12] uses the 3.3-V LVTTL I/O standard
        Info: Type bidirectional pin DRAM_DQ[3] uses the 3.3-V LVTTL I/O standard
        Info: Type bidirectional pin DRAM_DQ[11] uses the 3.3-V LVTTL I/O standard
        Info: Type bidirectional pin DRAM_DQ[10] uses the 3.3-V LVTTL I/O standard
        Info: Type bidirectional pin DRAM_DQ[1] uses the 3.3-V LVTTL I/O standard
        Info: Type bidirectional pin DRAM_DQ[8] uses the 3.3-V LVTTL I/O standard
    Info: Following pins have the same output enable: Multi_Flash:u2|Flash_Controller:u1|ST.READ (inverted)
        Info: Type bidirectional pin FL_DQ[2] uses the 3.3-V LVTTL I/O standard
        Info: Type bidirectional pin FL_DQ[0] uses the 3.3-V LVTTL I/O standard
        Info: Type bidirectional pin FL_DQ[7] uses the 3.3-V LVTTL I/O standard
        Info: Type bidirectional pin FL_DQ[6] uses the 3.3-V LVTTL I/O standard
        Info: Type bidirectional pin FL_DQ[5] uses the 3.3-V LVTTL I/O standard
        Info: Type bidirectional pin FL_DQ[4] uses the 3.3-V LVTTL I/O standard
        Info: Type bidirectional pin FL_DQ[3] uses the 3.3-V LVTTL I/O standard
        Info: Type bidirectional pin FL_DQ[1] uses the 3.3-V LVTTL I/O standard
    Info: Following pins have the same output enable: Multi_Sram:u6|SRAM_WE_N~56
        Info: Type bidirectional pin SRAM_DQ[10] uses the 3.3-V LVTTL I/O standard
        Info: Type bidirectional pin SRAM_DQ[1] uses the 3.3-V LVTTL I/O standard
        Info: Type bidirectional pin SRAM_DQ[8] uses the 3.3-V LVTTL I/O standard
        Info: Type bidirectional pin SRAM_DQ[7] uses the 3.3-V LVTTL I/O standard
        Info: Type bidirectional pin SRAM_DQ[15] uses the 3.3-V LVTTL I/O standard
        Info: Type bidirectional pin SRAM_DQ[6] uses the 3.3-V LVTTL I/O standard
        Info: Type bidirectional pin SRAM_DQ[14] uses the 3.3-V LVTTL I/O standard
        Info: Type bidirectional pin SRAM_DQ[5] uses the 3.3-V LVTTL I/O standard
        Info: Type bidirectional pin SRAM_DQ[13] uses the 3.3-V LVTTL I/O standard
        Info: Type bidirectional pin SRAM_DQ[4] uses the 3.3-V LVTTL I/O standard
        Info: Type bidirectional pin SRAM_DQ[12] uses the 3.3-V LVTTL I/O standard
        Info: Type bidirectional pin SRAM_DQ[3] uses the 3.3-V LVTTL I/O standard
        Info: Type bidirectional pin SRAM_DQ[11] uses the 3.3-V LVTTL I/O standard
        Info: Type bidirectional pin SRAM_DQ[2] uses the 3.3-V LVTTL I/O standard
        Info: Type bidirectional pin SRAM_DQ[9] uses the 3.3-V LVTTL I/O standard
        Info: Type bidirectional pin SRAM_DQ[0] uses the 3.3-V LVTTL I/O standard
    Info: Following pins have the same output enable: I2C_AV_Config:u10|I2C_Controller:u0|SDO
        Info: Type bidirectional pin I2C_SDAT uses the 3.3-V LVTTL I/O standard
Warning: The Reserve All Unused Pins setting has not been specified, and will default to 'As output driving ground'.
Info: Generated suppressed messages file //file2/R1/DE1/cd/source/DE1_CD_v0.7/DE1_demonstrations/DE1_USB_API/HW/DE1_USB_API.fit.smsg
Info: Quartus II Fitter was successful. 0 errors, 57 warnings
    Info: Allocated 227 megabytes of memory during processing
    Info: Processing ended: Thu Aug 30 15:45:33 2007
    Info: Elapsed time: 00:00:56


+----------------------------+
; Fitter Suppressed Messages ;
+----------------------------+
The suppressed messages can be found in //file2/R1/DE1/cd/source/DE1_CD_v0.7/DE1_demonstrations/DE1_USB_API/HW/DE1_USB_API.fit.smsg.


